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RSS订阅转载 FPGA的同步时序设计 2012_7_29
FPGA 同步时钟设计 建立时间 保持时间数字电路中，时钟是整个电路最重要、最特殊的信号。第一，系统内大部分器件的动作都是在时钟的跳变沿上进行，这就要求时钟信号时延差要非常小，否则就可能造成时序逻辑状态出错。第二，时钟信号通常是系统中频率最高的信号。第三，时钟信号通常是负载最重的信号，所以要合理分配负载。出于这样的考虑在FPGA这类可编程器件内部一般都设有数量不等的专门用于系
2012-07-29 17:08:27
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原创 FPGA和CPLD使用时的区别 2012_7_29
FPGA是现场可编程逻辑门阵列的简称，是电子设计的一个里程碑。CPLD是复杂可变成逻辑器件的简称。尽管FPGA和CPLD都是可编程ASIC器件,有很多共同特点,但由于CPLD和FPGA结构上的差异,具有各自的特点:1）、CPLD更适合完成各种算法和组合逻辑,FP GA更适合于完成时序逻辑。换句话说,FPGA更适合于触发器丰富的结构,而CPLD更适合于触发器有限而乘积项丰富的结构。2）、CP
2012-07-29 09:24:15
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转载 FPGA设计者的5项基本功 2012_7_29
记得《佟林传》里，佟林练的基本功是“绕大树、解皮绳”，然后才练成了什么“鬼影随行、柳叶绵丝掌”。在我看来，成为一名说得过去的FPGA设计者，需要练好5项基本功：仿真、综合、时序分析、调试、验证。需要强调的一点是，以上基本功是针对FPGA设计者来说的，不是针对IC设计者的。对于IC设计，我不懂，所以不敢妄言.对于FPGA设计者来说，练好这5项基本功，与用好相应的EDA工具是同一过程，
2012-07-29 08:52:21
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转载 VHDL语言简单的教程 2012_7_29
VHDL——（Very high speed intergated circuit- Hardware Description Language）最初诞生于由美国国防部所支持的研究计划，目的是为了把电子电路的设计意义以文字或文件的方式保存下来。现已成为国际标准硬件描述语言。93年为IEEEll64标准，96年后改为IEEEl076．3标准，现为IEEE 1364-1995 标准。ABE
2012-07-29 07:06:19
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转载 28nm创新加速FPGA应用 2012_7_28
今年赛灵思的市场策略重点就是全力打造28纳米FPGA，通过一项项突破性的创新技术，不仅为不断加速的FPGA应用提供支持，而且也致力于让这种加速度更快。这些创新我相信大家都是有目共睹的，包括以下几方面：首先，选择最佳工艺，和台积电一起开发高性能低功耗HPL工艺用来打造统一平台的28nm产品。其次，率先在FPGA上应用堆叠硅片互联技术(SSIT 3D FPGA技术)，从而把FPGA的容量提升至
2012-07-28 21:56:02
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转载 跨时钟域异步时序设计 2012_7_28
1）问题产生：亚稳态 因为不同时钟域，每一个触发器都有其规定的建立(setup)和保持(hold)时间参数, 在这个时间参数内，输入信号在时钟的上升沿是不允许发生变化的。如果在信号的建立时间中对其进行采样，得到的结果将是不可预知的，即亚稳态。2）解决方法之一：打二拍 若触发器进入亚稳态的时间可以用可靠性指标MTBF来描述的话，不打二拍时的MTBF为MTBF = e (tr/
2012-07-28 21:50:54
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转载 Xilinx FPGA设计经验小谈 2012_7_28
简单总结：1.衡量FPGA的性能以及是否满足实际需求，按 性能=逻辑数X速度+BRAM数X系数来计算，BRAM系数比较麻烦，一般只按 性能=逻辑数X速度 来计算。这是一个非常重要的概念，另一重意思就是 面积与速度的积对于一个项目而言是个定数。原始设计速度为100M，完成同样的事，速度跑到400M时理论上资源可以少到1/4。2.仔细计算好流水线，尽量提高编译报告的速度。速度可以换面积，同
2012-07-28 21:42:11
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转载 Xilinx FPGA开发工具链各自特点 2012_7_28
ISE：最基本的逻辑开发和行为仿真工具，编码设计第一步。检查工具包括综合器、布局布线器、功耗估计器、时序分析器等。值得一提的是功耗估计器，布局布线完毕后可以在层次结构中看到各个子模块的资源消耗，从而为代码优化提供下手的基本定位。时序分析器则是基本的代码风格检查器，如果节拍、流水线做得不好，可以通过错误报告迅速定位。而IP向导就是一个非常强大的工具了，可以载入Xilinx FPGA的多种可用基本
2012-07-28 20:53:18
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转载 决定高薪的细节守则 2012_07_28
每天晚上8点到10点之间，你在做什么基本决定着你是薪水见涨，还是薪水见降。 8点到10点之间，是在有目的性阅读，还是为明天的事情做准备，甚至在充电专业或研习第二专长？不管是哪一样，都有可能迈向成功，一个非常了解自己需要，同时也懂得善待时间的人不可能是一个无效率的人，而效率在这个时代意味着什么则是不言而喻，一个有效率的人，就连一个单位的同事都乐于与你共事。欲求高薪，首先让我们做个有效
2012-07-28 11:03:42
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转载 同步、异步电路 2012_07_28
异步电路主要是组合逻辑电路，用于产生地址译码器、ＦＩＦＯ或ＲＡＭ的读写控制信号脉冲，但它同时也用在时序电路中，此时它没有统一的时钟，状态变化的时刻是不稳定的，通常输入信号只在电路处于稳定状态时才发生变化。也就是说一个时刻允许一个输入发生变化，以避免输入信号之间造成的竞争冒险。电路的稳定需要有可靠的建立时间和持时间，待下面介绍。 同步电路是由时序电路(寄存器和各种触发器)和组合逻辑
2012-07-28 10:43:47
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原创 日报_2012_07_27
zImage uImage.img 电平不稳 支持24k 8k pagesize nand硬件 管脚 焊接 生命科学 体检
2012-07-27 22:27:11
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原创 日报_2012_07_26
三星电子 K9LCG08U0A Nandflash Datasheet Nandflash驱动 2k 4k 8k pagesize 还需uboot深入
2012-07-27 22:25:37
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原创 日报_2012_07_25
nand驱动 Xshel tftp uboot nand nor ftp live555 onvif 网络分析仪 段错误 gdb 稳定性 lsmod mount -t nfs -o nolock 192.168.1.107:/ /mnt setenv mdio_intf mii 协议
2012-07-27 22:24:15
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原创 日报_2012_07_24
ISE ChipScope Pro verilog任务&函数 思考同步 XPS Isim Created my first video PCORE!
2012-07-27 21:59:05
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原创 日报_2012_07_23
Spartan-6 Industrial Video Processing Kit EDK Reference Design Tutorial 行 列 同步 德国 资料 软件 IVK_Camera_Frame_Buffer_Demo IVK_Camera_Frame_Buffer_Demo_CFA_Tutorial Camera 成功
2012-07-27 21:49:50
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原创 日报_2012_07_21
ModelSim 10.1a来了 Modelsim SE 10.1a 硬件模块化 配对（语言，频率，带宽等） 时钟-》其他时钟 丢失，水印 通信协议 软件控 原理图 Matlab
2012-07-27 21:09:46
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原创 日报_2012_07_20
X-fest Zynq-7000 EPP可扩展处理平台介绍(硬件，bootloader-secure) 采用Xilinx 7系列FPGA的显示世界数据采样和处理(ADC sensor) 采用Xilinx FPGA设计高像素率视频系统(带宽) 采用Xilinx 7系列FPGA高性能时钟(分频,buffer)
2012-07-20 22:06:17
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原创 日报_2012_07_19
MicroBlaze ISEISE NavigatorIsimISE ImpactChip Scopepro EDKXilinx Platform StudioIsimXilinx Software Development KitChip Scopepro CCD+FPGA(PCI) Ready X-fest D/A AD55
2012-07-20 22:03:03
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原创 日报_2012_07_18
实验2 为硬件设计添加IP IP MHS文件(手动) 自动 添加IP到处理器系统 扩展硬件系统 分析MHS文件 硬件验证设计 实验3 添加自定制IP实验 打开工程 使用向导创建一个定制 将自定制外设添加到系统 硬件验证设计 实验4 创建基本应用程序 更新项目 创建一个BSP
2012-07-20 21:57:13
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原创 日报_2012_07_17
管脚约束(编译通过)更换FPGA图像数据采集卡PCI核Xilinx-FPGA前段采集后端采集DMA接受和发送数据芯片DS92LV16SRAM乒乓PCI接口地址空间配置FIFO IP 块RAM配置支持库 中断支持库数据采集方式 查询 中断Xilinx Platfor
2012-07-20 21:31:32
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原创 日报_2012_07_16
34针 实物图 ISE 程序 编译 仿真 综合 管脚约束(datasheet) LED流水灯 规划和预算 创建代码/原理图 HDL RTL仿真 综合以创建网表 功能仿真 实现(翻译 映射 布局和布线) 时序收敛 时序仿真 产生比特流 配置FPGA DEVICE ID IDCODE
2012-07-20 20:05:43
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原创 日报_2012_07_15
搜集资料 relax copy from user copy to user Cadence葵花宝典-成为Xilinx FPGA设计专家(基础篇)QPSK调制解调器，抗多径算法 莫尔型状态机
2012-07-20 20:00:12
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原创 日报_2012_07_14
地感线圈 抓拍 人脸闪光灯(补光) 白线(补色) 电警 拍 红绿灯 datasheet PCI FPGA XILINX 启动体验 XILINX LT150PCB 顶层 底层 接地层 电源层Release
2012-07-20 19:59:11
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原创 日报_2012_07_13
1.SPARTAN 硬件 硬件图 2.LX150T ISE软件の硬件设计，仿真 3.DATASHEET *SCH 原理图 4.LCD interface 5.BOM list sample:flash-bounces.v / flash.sch / flash_tb.vhd / hex2led.vhd / lxro117.sch 6.hi
2012-07-13 20:29:49
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原创 日报_2012_07_12
FPGA SOPC硬件系统 SOPC软件系统 硬件最小系统设计 *nand*.* 代码 XILINX SPARTAN TAIWAN
2012-07-13 20:23:09
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原创 日报_2012_07_11
MCU CPCC GPU NAND FLASH选型和调研 nand闪存架构 SLC,MLC,MBC 传感器 温度传感器 无源 机械波电磁波 自动光圈 电机转动 PWM 实时 压缩因子 RFID组网 matlab GUI EPC-RFID协议 m文件转换成cpp文件 算法语言转换 sw6开关电路图
2012-07-13 20:21:05
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原创 日报_2012_07_10
altium designer卡口抓拍 (一) ISPONVIF 协议与NVR通信(security)MJPEG和H264双线程reboot脚步实现CMOS-------------线圈距离限速值对时重启 (处理函数)------------udp多播实现远程格式化SD卡，升级静电测试，放电，抗扰度远程校时，重
2012-07-13 19:53:46
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原创 日报_2012_07_09
MODELSIM ISE DESIGN SUITE (I SIMLATOR) MATLAB2010->MATLAB2011 (SIMULINK) MAC地址一致(局域网内) 可能导致ping不通 ISE安装+license12x.lic vs2005 Nandflash panysonic MLC(工艺高)SLC(工艺低)
2012-07-13 19:28:26
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原创 日报_2012_07_08
XILINX ISE FPGA module ledloop(iclk,ob); output[7:0] ob; input iclk; reg ob; reg[24:0] count ; always@(posedge iclk) begin count ob[7:0] endendmodule NET "ob" LOC = P
2012-07-08 15:45:58
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原创 日报_2012_07_07
ModelSim 前仿真,后仿真 ModelSim 读写文件 (excel/matlab生成所需输入数据.dat)-write_read_file.v($fdisplay)相当于fwrite,($display)相当于printf,($readmemh)相当于fread PCIe DMA
2012-07-08 08:01:50
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原创 日报_2012_07_06
1,由u-boot.map全面了解Hi3516之uboot关于nandflash启动相关代码 2,Hi3516之uboot关于nandflash启动相关代码,新增加K9LCG08U0A芯片相应信息，最后生成"1+1"合成uboot 3,建立fedora之eclipse安装并测试通过 4,FPGA X-fest EPP-ACP
2012-07-07 06:05:51
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原创 日报_2012_07_04
1,深入nandflash驱动 Hinfc301.c Hinfc_godeyes.c 2,了解nandflash硬件，映射等相关内容 3,熟悉Hi3516摄像机 用超级终端操作(或特里net) 4,探讨Udp丢包事宜
2012-07-07 06:03:38
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原创 日报_2012_07_03
1,fedora环境tftp服务器搭建 2,SDK导入fedora 3,了解uboot,uImage,rootfs知识 4,熟悉uboot(1+1)制作过程 5,熟悉linux内核制作过程 6,熟悉zImage->uImage,定位Hi3516之uboot_nand驱动代码
2012-07-07 06:01:33
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原创 7_1_天天向上_FPGA_2
Verilog任务parameter MAX_BITS=8;reg[MAX_BITS:1]D;task reverse_bits; inout[7:0]data;//双口总线被视为寄存器类型 integer K; for(k=0;k reverse_bits[MAX_BITS-(K+1)]=data[K];endtaskalways@(posedge clk)
2012-07-02 06:08:06
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原创 7_1_天天向上_FPGA_1
Case语句+优化器module dircase(a,b,c,d);input b,c;input[1:0]a;output d;reg d;always @(a or b or c) case(a)//ambit synthesis case=full 2`b00:d=b; 2`b01:d=c; endcaseendmoduleassign q=(
2012-07-01 16:57:32
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SD-WiFi 1035原理图和驱动等
2018-09-05
u-boot-mini2440-micro2440-启发-万能-成功版
2012-01-20
空空如也
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