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RSS订阅原创 Project5&6 Verilog开发流水线CPU
本文是笔者在使用Verilog开发流水线CPU过程中的一些记录与反思，希望能给大家开发流水线CPU带来一点帮助。内容主要分为冲突的覆盖性组合分析、带转发的数据通路与信号设计、初步代码编写、设计测试代码与调试过程以及一些思考五个部分，在设计与开发过程中会向读者频繁地传达流水线设计的工程化方法。
2015-12-17 04:25:31
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原创 HDU 4851 Wow! Such Precision!
题目：http://acm.hdu.edu.cn/showproblem.php?pid=4851 题意： 给定一个非负整数nnn，请你构造一个nnn次多项式f(x)f(x)f(x)，使得∫10(f(x)−ex)2dx∫01(f(x)−ex)2dx\int_{0}^{1}{(f(x)-e^x)^2dx}取得最小值。给出f(x)f(x)f(x)的n+1n+1n+1个项的系数，要求精度误差不超过1...
2015-12-02 23:39:30
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空空如也
空空如也
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