如果在一个工程中有两个vhd文件，就相当于有两个模块，那么对于这个工程整体的bdf文件生成，怎么把这两个模块都加到同一个bdf文件中。bdf文件中两个模块之间的连线及输入输出，是自己输进去的还是自动生

最新推荐文章于 2023-01-14 00:08:15 发布
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分类专栏： FPGA

如果在一个工程中有两个vhd文件，就相当于有两个模块，那么对于这个工程整体的bdf文件生成，怎么把这两个模块都加到同一个bdf文件中。bdf文件中两个模块之间的连线及输入输出，是自己输进去的还是自动生成的呢？


做一个顶层模块，在其中例化你说提到的两个模块，VHDL文件转化为元件，顶层原理图进行元件调用也可

zhanghuaichao
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