利用Logsim实现4位一个二进制数的补码器电路

已于 2023-10-20 21:37:48 修改
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于 2023-10-19 23:48:10 首次发布
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一、1bit半加器

、1bit半加器使用一个异或门和一个与门组成，异或门表示两个数相加后的数，与门表示其进制

二、1bit全加器

全加器可看作是两个半加器的叠加，与半加器相比还可接收一个低位进位输入信号

三、4bit二进制补码器

根据补码的规则，若输入的数位正数则补码和原码相同，若为负数则除符号位其余的全部取反再加1。因此，可将每位数同符号位用异或门进行计算，判断是否需要取反，然后进行计算

总结

此次实现补码器既是对补码原理的熟悉，也是对logsim的熟悉

2201_75518371
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