Zhang万年
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个人简介:欲穷千里目,更上一层楼

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楠潼的博客

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欲穷千里目,更上一层楼
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    2021年
  • 5篇
    2020年
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  • C 冲锋号
    1篇
  • Linux 企鹅号
    2篇
  • 数据结构&算法
    4篇
  • 现代通信
    1篇
  • OMNET++ 实践号
  • 计算机网络配置
    8篇
  • EDA实践
    10篇
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AI大模型如何赋能电商行业,引领变革?

如何使用AI技术实现购物推荐、会员分类、商品定价等方面的创新应用?如何运用AI技术提高电商平台的销售效率和用户体验呢?欢迎分享您的看法

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升官发财

发布动态 2022.02.04

萬事如意,財源滾滾

发布动态 2022.02.01

在现实网络中 有没有存在 无线路由器 通过无线连着 无线路由器的情况? 如果有的话,还麻烦大佬解释一下这中间的原理和所用到的协议…

发布动态 2021.11.20

求助! 无线数据中心网络仿真的资料

发布动态 2021.10.18

万字【C语言最快入门总结】保姆级教学,小白必看

目录第1章初始C程序... 41-2 C语言结构... 41-4必不可少之主函数... 41-5良好习惯之规范... 51-6程序解析——注释... 6第2章 C中数据类型... 72-1有名有姓的C.. 72-3变量及赋值... 72-4基本数据类型... 82-5格式化输出语句... 9...
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发布博客 2021.09.15 ·
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基于linux的色盲检测系统.rar

发布资源 2021.09.14 ·
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嵌入式开发入门设计 —— 色盲检测系统

前言说到色盲,大家肯定会想到各种奇奇怪怪的图片,比如下图:可能你看来看去,也看不出来图片中有啥;可能你第一眼看过去就知道图片中有个图形,但它是三角形呢?还是圆形呢?还是方形呢?「可先在评论区留下你的答案」,等会在文末附上参考答案。既然是嵌入式,当然少不了虚拟机了。我用的是VMare Workstation 16,使用的ubuntu 也是16。至于为什么都是16呢,当然与它的各项性能有关。下面正式进入正题。环境测试测试,当然需要看到才能测试,所以先把测试环境给搭建起来。本次设计使用的.
原创
发布博客 2021.09.14 ·
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嵌入式开发之 TCP/IP & UDP 网络编程和比较

目录UDP通信总体流程udp发送端流程创建套接字绑定ip地址和端口号发送信息关闭套接字udp接收端流程接收信息具体例子如下:TCP / IP 流程UDP通信流程udp通信协议的流程和实现步骤 发送端:socket --》bind --》sendto --》close 接收端:socket --》bind --》recvfrom --》closeudp发送端流程创建套接字int socket(int domain...
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发布博客 2021.09.14 ·
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LTE通信系统的网络拓扑结构(4G)

GPRS(General Packet Radio Service) ...
原创
发布博客 2021.07.02 ·
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乐曲设计eda(含乐曲源文件)xizo.rar

发布资源 2021.02.27 ·
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EDA(Quartus II)——乐曲硬件演奏电路设计

实验目的:学习设计硬件乐曲演奏电路以及相关的控制电路。实验原理:组成乐曲的每个音符的发音频率值及其持续的时间是乐曲能连续演奏所需要的两个基本要素,问题是如何来获取这两个要素所对应的数值以及通过纯硬件的手段来利用这些数值实现乐曲的演奏效果。如图1所示为乐曲硬件演奏的电路原理图。其中rom_liangzhu为歌曲“梁祝”部分音符数据产生器,cnt_1为地址发生器,decoder_1为初始值设置译码器,dvf为数控分频器,PLL2和PLL3为分频器,其中PLL2将10MHz的信号分频成为1MHz和
原创
发布博客 2021.02.27 ·
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EDA(Quartus II)——ADC采样控制电路设计

实验目的:用状态机控制ADC0809实现A/D转换。实验原理:如下图所示为状态机控制ADC0809的结构框图。图1 采样状态机结构框图用状态机对ADC0809进行采样控制,首先必须了解其工作时序,然后据此作出状态图,最后写出相应的Verilog代码。ADC0809是8位CMOS A/D转换器,片内有8路模拟开关,可控制8个模拟量中的一个进入转换器中。ADC0809的分辨率为8位,转换时间约100us,含锁存控制的8路多路开关,输出有三态缓冲器控制,单5V电源供电。如图2所示为ADC0
原创
发布博客 2021.02.27 ·
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序列检测机_状态机test8.zip

发布资源 2021.02.26 ·
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EDA(Quartus II)——序列检测器设计

引言:有限状态机及其设计技术是实用数字系统设计中的重要组成部分,也是实现高效率、高可靠和高速控制逻辑系统的重要途径。广义而论,只要是涉及触发器的电路,无论电路大小,都能归结为状态机。因此,对于数字系统设计工程师,面对的只要是时序电路设计,状态机的概念则是必须贯穿于整个设计始终的最基本的设计思想和设计方法。基于现代数字系统设计技术的状态机的HDL表述形态和表述风格具有一定的典型性和规律化。只要把握了这些固定的语句表达部分,就能根据实际需要写出各种不同风格和面向不同实用目的的Verilog状态机了.
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发布博客 2021.02.26 ·
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shiyan7.rar

发布资源 2021.02.26 ·
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EDA(Quartus II)——8位硬件乘法器设计

实验目的:1、学习应用移位相加原理设计8位乘法器。2、了解移位相加原理构成乘法器与用组合逻辑电路直接设计的同样功能的电路优势。设计方法:方法一:(用乘号实现乘法)module chengfaqi(a,b,dout);input [7:0] a,b;output [15:0] dout;assign dout=a*b;endmodule仿真波形:方法二:(用移位相加的方法实现乘法)module cfq_ywxj_1(a,b,dout);input[7:0] a
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发布博客 2021.02.26 ·
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FPGA_SAVE.zip

发布资源 2021.02.16 ·
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EDA(Quartus II)——8位16进制频率计设计

实验目的:设计8位16进制频率计,学习较复杂的数字系统设计方法。实验预习:复习计数器和寄存器的设计。实验原理:(1)频率计的功能是什么?(测量频率的仪器)(2)频率计前面的定语“8位16进制”限定了什么?(频率计的测频范围)根据频率的定义和频率测量的基本原理,测定信号的频率必须有一个脉宽为1秒的输入信号作为脉冲计数允许的信号。1秒计数结束后,计数值将被锁入锁存器,计数器清零,为下一次测频计数周期作好准备。设计要求:如图1所示为8位16进制频率计原理图。其中..
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发布博客 2021.02.16 ·
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SHIYAN5.rar

发布资源 2021.02.15 ·
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EDA(Quartus II)——正弦信号发生器的设计

实验目的:进一步熟悉QuartusⅡ及其LPM_ROM与FPGA硬件资源的使用方法。实验预习:定制LPM_ROM模块流程。实验原理: EDA是电子设计自动化,对象是数字电路设计,而正弦信号发生器的设计却是一个模拟电路设计,因此需要用到D/A转换器。 根据正弦信号发生器的波形,得知该实验的输入为时间,而输出为振幅。如果将正弦波的振幅放在存储单元为64的ROM中,根据ROM的功能得知,ROM中的数据与地址是一一对应关系,因此设计由时间和振幅的对应关系转换为时间和地址的对应...
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发布博客 2021.02.15 ·
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