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RSS订阅原创 EMIO，不只是MIO的重复扩展
上传到开发板可以看到两个led交替闪烁，这说明EMIO并不是直接连接到PL的输出部分，而是经过PL单元内，可以在PL端编写逻辑接入EMIO。在ps的ip核中，首先在外设引脚中，打开EMIO，然后设置EMIO位宽为2位，设置好使用的内存位宽和型号后。在综合的原理图中，可以发现PS的IP核经过Verilog中设置的两个门电路后，输出到外部引脚。设置完成后，在模块设计中可以得到下图，运行绿色提示的自动设计，自动连接DDR内存和固定IO。zynq的IO引脚中，除了直接与PS端连接的MIO外，也集成了EMIO。
2023-07-16 13:06:15
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空空如也
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