学习笔记1

最新推荐文章于 2022-12-19 21:47:33 发布

倔强的萤火虫

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分类专栏： system verilog 文章标签： verilog

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case语句是组合逻辑，用阻塞赋值语句

1、时序逻辑，使用“非阻塞赋值”。

2、锁存器（latch）建模，使用“非阻塞赋值”。

3、组合逻辑，使用“阻塞赋值”

4、当在同一个always块里面既为组合逻辑又为时序逻辑时，使用“非阻塞赋值”。

5、组合逻辑输出时，为消除毛刺会在输出端加一个触发器，即使用非阻塞赋值

6.寄存器输出没有毛刺

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case语句是组合逻辑，用阻塞赋值语句1、时序逻辑，使用“非阻塞赋值”。2、锁存器（latch）建模，使用“非阻塞赋值”。3、组合逻辑，使用“阻塞赋值”4、当在同一个always块里面既为组合逻辑又为时序逻辑时，使用“非阻塞赋值”。5、组合逻辑输出时，为消除毛刺会在输出端加一个触发器，即使用非阻塞赋值6.寄存器输出没有毛刺...
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