卷舒开合任天真

不戚年往,忧知菲薄

ArrayFire中文教程[1]

在做GPU开发设计的时候,遇到了ArrayFire,但我对ArrayFire并不了解。本文档编写的目的是为了学习ArrayFire。同时,该系列文档是我于业余时间来翻译的。原文为ArrayFire的官方文档指南。(链接:http://arrayfire.org/docs/index.htm)在翻译...

2018-04-03 19:16:47

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使用FPGA进行加速运算

注:本篇文章来源于知乎,为微软亚洲研究院李博杰的回答,详细链接在这儿:点击打开链接 在这篇文章中,作者从CPU,GPU,FPGA的架构出发,讨论了微软数据中心为什么使用FPGA而不选择GPU。该文章是我逐字搬运过来的,其目的是为后续我们公司的机器视觉平台和机器学习平台做参考。 在这篇文章中,主...

2018-02-06 20:27:40

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Shell学习(2)--Shell变量

在Shell中,变量的定义很简单。 定义变量 var="ddiicey" 需要注意的是,与平时我所编写的高级语言(C、C++、Python)等不同,变量名和“=”之间不能有空格。变量名的命名与其他语言一样都遵循如下规则: 命名只能使用英文字母,数字和下划线,并且首个字符不能...

2017-12-25 17:36:20

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逻辑设计方法学【7】 --跨时钟域

在上一篇文章的最后,详细说明了什么是同步时钟,什么是异步时钟,在本篇中,主要介绍跨同步时钟域问题,为详细描述异步时钟域间数据传输的方法打好基础。 如果多个时钟都起源于同一时钟,并且它们的香味和频率关系是已知的,那么这些时钟可以看成是跨同步时钟域的时钟。按照相位和频率的关系,可以将这些时钟分成以...

2017-11-21 19:06:00

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逻辑设计方法学【6】 --多时钟设计技术

在进行一个含多个时钟的设计时,在仿真和综合过程中需要遵循一定的准则,这样会带来很大的好处。通用的准则如下: 时钟命名规则分模块设计 1 时钟命名法 Xilinx的开发工具Vivado有“project mode”和“non-project mode”,在“non-projec...

2017-11-19 20:49:53

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逻辑设计方法学【5】 --控制时钟偏移

整个芯片中时钟信号到达时间的差异成为时钟偏移,即clock skew。在时序设计的时候,满足寄存器的建立时间和保持时间的要求是最基本的设计原则。在相邻的寄存器之间的数据传输延迟,与时钟偏移应该满足一定的关系,在本节中,我们来详细地讨论其关系。 通过图1来看相邻寄存器之间传输的时候的数据延迟和时...

2017-11-17 21:50:37

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逻辑设计方法学【4】 --复位信号设计方法

在为ASIC选择复位策略前必须考虑许多方面的问题。对于复位,我们都只到有同步复位和异步复位,那么在实际设计的时候,就需要知道该选择哪种复位方式,还有所有的触发器是否都需要接收复位信号。 复位最基本的目的是使SoC进入一个能进行稳定操作的确定状态,这样可以避免SoC在上电后进入随机状态而死机。在...

2017-11-16 21:55:27

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逻辑设计方法学【3】--门控时钟

对于每一个寄存器,都需要有时钟输入端,如果在一些对设计功耗要求比较高的地方,保持设计准确后的功耗控制便是头等大事。为了分析如何减少功耗,首先要来分析功耗主要由哪些部分组成。 在绝大多数的设计中,功耗主要由三部分组成: 在每个时钟沿变化的组合逻辑所产生的功耗(由于触发器驱动这些组合逻辑)由触发器...

2017-11-15 21:50:26

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深入理解SerDes之一

我在2015年底到2016年初的时候,使用7 Series FPGA Transceivers完成了TS流数据的传输,当时使用的传输速度为3.125G,SerDes选取的是8b/10b编码方式,到最后速度提升到6.25G。均已获得完好的传输效果。不过当时因为项目紧张,对于SerDes的学习不那么深...

2017-11-14 17:57:50

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Xilinx基于MIG IP Core的DDR3设计【1】 -- 建立仿真平台

在图像拼接的工程中,前端相机生成图像数据,需要对图像数据进行缓存后,再根据后端标准的HDMI时序输出图像数据。在这个过程中,因为前端相机的时钟与后端HDMI输出的时钟是不相同的,为了使输出的图像没有像素丢失,所以需要将相机图像先进行缓存,然后输出。对于高清图像,一帧图像所占用的存储空间比较大,单独...

2017-11-13 12:50:05

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基于AM335X与FPGA的SPI通讯设计

在2013年的工作中,涉及到了AM3359与XC7K325T之间的相互通信,其目的是为了获取FPGA设计版本号,该FPGA版本号保存在FPGA的寄存器0xFFFF中,FPGA的版本值随着加载程序发生变化,当时的版本信息为0x1003. 需要说明的是,在本文中的代码风格是刚工作两年的时候的代码风格,...

2017-11-09 16:49:45

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Xilinx SDK下载失败的解决方法

在视频合成项目中,用到了Xilinx SDK,通过microblaze软核处理器完成前端相机OV4689和后端HDMI图像发送芯片ADV7511的配置。 开发平台 硬件平台:Xilinx KC705开发板, novel-supertv merge前端板 软件平台:Keil,ISE14...

2017-11-07 15:00:04

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Bayer图像色彩还原线性插值方法

这篇文献是从知网下载的,感觉本文很有实用性,所以将其转载至此,如果带来任何纠纷 Bayer图像色彩还原线性插值方法 孙辉,柏旭光,孙丽娜,李志强 (中国科学院 长春光学精密机械与物理研究所 中国科学院航空光学成像与测量重点实验室) 1 引言 在才舍数字相机的成像传感器结构中,为准确获取目标景物信息...

2017-10-30 10:20:36

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基于FPGA的串口通讯设计

这个小项目是在2013年初学FPGA时所做的,现把当时的设计笔记贴出来。 RS232C电气规定 EIA-RS-232C对电气特定、逻辑电平和各信号线功能都做了相关规定。在此部分,只简单介绍相关的电气特性。 对于RS232C标准对逻辑电平的定义,在数据部分,逻辑1的电平低于-3...

2017-10-25 09:56:52

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Shell学习(1)--初识Shell script

在2013年的时候,开始学Linux,为了熟练使用vim编辑器和Linux操作,我把当时在windows下开发ARM的所有源文件,都转移到了Linux下。在那时候便学会了一些简单的Shell脚本编程。但随着2013年底开始做FPGA逻辑设计,开发平台就全部转移到了windows下,这样Shell脚...

2017-10-23 17:12:43

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计算机文化课--摩尔定律

我们从摩尔定律开始。 为什么要学习摩尔定律呢?摩尔定律从宏观角度揭示了IT产业发展程度。同样,也有一些其他的作用。 在前段时间,我们看过芯片,就是电路板上黑黑的那个方块(绝大多数的形状),它们有大有小,有高有矮。每一个芯片,都有一些伸出来的“手”,既想要从外界获得“食物”(电 OR 信号)...

2017-10-10 22:17:31

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逻辑设计方法学【1】 -- 常用设计技术

使用HDL代码进行设计的时候,需要注意所选取的综合工具是哪一种,无论是FPGA开发套件自带的综合工具(synthesis tools)还是第三方的综合工具,它们对同一段HDL语言综合结果都有可能不同,综合工具有可能违背设计者的最初设计想法,优化掉某些设计。所以在实际设计过程中,需要对所使用的综合工...

2017-09-05 16:47:51

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亚稳态以及测试逻辑实现

在逻辑设计中,如果整个系统使用的都是同步时钟,并且后续时钟都是由同一时钟经过PLL或者DCM产生的时钟信号,那么时钟和数据总会有固定的关系。当这个关系满足寄存器的建立时间和保持时间要求的时候。输出端会在特定的传输延迟时间后输出一个稳定的有效状态。因为在同步系统中,输入信号总是满足寄存器的建立保持时...

2017-08-30 17:51:37

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阻塞赋值与非阻塞赋值的再分析

在Verilog HDL设计中,经常会遇到阻塞赋值与非阻塞赋值,这是学习逻辑设计时最基础的知识点。设计者经常会在书中看到一些建议:什么时候该用阻塞赋值,什么情况下使用非阻塞赋值。可是,如果仅仅按照这样的设计推荐来进行设计的话,经常会碰到一头雾水的情况。本文就对阻塞赋值和非阻塞赋值进行详细的讨论,深...

2017-08-25 14:27:10

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MIPI D-PHY 带宽矩阵用户指南

引言 随着视频信号从标清到高清和超高清的发展,原来所使用的视频信号并行传输接口,其难以扩展、接口引脚多以及高功耗等缺点已经变得尤为突出。新兴的基于数据包传输的串行接口,如MIPI CSI-2和DSI接口,可以解决并行接口的不足,同时也可以减小系统的复杂性。理解并行和串行接口带宽的计算方法,可以避...

2017-08-21 14:34:38

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