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原创 我用过的芯片相关网站记录

我用过的芯片相关网站。

2023-01-12 19:39:25 153

原创 SystemC思考

几年前初次接触到SystemC的概念,就对此很感兴趣。SystemC是C++的拓展集。SystemVerilog是Verilog的拓展集。

2019-07-04 18:48:24 248 1

原创 linux工作环境配置

linux工作环境配置linux工作环境下常用的配置包括.cshrc, .vimrc, .dir_colors. -.cshrc配置terminal显示 -.vimrc配置vi显示 -.dir_colors配置文件夹显示

2019-07-04 18:47:56 590

原创 芯片行业名词

SAIFSwitching Activity Interchange FormatCPFCommon power format

2019-07-04 18:44:51 2755

原创 perforce help

revert to old versionNow is #10, want to revert to #9.p4 filelog a.txtp4 sync a.txt#9p4 edit a.txtp4 sync …p4 resolve -ayp4 submitp4 diff2 a.txt#9 a.txt#11===> identical

2019-07-04 18:43:44 459

原创 Linux Shell使用记录

查看默认用的SHELL主要可能是bash和csh(tcsh是csh的增强版)echo $SHELL查看当前系统可用的shellcat /etc/shellsbash支持默认配置~/.bashrc变量的定义VAR=XAVAR=(X1 X2)环境变量的定义export VAR=X或VAR=Xexport VAR命令搜索路径的定义PATH=/bin:/usr/bin命令h...

2019-06-25 18:00:21 288

原创 极简仿真环境 with irun/xrun

Basicxrun -sv -top top_module_name top_module_name.sv top_rtl.vplus option-incdir . -incdir ./rtl_define // include directory+define+NUM=5 // define MACRO+access+rwc -input dump.tcl // dump signa...

2019-06-25 18:00:14 7378

原创 System Verilog验证第十一章笔记 - 完整的验证平台

System Verilog和UVM搭建验证平台机制分析用System Verilog搭建完整的验证环境,核心在于运用回调函数和蓝图模式,可以说是callback机制和blueprint机制。在System Verilog基础上搭建完整的验证环境,则提供了Sequence机制、factory机制和callback机制三种。其中sequence机制和factory机制是System Verilo...

2019-06-09 22:14:40 2307

原创 System Verilog验证第十章笔记 - 接口

虚接口联系起UVM来,虚接口就具体了,就是UVM中的virtual interface。在design顶层实例化实际的接口,通过XMR跨模块引用的方式把实际的接口连接到验证平台的虚接口上。XMR可以用端口传递的方式替代。接口中的过程代码接口中可以有子程序/断言/initial/always等。对子程序如task的访问都是通过MODPORT来实现。比如一个接口定义并行协议的task,一个...

2019-06-08 14:15:21 834

原创 System Verilog验证第九章笔记 - 功能覆盖率

如何衡量验证的进展?依靠完善的验证计划test plan和对应的功能覆盖率coverage。用验证计划和对应功能覆盖率的结果来指导验证的进展,这样才能站在更高的抽象层次上看待验证。根据功能覆盖率结果来思考如何提高功能覆盖率,并在功能覆盖率达标或者止步不前时思考验证计划本身。道法术验证人员的最重要工作是制定完善的验证计划,这是验证之道。搭建验证环境和编写对应验证计划的覆盖率代码,可以认为...

2019-06-08 14:15:03 7039

原创 System Verilog验证第七章笔记 - 进程间通信

IPCIPC(inter process communicate)方法有:event(@,->),wait/disable,mailbox,semaphore。线程结构Verilog的线程结构有begin...end,fork...join。System Verilog新增的fork...join_none,fork...join_any。fork...join_none...

2019-05-31 18:23:45 1778

原创 System Verilog验证第八章笔记 - System Verilog验证里的OOP高级技巧

继承基类:也叫父类。拓展类:也叫子类。如果基类的构造函数有参数,拓展类必须有构造函数并且在第一行调用基类的构造函数。子类的约束会覆盖父类的同名约束。多态句柄的声明类型,句柄的真正指向的对象类型,方法是否定义为virtual。这三者会共同决定调用方法时调用的是父类的方法还是子类的方法。未声明virtual时,方法会根据句柄的声明类型来调用。声明为virtual时,方法...

2019-05-30 18:18:40 1197

原创 System Verilog验证第五章笔记 - System Verilog验证里的OOP基础

在System Verilog验证中应用OOP可以理解为从过程式验证平台向结构式验证平台的转变,可以参照从过程编程语言C向面向对象编程语言C++的转变。传统测试平台是过程/操作式的,创建事务/发送/接收/检查结果一步步进行。 基于OOP的测试平台是结构式的,把创建事务/发送/接收/检查结果等功能划分到不同的结构中,结构之间的通信在搭建平台时定义好就不需要改变了。当然OOP的基本优点也包括类...

2019-05-30 18:18:06 873

版图设计_基础+全面

版图设计_基础+全面:集成电路版图设计与工具。 8.1 工艺流程的定义 8.2 版图几何设计规则 8.3 版图图元 8.4 版图设计准则 8.5 电学设计规则与布线 8.6 基于Cadence平台的全定制IC设计 8.7 芯片的版图布局 8.8 版图设计的注意事项

2011-11-02

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