Xilinx 7系列FPGA DDR3硬件设计规则

最新推荐文章于 2024-11-25 13:24:57 发布
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分类专栏： Xinx FPGA硬件设计 文章标签： FPGA DDR3
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引言：本文我们介绍Xilinx 7系列FPGA DDR3硬件设计规则及约束，包括Bank选择、管脚位置约束、管脚分配、端接、I/O标准和走线长度。

01.设计规则

存储器类型、存储器数量和数据宽度受限于所选FPGA器件家族、FPGA速度等级和设计频率，频率范围取决于器件电气特性。

02.Bank和管脚选择

图1、DDR3 数据组连接（DCI级联从Bank）

图2、DDR3地址组连接（DCI级联主Bank）

图3、DDR3 地址/控

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