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RSS订阅原创 MAC知识点001：以太网帧格式--IEEE802.3
MAC知识点001：以太网帧格式--IEEE802.3IEEE802.3协议以太网帧格式 字段 字段长度（字节） 说明 前导码（Preamble） 7 同步 帧开始符（SFD） 1 表明下一个字节为目的MA...
2018-10-26 20:21:56
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原创 Perl在IC设计中的运用002：循环打印有规律的verilog代码
Perl循环打印有规律的Verilog代码Verilog编码过程中会存在很多有规律的代码，如MAC、PCS模块里就有很多重复有规律的模块例化，此时使用Perl循环打印能够提高效率，较少失误。1.脚本原理将要例化的代码赋值给变量inputdata，将需要替换的例化模块数字写成#b，将信号名称写成#a，采用匹配替换的方式将#a和#b替换依次替换成1、2、3#!/usr/bin/per...
2018-10-24 20:05:43
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原创 DC综合约束：注意事项
1、用采样时钟约束输入信号的input delay输入信号的input delay不使用驱动时钟来约束，而是使用采用时钟进行约束举例如下：2、clock gating输出时钟驱动的信号的output delay使用clock gating之前的输入时钟来约束clock gating模块的输入时钟和输出时钟属于同步时钟，且具有相同的时钟属性，因此cg输出时钟驱动的时钟信号output...
2018-10-14 15:34:33
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原创 gvim-高级操作004-删除匹配行和删除非匹配行
1、删除匹配行如果需要删除的语句分布在全文，则使用全局符号 g : g /Error/d 作用：删除全中包含Error的行g 表示全文，d表示删除行， /Error/ 表示包含Error特定行如果需要删除的语句集中在文件中的110行到200行，则使用范围：110,200: 100,200 /Error/d 2、删除非匹配行删除不匹配行使用g...
2018-10-10 19:38:08
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原创 gvim高级操作003--数字加减
在编写Verilog代码时，经常出现信号寄存器位宽信号，此时采用gvim的数字加减操作能够有效提高速度。1、数字增加 ctrl+a光标放在数字上，命令模式下（按ESC）：数字加1，同时按住ctrl和a，即ctrl+a先按5，再同时ctrl+a，数字加52、数字减少 ctrl+x光标放在数字上，命令模式下（按ESC）：数字减1，同时按住ctrl和x，即ctrl+x先按...
2018-10-10 19:22:26
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空空如也
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