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原创 verilog语法-004 比特位选择

Verilog—比特位选择在有规律的代码,经常会根据输入信号来选择需要的数据。assign output=cfg_assert[tx_client_in*16+:16];表示tx_client_in为0时,outupt= cfg_assert[15:0]表示tx_client_in为1时,outupt= cfg_assert[31:16]在generate模块中还可以采用以下...

2018-12-23 17:37:39 2139

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2018-12-23 17:11:36 6787 1

原创 verilog语法--003function

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2018-12-02 10:16:27 290

原创 软复位与硬复位

软复位与硬复位1、软复位与硬复位软复位信号名称中通常包含soft,硬复位信号名称中通常包含hard软复位:常用于复位逻辑模块硬复位:常用于配置寄存器模块,配置信号同步模块硬复位有效会驱动软复位有效一个模块出现问题时,可以使其软复位有效,进行逻辑复位操作,但是由于配置寄存器是由硬复位驱动的,所以不会发现改变,因此无需浪费时间重新配置。2、复位的产生NOTE:硬复位有效...

2018-12-02 09:26:18 27293

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