liuhandd的博客

查了一下网上的资料，大概率是卡带分问题，直接联系商家换新。新买的奥德赛卡带，使用的时候报错。

比如读的时候没有，没有从机无反应，没有返回值。常见的如apb和axi总线的ready信号没拉高。问题所在其实在最后一句话：Stalled on memory access。访问一片地址不成功，可能是访问memory的总线接口出现了问题。对一片空间进行读写操作时，程序跑飞无法暂停。

这篇博客阅读官方手册5章的内容第5章描述了一些关键的概念，了解每层具体的前必须完整的阅读第5章。物理视图会在6,7,8章中详细说明，逻辑视图会在9,10章中详细说明。整体结构特异性和共性需要协议英文版原文的可以评论区留言，我私发，工作日我都会上线。USB系统的简单视图，这体现了USB系统最重要的两个实体。USB Host为主，USB Device为从，一切事务都是由Host发起！

这篇博客阅读官方手册1-4章的内容BackgroundArchitectural Overview （重点）链接: https://pan.baidu.com/s/1c1T3cRMFcq01I3vEeNldKg?pwd=1111 提取码: 1111 复制这段内容后打开百度网盘手机App，操作更方便哦–usb2.0英文版协议原文如今USB和PCIe已经成为了计算机系统里面最重要的两个接口。

（官网搜pg137也行）在Block Design中的样子：IP默认配置：很明显FPGA逻辑做主，USB设备做从拥有：1个Endpoint0，7个用户Endpoint包括32位寄存器，它为核心提供控制和状态信息，可以通过AXI Slave Interface访问。

在代码中添加Mark_debug的方式进行debug时，综合完成后，又修改了代码或者xdc，重新综合后，再布局布线就会出现这个报错。注：使用在图上标记和添加ila ip的方式基本上不会出现这个问题。

ZCU102 ZYNQ MPSoC IP设置与说明笔记

打算基于ZUC102实现板卡与电脑的USB通信。下文为硬件部分介绍。基于Xilinx Zynq UltraScale+ MPSoC ZCU102，Vivado版本为2018.3，SDK版本也是2018.3

FPGA中尽量使用高有效的复位信号，采用异步复位同步释放的方式，并且要将复位信号局部化，避免使用高扇出的全局复位。至于驱动多少逻辑单元算过多，需要根据工艺，后端实现情况以及芯片本身类型来决定。...

博主第一份工作做FPGA工程师，公司给了CPLD的任务给我练手，大大小小参与了几款主板上电的设计，同一套代码进行了多次修改运用。跳槽后，把代码整理一下，改善代码结构，优化可移植性。常用的上电控制有使用单片机和CPLD或者EC的方式，本文使用CPLD实现上电控制操作......

数字IC设计全流程介绍 - 温戈的文章 - 知乎FPGA是一款芯片，只是数字IC设计上板测试过程中的一个必要的实现平台，在IC设计和验证过程中，如果深刻理解Verilog（或者其他硬件描述语言）与底层实现的关系才最重要。......

在国产的GD32和复旦微FPGA之间实现较高带宽的数据通信，可以使用EXMC接口。EXMC接口通过部分逻辑与FPGA中例化的BRAM接口相连。使用双口RAM的形式就能实现GD32和FPGA内部逻辑的交互。

FPGA 内部详细架构你明白了吗？- FPGA之家FPGA内部分为六大模块

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VNC (Virtual Network Console)是虚拟网络控制台的缩写。它是一款优秀的远程控制工具软件，由著名的 AT&T 的欧洲研究实验室开发的。

为验证一款UTMI接口的PHY芯片数据通路是否正常，功能实现是否满足需求，特搭建此工程进行测试。FPGA芯片：Xilinx XCVU440PHY芯片：CY7C68000平台：Vivado 2019.2