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原创 IRIG-B码Verilog实现思想

该图是B码完整图 由图可知B码是由100个单独码组成,我们可以将这100个码元分开传输; 1.8ms表示1个P ,5ms表示1 ,2ms表示0 2.可将一个码元表示为10ms,将码元按顺序发出; 3.发1000个码元也就是1s 4.将年、天、时、分、秒分别组成一个整码,移位发送; ...

2019-03-10 00:25:34

阅读数 371

评论数 0

原创 vivado做摄像头接收时候出现绿屏

现象: 该现象能看清图片而表面感觉有一层绿色,是由于摄像头的配置文件处错误,修改配置文件

2019-03-10 00:25:06

阅读数 410

评论数 0

原创 Vivado内存冲突报错

报如下错误: [BD 41-703] Peripheral </processing_system7_0/S_AXI_HP1/HP1_DDR_LOWOCM> is mapped into master segment </axi_d...

2019-03-10 00:24:43

阅读数 473

评论数 0

原创 Vivado中IP被锁

首先点击Reports 再次点击Upgrade Selected 更新会报错: [Common 17-69] Command failed: No IP specified. Please specify IP with ‘objects’ 解决方式: 该错误是由于该工程在中文路径下,将路...

2019-02-27 22:45:51

阅读数 1134

评论数 0

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