组合电路的竞争和冒险

最新推荐文章于 2024-02-27 01:23:53 发布

luoai_2666

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分类专栏： FPGA笔试面试文章标签： python 深度学习

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本文介绍了组合电路中逻辑竞争和冒险的现象。逻辑竞争源于不同路径导致的延迟差异，而冒险则是逻辑关系短暂失效的表现，可能导致输出毛刺。1型冒险发生在变量从0到1的转变，0型冒险则是从1到0。识别冒险的关键在于寻找Y = A+ A'或Y = A* A'的情况。解决方法包括：输出端并联滤波电容、引入选通脉冲和修改逻辑设计以添加冗余项。最后，文章通过布尔表达式和卡诺图展示了如何避免竞争冒险问题。

摘要由CSDN通过智能技术生成

定义

逻辑竞争：当某一个变量经过两条以上的路径到达输出端的时候，由于每条路径上的延迟时间的不同，到达终点的时间就会有先有后。
逻辑冒险：在具有竞争现象的组合电路中，当某个变量发生变化的时候，比如说从1跳到 0（0型冒险），或者说从 0 跳到 1（1型冒险），如果真值表所描述的逻辑关系遭受到短暂
的破坏，在输出端它就会出现一个不应有的这么一个毛刺。
1型冒险：
如何记忆1型冒险：本来应该是0→
在这里插入图片描述

0型冒险：
在这里插入图片描述

判别

如何识别逻辑冒险&#

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