（22）Xilinx FPGA PCIE中断接口（学无止境）

最新推荐文章于 2024-09-02 07:34:44 发布
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本文介绍了在使用Vivado 2018.2开发K7 FPGA项目时，FPGA与ARM通过PCIE接口通信的中断调试经验。重点讲解了PCIE IP核中的中断相关信号，包括中断请求、应答、数据输入/输出等，并提供了中断状态的解释。最终，作者分享了遇到的问题及解决方法，鼓励读者如有疑问可通过邮件交流。
摘要由CSDN通过智能技术生成

1 引言

最近在做一个项目，用到PCIE接口。主要是FPGA与ARM通过PCIE接口进行通信，中断调试一直不通有2个月，最近也算是找到原因，FPGA中断上报后，CPU可以收到中断。所以，这里整理一下FPGA中断相关信号。

2 中断信号

开发软件：vivado 2018.2

硬件型号：K7 FPGA

PCIE IP核对应的中断信号如下：

input wire cfg_interrupt                  
output wire cfg_interrupt_rdy             
input wire cfg_interrupt_assert           
input wire [7 : 0] cfg_interrupt_di       
output wire [7 : 0] cfg_interrupt_do      
output wire [2 : 0] cfg_interrupt_mmenable
output wire cfg_interrupt_msienable       
output wire cfg_interrupt_msixenable      
output wire cfg_interrupt_msixfm          
input wire cfg_interrupt_stat             

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