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RSS订阅原创 VHDL/Verilog HDL实现任意整数倍分频器
在用HDL实现分频器的时候，主要通过写计数器计数时钟的上升/下降沿来实现。偶数倍分频十分容易实现在此不加赘述，奇数倍分频需要通过计数器生成两个波形然后进行异或操作实现奇数倍分频。以下给出5倍分频、10倍分频的Verilog HDL程序代码，以及testbench测试仿真程序Verilog程序：module frequence_divider ( input clk_50M...
2019-07-21 19:57:44
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原创 FPGA 中基于RAM的移位寄存器的IP核的配置及调用
FPGA 中基于RAM的移位寄存器的IP核的配置及调用在进行FPGA开发时，经常需要借助移位寄存器来实现一定的程序功能。但如果需要构建的移位寄存器数据位宽较大，移位位数较大时，利用传统方法实现的移位寄存器将使用大量的逻辑资源。Alrea提供的IP核Shift register（RAM-based）可以方便的实现基于RAM的移位寄存器。此外该IP核实现的移位寄存器，具有参数化的抽头，抽头可以在寄存...
2019-07-17 23:18:14
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空空如也
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