24届数字IC验证——SV+UVM基础知识汇总（八）

最新推荐文章于 2024-10-29 15:25:56 发布
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分类专栏： 24届数字IC秋招笔面真题 文章标签： ic 数字ic 学习 UVM SV
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本文汇总了数字IC验证中UVM和SystemVerilog的基础知识，包括验证流程、常见问题及解决办法。内容涵盖验证计划制定、环境搭建、VCS命令、task与function的区别、initial与always的差异、ref与inout的用法，以及UVM宏定义和包导入的解释。通过这些知识点的学习，有助于理解IC验证的关键点。
摘要由CSDN通过智能技术生成

文章目录

前言

汇总整理在面试过程中常见的问题，如果都能回答下来，那么面试肯定不成问题的

46、介绍你做验证的流程（常问）

首先是阅读spec，了解模块功能，根据spec提取出验证功能点，指定验证计划，包括使用的验证方法，功能点等；第三是搭建验证环境，第四是先写个简单的case把环境跑通，再根据功能点去写不同的case；第五收集覆盖率，包括代码、功能覆盖率等；然后进行回归测试，最后是对结果进行分析和总结。

47、验证时遇到的难点和重点

时序的实现，实现高的覆盖率

48、发现过哪些问题，如何发现的

sequence发送完成之后没加set_drain_time，预留一定时间发送完毕的数据（5us）
run_phase和main_phase不能混用
编译头文件的顺序必须顺序写，否则汇报语法错误

49、如何学习UVM（问的最多的问题）

先看SV的语法，后看《UVM实战》这本书

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24届数字IC验证——SV+UVM基础知识汇总（一）
qq_42135020的博客
04-16 1685
汇总整理在面试过程中常见的问题，如果都能回答下来，那么面试肯定不成问题的分别构建不同抽象级的transaction，来实现复杂的激励。（以前是单一层次的sequence，对激励复用、上层复用不塌友好）不同层级之间的sequence没有继承关系，相互之间进行转换低层次的sequence从高层次的sequencer中获取高层次的sequence，并将其转换为低层次的sequence，再通过低层次的sequencer发送出去如何连接：低层次的sequencer包含高层次sequencer的句柄。
24届数字IC验证——SV+UVM基础知识汇总（二）
qq_42135020的博客
04-16 778
汇总整理在面试过程中常见的问题，如果都能回答下来，那么面试肯定不成问题的。
教你搭建linux下UVM+VCS基本平台，运行《UVM实战》中的第一个UVM代码并输出结果
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基于vcs+uvm+xilinx ip的仿真平台的半自动化搭建
u012938458的博客
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仿真平台的半自动化搭建
【数字IC验证】VCS+UVM使用vdp文件产生波形
PPRAM的博客
08-28 928
在《Linux中UVM环境搭建》中第五节，我们设计了自己的Makefile文件，在此基础上我们对其修改，增加如下两条命令，这样我们每次在调用Makefile文件时就不需要删除上次仿真产生的文件，另一方面我们可以直接从终端跳转到仿真界面，无需再手动输入dev &打开可视化界面再添加波形文件了；其中clean命令会在每次启动vcs进行编译前，将上一次产生的相关文件删除；run_dve命令则在生成vpd波形后，直接跳转至仿真界面；
24届数字IC验证——SV+UVM基础知识汇总（九）
qq_42135020的博客
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汇总整理在面试过程中常见的问题，如果都能回答下来，那么面试肯定不成问题的。
24届数字IC验证——SV+UVM基础知识汇总（七）
qq_42135020的博客
04-19 480
汇总整理在面试过程中常见的问题，如果都能回答下来，那么面试肯定不成问题的。
vcs+verdi+uvm单步调试及查看所有phase的运行状态
weixin_42764060的博客
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vcs+verdi联合仿真中的单步调试
uvm+vcs+verdi基本平台搭建
11-09
uvm+vcs+verdi基本平台搭建,也许平台不是很难，但是网上没有 UVM 在 VCS 中的详细教程，但是对于初学者就是一道屏障，我探索了几天，下文将一步一步的举例子说明 UVM+VCS+Verdi 的 liunx 平台搭建过程
linux VCS+verdi运行UVM实战(第二章)中的例子
qq_37708525的博客
12-23 3092
在某宝上花了几十块，买了个虚拟机（已经安装好VCS+verdi）。直接用UVM实战中，现成的uvm代码跑了下。直接复制UVM实战的源码，也可以自己对着源码敲。将dut代码，agent代码，env代码以及reference model代码，直接进行文件分类，用package包起来了。最后，直接运行代码即可。
VCS编译时导入UVM库
qq_37960317的博客
05-19 5168
VCS编译时导入UVM库 1.test_top.sv引入类 在test_top.sv文件里， `include “uvm_macros,svh” import uvm_pkg:: *; 2.vcs 命令里添加 -ntb_opts uvm 参数 vcs -sverilog -ntb_opts uvm my_file.sv
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qq_33300585的博客
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探索数字验证新境界：UVM、VCS与Verdi基础平台搭建全攻略
gitblog_09790的博客
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