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原创 2024年数字IC秋招-TP-LINK-数字IC验证工程师-笔试题

笔试题型:四个部分,第一部分为笔试题,后面部分为性格测评题目笔试平台:北森平台笔试时间:2h做题感受:唯一一家把测评和笔试题目放在一起,措手不及,做了第一部分以为后面全部都是笔试题,赶紧交卷,结果后面还剩余时间。

2024-04-01 09:46:16 728

原创 2024年数字IC秋招-黑芝麻智能-数字IC验证工程师-笔试题

笔试题型:单选题(10个) + 多选题(10个)+ 简答题(4个)笔试平台:牛客(电脑监控)笔试时间:1h。

2024-03-31 18:36:56 270

原创 2024年数字IC秋招-格科微-数字电路设计工程师-笔试题

笔试题型:简答题(9个)笔试平台:牛客(电脑监控)笔试时间:2h。

2024-03-31 18:36:24 1086

原创 2024年数字IC秋招-华为机试-数字芯片-实习笔试题

笔试题目:40个选择题A.综合时不同文件列表内的宏定义仅在本列表生效B.宏定义会覆盖,不需要单独undefC.仿真时出现宏定义冲突以最后一次值为准D.宏定义最好在各文件中随用随定义A.4/9B.4/6C.01D.0/6。

2024-03-29 10:53:41 1689 1

原创 2024年数字IC秋招-瑞芯微-数字IC设计工程师-笔试题

笔试题型:简答题(6个) + 复合题(3个)笔试平台:猿圈(电脑监控)笔试时间:1h30min做题感受:9个大题,相当于10分钟一个题目,体量大且题目难度大,写不出来,且题目中图片都是乱码。

2024-03-29 10:42:05 373

原创 2024年数字IC秋招-燧原科技-AI core验证工程师-笔试题

笔试题型:20个单选 9个多选 3个填空题笔试平台:牛客(手机监控+电脑监控)笔试时间:1h答题情况:秋招最开始的时候,这个笔试当时没有认真做,且考察范围很广,直接挂掉了,十分可惜(希望大家都争取笔试能过!

2024-03-29 10:41:30 207

原创 2024年数字IC秋招-沐曦-GPU验证-笔试题

笔试题型:选择题(15个) + 简答题(3个)笔试平台:Showmebug笔试时间:1h。

2024-03-28 21:45:49 439

原创 2024年数字IC秋招-复旦微电子-数字前端/验证-笔试题

笔试题型:基础题(10个) + 选做题(5个)笔试平台:百一测试(电脑监控)笔试时间:2h做题感受:题目全部都是大题目,题量很大,压根写不完,而且做完一个部分才能跳到下一个部分,建议想不出来思路的直接立马放弃做下面的题目。p =new();

2024-03-28 21:45:19 366

原创 2024年数字IC秋招-海康威视-数字逻辑设计工程师-笔试题

笔试题型:单选 + 多选笔试平台:百一测试(电脑监控)笔试时间:1h30minA. AW通道B. D通道C. B通道D. AR通道return x++;x = 5;y = Foo(x);

2024-03-28 21:44:23 1928

原创 2024年数字IC秋招-速腾聚创-数字芯片验证工程师-笔试题

笔试题型:单选 + 问答题笔试平台:牛客(手机+电脑监控)笔试时间:1hA. len取10的概率是1/2;B. len取10的概率是1/3;C. len取10的概率是1/4;D. len取10的概率是1;

2024-03-28 21:41:58 661

原创 2024年数字IC秋招-海光-IC验证工程师-笔试题

笔试题型:单选 + 多选 + 简答题笔试平台:百一测试(电脑监控)笔试时间:1h。

2024-03-28 21:38:40 1845 1

原创 【24届秋招总结】24届数字IC秋招给学弟学妹们的99条建议(标题党)

针对2023年找实习、秋招、谈薪资等方面的个人经验进行总结,希望对后续同学们找工作有所帮助

2024-03-28 16:12:14 2798 1

原创 异步FIFO项目 UVM验证

记录自己开始使用UVM仿真异步FIFO项目。

2023-09-09 16:35:28 500

原创 verilog学习笔记7——PMOS和NMOS、TTL电路和CMOS电路

PMOS、NMOS电路,TTL电路,根据逻辑表达式画出电路图

2023-09-08 10:12:32 5376

原创 计算机组成原理知识——CPU结构组成和功能、堆栈、RISC、

CPU组成、功能、指令运行步骤、堆栈、RISC、CICS

2023-09-07 11:04:40 1717

原创 Vim编辑器的使用和常见指令

vim编辑器三种模式,常见指令和快捷键

2023-09-01 10:39:46 775

原创 windows环境下QuestaSim软件的使用

介绍questasim软件的使用及脚本编写

2023-08-29 22:04:03 1664

原创 verilog学习笔记6——锁存器和触发器

RS锁存器、D触发器、脉冲/边沿/电平触发方式

2023-08-15 22:51:06 6667

原创 verilog学习笔记5——进制和码制、原码/反码/补码

原码、反码、补码、进制转换

2023-08-13 11:38:02 1988

原创 verilog学习笔记4——竞争和冒险、verilog延时语句、timescale

verilog阻塞赋值和非阻塞赋值的延时

2023-08-10 14:56:04 1772

原创 《综合与Design_Compiler》学习笔记——第一章综合综述 第二章verilog语言结构到门级的映射 第三章 使用DC进行综合

综合流程:准备设计文件、指定库文件、读入设计、定义设计环境、设置约束、编译(选择编译策略)、报告、存储数据工艺库(technology library):目标库和链接库统称为工艺库,一般只要设置好这两个set: 自己自定义的一些变量,方便定义系统变量,相当于减少一些重复的代码,同时增加了代码的可读性,和tcl的语法是一样的。定义DC内部的系统变量、指定DC内部的连接等。

2023-06-27 16:55:37 1536 2

原创 verilog手撕代码7——固定优先级仲裁器和轮询仲裁器

verilog实现固定优先级仲裁器和轮询仲裁器

2023-05-17 09:49:45 4004 2

原创 verilog手撕代码5——计数器(置位、加减、环形、扭环形、格雷码计数器实现)

置位、加减、环形、扭环形、格雷码计数器实现

2023-05-13 09:57:00 6344

原创 verilog手撕代码6——数据包检测器

verilog实现数据包检测

2023-05-07 22:12:11 699 1

原创 verilog手撕代码4——串行数据和并行数据转换

verilog串并转换

2023-04-26 14:53:28 2669

原创 verilog手撕代码3——序列检测和序列发生器

序列检测、序列生成

2023-04-26 10:53:35 6565

原创 verilog手撕代码2——各种加法器介绍——真值表、表达式、电路图

各种加法器:半加器、全加器、RCA、LCA、CAS

2023-04-25 11:43:20 7274

原创 好记性不如烂笔头——记录项目过程中的编译错误及解决方法(持续记录中)

记录做项目的时候编译问题,好记性不如烂笔头,下次碰到相同的问题也可以方便查阅

2023-04-24 21:01:41 5546 4

原创 《UVM实战》学习笔记——第七章 UVM中的寄存器模型2——期望值/镜像值、自动/显示预测、操作方式

介绍寄存器模型的期望值、镜像值,预测分类等

2023-04-24 20:54:32 3832

原创 《UVM实战》学习笔记——第七章 UVM中的寄存器模型1——寄存器模型介绍、前门/后门访问

寄存器模型介绍、最简单的寄存器模型,集成到验证环境,前门/后门访问

2023-04-24 15:10:16 4655 4

原创 AMBA总线协议AXI——学习笔记

AXI:高级可拓展接口高性能、高带宽、低延迟单向通道体系结构独立的地址和数据通道支持多项数据交换。通过并行执行burst操作,极大地提高了数据吞吐能力。

2023-04-23 15:14:21 1301

原创 IIC协议——同步半双工串行通信方式

集成电路总线,半双工协议,多主设备,多从设备。通过地址索引,I2C可以使能所需从设备实现不同集成电路组件之间的控制功能。

2023-04-22 20:32:13 2152

原创 SPI协议——同步全双工串行通信方式

SPI协议学习

2023-04-22 15:40:15 3226

原创 通信方式基础知识

串行、并行、异步、同步、单工、半双工、全双工通信

2023-04-22 14:28:58 607

原创 UART协议——异步全双工串行通信方式

UART:Universal Asynchronous Receiver/Transmitter,通用异步收发器广泛的应用在各类MCU和SOC产品上“不需要额外的时钟线进行数据的同步传输”。即只要信号拉低,即可开始传送数据(不在时钟沿发送数据)一个数据的发送方和一个数据的接收方每秒钟传输的数据位数,bit/sclk=100 MHz,波特率=9600,T=10 ns。

2023-04-22 11:49:33 2441

原创 静态时序分析Static Timing Analysis4——多时钟域和多时钟时序检查

多时钟以及非整数比时钟时序检查

2023-04-12 15:51:17 1466 2

原创 静态时序分析Static Timing Analysis3——特殊路径(多周期、半周期、伪路径)的时序检查

多周期、半周期、伪路径时序检查

2023-04-12 10:52:41 1550

原创 静态时序分析Static Timing Analysis2——建立时间和保持时间的时序检查

建立时间和保持时间不同时序路径的检查

2023-04-12 09:59:21 1848

原创 静态时序分析Static Timing Analysis1——STA概述、标准工艺库、时钟、IO约束的建立

简要介绍STA和标准工艺库内容,对时钟,IO等进行约束的指令介绍,PVT

2023-04-11 15:31:47 5296

原创 verilog手撕代码1——分频计数器——偶数、奇数、半整数、任意小数分频

时钟分频verilog、奇数、偶数、小数

2023-04-08 22:32:16 3972

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