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利用MATLAB自动生成HFSS激励文件,适用于大型相控阵的全波仿真

2024-01-19 19:35:57 668

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2021-03-18 18:06:13 631

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2020-12-05 13:09:15 327

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记录一下Nios II的学习过程软件:Quartus II 13.1开发板:Cyclone IV 系列 EP4CE6F17C8新建一个Quartus II 的工程文件,注意芯片选择Tools—Qsys

2020-11-22 19:41:49 1057

原创 数字逻辑电路课程设计之数字电子时钟

利用protues软件设计一个数字电子时钟,可实现以下功能:(1) 时钟功能: 采用数码管显示累计时间,以24小时为周期。(2) 校时功能: 能快速校准“ 时”、“分”、“ 秒”的功能。(3) 整时报时功能: 具体要求整点前鸣叫5 次低音( 500 Hz ) , 整点时再鸣叫一次高音(1 000 Hz左右) , 共鸣叫6 响, 两次鸣叫间隔0 .5 s。(选做)(4) 计时准确: 每天计时误差不超过10 s。

2020-07-06 20:11:04 50011 53

数字逻辑电路课程设计之八路彩灯终

利用Proteus进行彩灯控制器的设计与仿真 设计要求 1. 彩灯控制电路要求控制8 个以上的彩灯。 2. 要求彩灯组成两种以上花形, 每种花形连续循环两次, 各种花形轮流交替。

2020-11-06

数字逻辑电路课程设计之智能电子抢答器

Proteus仿真 1. 通道数8个,每路设置一个抢答按钮, 供抢答者使用。 2. 电路具有第一抢答信号的鉴别和锁存功能。在主持人将系统复位并发出抢答指 令后,若参赛者按抢答开关, 则该组指示灯亮, 显示电路显示出抢答者的组别, 同时扬声器发出“滴嘟”的双音, 音响持续2~3s。 3. 电路应具备自锁功能, 一旦有人事先抢答, 其他开关不起作用。

2020-11-06

数字逻辑电路课程设计之数字电子时钟

(1) 时钟功能: 采用数码管显示累计时间,以24小时为周期。 (2) 校时功能: 能快速校准“ 时”、“分”、“ 秒”的功能。 (3) 整时报时功能: 具体要求整点前鸣叫5 次低音( 500 Hz ) , 整点时再鸣叫一次高音(1 000 Hz左右) , 共鸣叫6 响, 两次鸣叫间隔0 .5 s。 (4) 计时准确: 每天计时误差不超过10 s。

2020-11-06

FPGA实验.docx

七段显示译码器 8位硬件加法器 七人表决器 巴克码 多功能数字时钟 状态机 verilogHDL语言,全部编译通过,并在实验箱验证过

2020-04-28

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