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计算机组成原理算术逻辑运算实验报告1.doc

福建农林大学计算机与信息学院信息工程类实验报告课程名称计算机组成原理姓 名系计算机系专 业计算机科学与技术年 级2007级学 号指导教师职 称讲师2009年 5 月 25 日附件二实验报告实验项目列表格式实验项目列表序号实验项目名称成绩指导教师1算术逻辑运算实验2存储器实验3总线控制实验4微程序控制器实验567891011121314151617181920福建农林大学计算机与信息学院信息工程类实验报告系 计算机系 专业 计算机科学与技术 年级 2007级 姓名 学号 实验课程 计算机组成原理 实验室号_田 实验设备号 1 实验时间 2009年5月 4日 指导教师签字 成绩 实验一 算术逻辑运算实验1.实验目的和要求(1) 掌握简单运算器的组成以及数据传送通路； (2) 验证运算功能发生器(74LS181)的组合功能。2.实验原理图1-l 运算器数据通路图实验中所用的运算器数据通路如图1-1所示。其中运算器由两片74LS181以并/串形式构成8位字长的ALU。运算器的两个数据输入端分别由两个锁存器(74LS273)锁存，锁存器的输入连至数据总线，数据输入开关用来给出参与运算的数据，并经过一三态门(74LS245)和数据总线相连。运算器的输出经过一个三态门(74LS245)和数据总线相连。数据显示灯已和数据总线相连，用来显示数据总线内容。图1-2中已将实验需要连接的控制信号用箭头标明(其他实验相同，不再说明)。其中除T4为脉冲信号，其它均为电平控制信号。实验电路中的控制时序信号均已内部连至相应时序信号引出端，进行实验时，还需将S3、S2、S1、S0、Cn、M、LDDR1、LDDR2、ALU_G、SW_G各电平控制信号与开关单元中的二进制数据开关进行跳线连接。其中ALU_G、SW_G为低电平有效，LDDR1、LDDR2为低电平有效。3.主要仪器设备ZYE1603B计算机组成原理及系统结构教学实验箱一台，排线若干。4.操作方法与实验步骤1按图1-2连接实验线路，仔细检查无误后，接通电源。(图中箭头表示需要接线的地方，接总线和控制信号时要注意高低位一一对应，可用彩排线的颜色来进行区分)图1-2 算术逻辑运算实验接线图2用输入单元的二进制数据开关向寄存器DR1和DR2置数，数据开关的内容可以用与开关对应的指示灯来观察，灯亮表示开关量为“1”，灯灭表示开关量为“0”。以向DR1中置入11000001(C1H)和向DR2中置入01000011(43H)为例，具体操作步骤如下首先使各个控制电平的初始状态为CLR1，LDDR10，LDDR20，ALU_G1，SW_G1，S3 S2 S1 S0 M CN111111，并将控制台单元的开关SP05打在“NORM”状态，SP03打在“STEP”状态，SP04打在“RUN”状态。然后按下图所示步骤进行。 上面方括号中的控制电平变化要按照从上到下的顺序来进行，其中T4的正脉冲是通过按动一次控制台单元的触动开关START来产生的。形成时钟脉冲信号T操作步骤如下将控制台单元中的两个二进制开关“SP03”设置为“STEP”状态、SP04打在“RUN”状态，每按动一次触动开关START则T4输出一个单脉冲。)置数完成以后，检验DR1和DR2中存的数是否正确，具体操作为关闭数据输入三态门(SW_G1)，打开ALU输出三态门(ALU_G0)，使ALU单元的输出结果进入总线。当设置S3、S2、S1、S0、M、CN的状态为111111时，DATA BUS单元的指示灯显示DR1中的数；而设置成101011时，DATA BUS单元的指示灯显示DR2中的数，然后将指示灯的显示值与输入的数据进行对比。3验证74LS181的算术运算和逻辑运算功能(采用正逻辑)74LS181的功能见表1-1，可以通过改变S3 S2 S1 S0 M CN的组合来实现不同的功能，表中“A”和“B”分别表示参与运算的两个数，“”表示逻辑或，“加”表示算术求和。表1-1 74LS181功能表S3S2S1S0M0(算术运算)M1(逻辑运算)CN1无进位CN0有进位0000FFA加1F0001FF()加1F0010FF()加1F0011F0减1F0F0100F加F加加1F0101F()加F()加加1F0110F减减1F减F0111F减1FF1000F加F加加1F1001F加F加加1F1010F()加F()加加1F1011F减1FF1100F加F加加1F11101F()加F()加加1F1110F()加F()加加1F1111F减1FF通过前面的操作，我们已经向寄存器DR1写入C1H，DR2写入43H，即AC1H，B43H。然后改变运算器的控制电平S3 S2 S1 S0 M CN的组合，观察运算器的输出，填入表1-2中，并和理论值进行比较、验证74LS181的功能。表l-2 运算器功能实验表DR1DR2S3S2S1S0M0(算术运算)M1(逻辑运算)CN1无进位CN0有进位C1430000FFFC1430001FFFC1430010FFFC1430011FFFC1430100FFFC1430101FFFC1430110FFFC1430111FFFC1431000FFFC1431001FFFC1431010FFFC1431011FFFC1431100FFFC1431101FFFC1431110FFFC1431111FFF5实验内容与实验数据记录DR1DR2S3S2S1S0M0(算术运算)M1(逻辑运算)CN1无进位CN0有进位C1430000110000011100001000111110C1430001110000111100010000111100C1430010111111010000000000000000C143001111111111010001000000000C1430100010000010100010010111110C1430101010000110100010010111100C14301100111110110111111010000010C1430111011111111000000010000000C1431000000000100000001101111111C1431001000001000000010101111101C1431010001111100011111101000011C1431011010000000100000101000001C1431100100000101000001111111111C143110110001001000010111111101C1431110101111101011111111000011C1431111110000001100000111000001