转载 网络上的8051 free IP core资源

 转自: http://blog.ednchina.com/riple/121990/message.aspx

 riple
的本科和硕士毕业设计都是关于8051 IP core的。本科毕设在Flex10k上实现了8051的部分指令集;硕士毕设完成了一个指令集和外设都可以配置的8051,核心工作是完成了指令集的自动配置。这算是我的第一个EDA产品了,采用的语言是Matlab,可以对用户的.hex编程文件进行指令统计分析,根据统计结果生成最简的VHDL代码。  riple

        不久前在网上查找资料,偶然发现多年前下载源代码的网站居然还在——The UCR Dalton Project riple

        进一步搜索了网上的8051 free IP Core资源,和5年前相比,竟然没什么大的变化。提供免费下载的还是这几个网址: riple

University of California, Riverside的Synthesizable VHDL Model of 8051 riple

Oregano Systems的MC8051 IP Core riple

OpenCores.org的oc8051 riple

        UCR的代码是最早查到的,也是我本科毕设和硕士期间主要研究的代码。这组代码内容规整,很容易看懂。一个严重的bug是在执行3字节指令时有最后一个字节指令取不到的问题,我后来给改正了,还添加了中断控制器和一些外设。一个主要的不足是16个周期的超长指令执行时间,较慢的运行速度限制了该IP核的实用性。这个IP core作为教学使用还是不错的。 riple

        Oregano Systems的8051代码是影响最广和最完善的。不但在Oregano自己的网站上有全面的文档、工具、实例,在Keil的网站上也有完整的开发工具链 riple

        OpenCores.org的代码我没看过,从module的数量和名称上看来,做的还是蛮细致的,比UCR的模块划分要复杂得多。

转载于:https://www.cnblogs.com/xinjie/archive/2009/08/09/1542346.html

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8051单片机内核IP源码cyclone2 fpga quartu工程文件+文档说明, 可以做为你的FPGA设计学习参考。 该部分的8051内核的顶层信号引脚在8051内核的顶层便可查看到各个引脚模块的定 义。引脚的定义和普通的 8051 单片机相似,区别在于 P3 口的定义,普通的 8051 单片机的 P3 口有双重功能,在对普通的 8051 单片机编程时,特别是用 C 进行编程时所面向的是寄存 器层面的,但在硬件层面上,在定义 P3 口的两种功能时是不一致的,原因是用 C 编程时, 编译软件已经将 C 代码转变成机器代码,让机器能够辨别要用哪一个硬件模块,也就是 8051 的内核已经“解码”了机器码。普通的 8051 芯片的引脚框图和 P3 口的定义如下如下: 8051IP 核 核心本身是由定时器/计数器,ALU,串行接口,和控制单元组成。 8015 内核的原理图: Clk:时钟输入 Reset:复位输入引脚 rom_data_i:ROM 数据输入 ram_data_i :RAM 数据输入 int0_i 外部中断 0 int1_i:外部中断 1 all_t0_i:定时计数 0 all_t1_i:定时计数 1 all_rxd_i:串口接收 p0_i:IO-port0 input p1_i:IO-port1 input p2_i :IO-port2 input p3_i:IO-port3 input p0_o:IO-port0 output p1_o:IO-port1 output p2_o :IO-port2 output p3_o :IO-port3 output all_rxd_o:内部接收后直接输出,可以进入 all_rxd_i all_txd_o:串口发送 all_rxdwr_o:接收方向信号 rom_adr_o: 输出到 ROM 地址信号 ram_data_o:输出到 RAM 数据信号 ram_adr_o :输出到 RAM 地址信号 ram_wr_o :数据输出到 RAM 的使能信号 ram_en_o:RAM 的时钟使能信号 datax_i:从 RAM 的数据输入到单片机的信号 datax_o:从单片机输出数据到 RAM 的信号 adrx_o:RAM 的地址信号 wrx_o:RAM 的写使能信号
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