c语言编程的电压表设计,简易数字直流电压表的设计（最终版）最新版

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1、可在μs或更短时间内完成转换。TLC每μs重复一次完整的输入转换输出(inutconversionoutut)周期。内部系统时钟和IOCLOCK独立使用且不需要任何特定的速度或二者之间的相位关系。这种独立性简化了器件的硬件和软件控制任务。由于这种独立性和系统时钟的内部产生，控制硬件和软件只需关心利用IO时钟读出先前转换结果和启动转换。内部系统时钟以这种方式驱动转换电路以便控制硬件和软件不需要涉及此项任务。当CS为高电平时，DATAOUT处于高阻状态且IOCLOCK(IO时钟)简易数字直流电压表的设计设计一个简易数字直流电压表。(量程VV、测量速度为大于等于次秒、测量误差在V以内，有超限报警、数码管显示。)模块：系统设计()分析任务要求，写出系统整体设计思路从试题的要求分析，主要包括的内容为ADC转换电路的控制、采用定时器定时读取ADC转换器的数据、将ADC转换器的数据

2、询中断标志的方式来响应的中断，所以主程序要循环完成如下任务：中断标志的查询、AD转换器数据的读取、电压值的换算以及数码管的动态扫描显示。主程序开始初始化变量设置定时器T的参数数码管动态扫描显示TF==?TF=设置TH、姆电阻起限流作用。AD转换器的参考电压由精密基准电源TL提供，标准参考电压Vref+为伏,Vref为伏。由于VV内的测量误差控制在V内，因此位AD转换器即可满足要求。AD转换器TLC是以位开关电容逐次逼近AD转换器为基础而构造的CMOSAD转换器。它们设计成能通过态数据输出和模拟输入与微处理器或外围设备串行接口。TLC仅用输入输出时钟(IOCLOCK)和芯片选择(CS)输入作数据控制。TLC的IOCLOCK输入频率最高可达MHz。TLC提供了片内系统时钟，它通常工作在MHz且不需要外部元件。片内系统时钟使内部器件的操作独立于串行输入输出的时序并允许TLC

3、和TLC象许多软件和硬件所要求的IOCLOCK和内部系统时钟一起可以实现高速数据传送以及对于TLC为每秒,次转换的转换速度。TLC的引脚排列分别如图下。如图TLC的引脚排列TLC的工作时序如图所示。图TLC的工作时序转换周期需要个系统时钟周期(最大为μs)，它开始于CS变为低电平之后IOCLOCK的第个下降沿，这适用于该时刻其地址存在于存储器中的通道。在CS变为低电平后，最高有效位(A)自动被放置在DATAOUT总线上。其余的位(AA)在前个IOCLOCK下降沿由时钟同步