电子科大计算机组成原理ppt,计算机组成原理 电子科大技大学 实验报告

计算机组成原理 电子科大技大学 实验报告

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实验报告实验报告课程名称：计算机组成原理课程名称：计算机组成原理学学　　　　院：计算机科学与工程院：计算机科学与工程专专　　　　业：计算机科学与技术业：计算机科学与技术指导教师：王指导教师：王 勇勇学生姓名：郭学生姓名：郭 小小 明明学学　　　　号：号：20110601000292011060100029实验成绩：实验成绩：日日　　　　期：期：　　　　　　20132013　　年年　　1212　　月月　　6 6　　日日 电电 子子 科科 技技 大大 学学实实 验验 报报 告告一、实验一：一、实验一：ALU 设计实验设计实验 二、实验室名称：主楼二、实验室名称：主楼 A2-411 实验学时：实验学时：4三、实验目的：三、实验目的： 1 1．熟悉．熟悉 ALUALU 的工作原理。的工作原理。 2 2．掌握多个．掌握多个 ALUALU 的扩展方法。的扩展方法。 3 3．掌握用硬件描述语言设计．掌握用硬件描述语言设计 ALUALU 的方法。的方法。4 4．掌握数据的暂存和分时传送的方法。．掌握数据的暂存和分时传送的方法。四、实验内容四、实验内容 设计一个设计一个 8bit8bit ALU,ALU,实现两个实现两个 8bit8bit 二进制数的算术运算和逻辑运算二进制数的算术运算和逻辑运算, , ★★算术运算算术运算( (加、减加、减););★★逻辑运算逻辑运算( (与、或、置与、或、置 1 1、清、清 0);0); 实验要求：实验要求：1.1.设计一个设计一个 4bitALU4bitALU 模块模块; ; 2.2.如何用如何用 4bitALU4bitALU 实现实现 8bitALU8bitALU 的功能的功能? ? 3.3.数据的输入数据的输入/ /输出输出 输入输入: : 只有只有 8 8 个开关个开关, ,如何分时输入数据如何分时输入数据? ? 输出输出: : 8 8 个指示灯个指示灯( (数据数据),1),1 个指示灯个指示灯( (进位进位/ /借位借位) ) 4.4.控制端输入控制端输入 模式控制模式控制: : ( (算术算术 / / 逻辑逻辑) ) 运算方式控制运算方式控制: : (+(+、、- - / / andand、、oror 、、setset、、clr)clr) 分时控制位分时控制位: : ( (输入数据的使能端输入数据的使能端) ) 数据输入控制脉冲数据输入控制脉冲: :5、、实验原理：实验原理：verilog 硬件描述语言的硬件描述设计仿真功能。硬件描述语言的硬件描述设计仿真功能。FPGA 现场可编程逻辑门阵列的开发原理。现场可编程逻辑门阵列的开发原理。设计图如下：设计图如下：六、实验器材：六、实验器材：PC 机、机、Xilinx ise7.1 集成开发坏境、集成开发坏境、pq208七、实验步骤：七、实验步骤：实验代码：实验代码： I/OI/O 端口连接，与指示灯连接方式如图：端口连接，与指示灯连接方式如图：I/OI/O NameNameI/ODirectionI/ODirectionLocLocdin<0>din<0>InputInputP14P14din<1>din<1>InputInputP26P26din<2>din<2>InputInputP32P32din<3>din<3>InputInputP48P48enenInputInputP51P51m mInputInputP57P57clkclkInputInputP144P144opopInputInputP58P58out<0>out<0>OutputOutputP15P15out<1>out<1>OutputOutputP12P12out<2>out<2>OutputOutputP11P11 out<3>out<3>OutputOutputP9P9cbcbOutputOutputP8P8八、实验数据及结果分析：八、实验数据及结果分析：3|4 结果，结果，111，进位，进位 0，，{op,m}运算控制符为运算控制符为 1003-4 结果，结果，1111(-1)，借位，借位 1，，{op,m}运算控制符为运算控制符为 0113+4 结果，结果，111，进位，进位 0，，{op,m}运算控制符为运算控制符为 001 置置 1 结果，除进位外置结果，除进位外置 1，，{op,m}运算控制符为运算控制符为 110清零结果，清零结果，{op,m}运算控制符为运算控制符为 000 如图显示如图显示 3&4 结果，输出全结果，输出全 0，，{op,m}运算控制符为运算控制符为 010九、总结、改进建议及心得体会：九、总结、改进建议及心得体会： 本次实验完成了一个本次实验完成了一个 ALUALU 模块的设计，并在模块的设计，并在 FPGAFPGA 模块上进行了仿真设计实现验证。完模块上进行了仿真设计实现验证。完成了在不同使能控制信号下的第一个与第二个操作数的读取，并且在模式控制信号和成了在不同使能控制信号下的第一个与第二个操作数的读取，并且在模式控制信号和 opop 操操作信号作用下完成对六种运算方式的模拟(模式控制信号控制作信号作用下完成对六种运算方式的模拟(模式控制信号控制+ + 、、-/-/ andand oror setset reserreser)。)。 本次实验将我们在课本上的知识从了解层面向理解层面迈进了一大步，增进了对所学本次实验将我们在课本上的知识从了解层面向理解层面迈进了一大步，增进了对所学知识的认识，实验收获很大。在此谢谢指导老师的辛勤工作！知识的认识，实验收获很大。在此谢谢指导老师的辛勤工作！电电 子子 科科 技技 大大 学学实实 验验 报报 告告一、实验二：存贮器设计实验一、实验二：存贮器设计实验二、实验室名称：主楼二、实验室名称：主楼 A2-411 实验学时：实验学时：4三、实验目的：三、实验目的：1 1．掌握存贮器的读写控制方法，．掌握存贮器的读写控制方法，( (读信号、写信号、片选信号读信号、写信号、片选信号) )。。2 2．掌握存储器的字扩展和位扩展方法。．掌握存储器的字扩展和位扩展方法。3 3．掌握用硬件描述语言设计存贮器的方法。．掌握用硬件描述语言设计存贮器的方法。4 4．了解存储器种类、工作原理和特点。．了解存储器种类、工作原理和特点。四、实验原理：四、实验原理：verilog 硬件描述语言的硬件描述设计仿真功能。硬件描述语言的硬件描述设计仿真功能。FPGA 现场可编程逻辑门阵列的开发原理。现场可编程逻辑门阵列的开发原理。存储器位扩展与字扩展的原理。存储器位扩展与字扩展的原理。 五、实验内容：五、实验内容： 用字扩展和位扩展的方式，设计一个用字扩展和位扩展的方式，设计一个 32X832X8 的静态存储器，能够对其随的静态存储器，能够对其随机的读写。其中：机的读写。其中：3232 表示地址的寻址空间大小，表示地址的寻址空间大小，8 8 表示数据单元的位数。表示数据单元的位数。 要求：要求： 1 1．设计一个．设计一个 16X416X4 的可随机读写的存储器模块。的可随机读写的存储器模块。 2 2．利用．利用 16X416X4 存储器模块，如何通过级连实现存储器模块，如何通过级连实现 32X832X8 的存储器的功能。的存储器的功能。 3 3．数据、地址的输入．数据、地址的输入/ /输出输出 数据数据/ /地址的输入：开关控制。地址的输入：开关控制。 数据的输出：指示灯显示。数据的输出：指示灯显示。 4 4．控制信号．控制信号 片选：低有效。片选：低有效。 读：低有效。读：低有效。 写：上升沿有效。写：上升沿有效。6、、实验器材：实验器材： PC 机、机、Xilinx ise7.1 集成开发坏境集成开发坏境七、实验步骤：七、实验步骤：实验代码：实验代码：16*4 存储器设计模块存储器设计模块 32*8 存储器设计模块存储器设计模块 8、、实验数据及结果分析：实验数据及结果分析： 实现了在写信号上升沿及片选信号低电平时的写入存储器功能实现了在写信号上升沿及片选信号低电平时的写入存储器功能 实现了在读信号和片选信号都是低电平时读出存储器数据的功能实现了在读信号和片选信号都是低电平时读出存储器数据的功能 9、、总结、改进建议及心得体会：总结、改进建议及心得体会：本实验完成了对存储器进行读写，并在给定目标和条件下进行位扩展和字扩展的实践本实验完成了对存储器进行读写，并在给定目标和条件下进行位扩展和字扩展的实践设计以完成目标任务。在布线的时候发现由于输入端口不够使用，我们就可以使用左上角设计以完成目标任务。在布线的时候发现由于输入端口不够使用，我们就可以使用左上角的转盘输入增大输入端口数。我们首先向存储器当中写入一个数值，然后再操作读取改地的转盘输入增大输入端口数。我们首先向存储器当中写入一个数值，然后再操作读取改地址信号，测试程序设计正确性。址信号，测试程序设计正确性。本次实验将我们在课本上的知识从了解层面向理解层面迈进了一大步，增进了对所学本次实验将我们在课本上的知识从了解层面向理解层面迈进了一大步，增进了对所学知识的认识，实验收获很大。在此谢谢指导老师的辛勤工作！知识的认识，实验收获很大。在此谢谢指导老师的辛勤工作！ 关 键 词： 计算机组成原理电子科大技大学实验报告

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