苏州科技学院 电子与信息工程学院
《计算机接口技术》大作业
业: 电子信息工程 专
级: 班
姓 名:
号: 学
月6年2012
1.设计内容:
应用所学芯片8255、8251、8253、8237、8259、0809、0832及总线接口相关知识,在proteus中设计一套系统或一个小装置。要求至少用到以上三款芯片或接口技术。
2.考核要求:
1、设计具有基本完整的功能,具有可实现性;
2、强调创新性和应用性,不与现有系统、产品雷同;
3、硬件设计要求详尽,软件设计可以限于主要功能和关键部分
4、自拟题目,题目要求新颖
硬件设计3.
3.1 设计思想
硬件电路的搭建主要由8255A、8251和8253组成,利用地址译码器将8086芯片的端口地址分隔开,然后分给各个芯片。
3.2主要元器件介绍
3.2.1 8255A模型
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:
各引脚功能如下采用双列直插式封装,共有40个引脚,8255 用来传送数据信息。与单片机数据总线连接,D0--D7:三态双向数据线, CS:片选信号线,低电平有效,表示芯片被选中。 RD:读出信号线,低电平有效,控制数据的读出。 WR:写入信号线,低电平有效,控制数据的写入。 +5V电源。Vcc: /输出线。PA0--PA7:A口输入 /输出线。:B口输入PB0--PB7 输出线。口输入:C/PC0--PC7 :复位信号线。RESET 内部端口。A0:地址线,用来选择8255A1、 :地线。GND: 其控制逻辑为A1 A0 RD WR CS 工作状态
A口数据-->数据总线0 0 0 1 0
B口数据-->数据总线0 1 0 1 0
C口数据-->数据总线1 0 0 1 0
总线数据-->A口0 0 1 0 0
总线数据-->B口0 1 1 0 0
总线数据-->C口1 0 1 0 0
总线数据-->控制字寄存器1
1
1
0
0
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三态数据总线-->* * * 1 *
1 非法状态0 1 0 1
-->0 * 三态* 1 数据总线1
//输出端口,两个工作方式控制电路,一个读8255内部包括三个并行数据输入 8位总线缓冲器。各部分功能概括如下:写控制逻辑电路和C
B、1)端口A、( 8位数据输入锁存器。8位数据输出锁存器/缓冲器和一个A口:是一个 8位数据输入锁存器。输出锁存器/缓冲器和一个B口:是一个8位数据输入/位数据输入缓冲器(输入不缓冲器和一个88位数据输出锁存器/C口:是一个 锁存)。它在“方状态信息端口,/输出端口。C口作为控制通常A口、B口作为数据输入/分别与位锁存器,位端口,每个端口有一个4式控制字”的控制下可分为两个4 口配合使用,作为控制信号输出或状态信息输入端口。A口、B )工作方式控制电路(2这两组控制电路。组控制电路,另一个是B工作方式控制电路有两个,一个是A以决用来接受中央处理器发来的控制字,组控制电路具有一个控制命令寄存器,口按位清“0”或者按位置C定两组端口的工作方式,也可根据控制字的要求对 “1”。组控制电路用来控B)。口和C口的上半部分(PC7-PC4A组控制电路用来控制A )。口的下半部分(PC3-PC0制B口和C )总线数据缓冲器(3与系统总线之间的接口,8255位缓冲器,作为总线数据缓冲器是一个三态双向8 用来传送数据、指令、控制命令以及外部状态信息。 /写控制逻辑电路(4)读A1-A0RESET、地址信号RD、WR、读/写控制逻辑电路接受CPU发来的控制信号送来的,或者将CPU等,然后根据控制信号的要求,将端口数据读出,发往CPU 数据写入端口。 工作方式控制字
输出) 1:输入 0:端口D0 C(下半部 B输出 组D1 端口B 1:输入 0:1 方式选择D2 0:方式0 1:方式 ) 1:输入 0:输出C(D3 端口上半部 A 组端口D4 A 1:输入 0:输出2 方式选择1 *1:方式 00:方式0 10:方式D5D6
1:有效 置方式标志D7
:
口按位操作控制字C D0 位:置位 0:置位复位/复位 1:100 101 110 010 000 001 011 111 D3D2D1
C7
C6
CO
C1
C2
C3
C5
C4
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D4
D5 无关D6
有效:置位/复位标志 0:D7 位 三个端口都可以由,/输出工作方