三人抢答器逻辑电路图_数字电路3人抢答器实验报告.doc

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1数字电路与逻辑课程设计报告(本科)题目三人抢答器设计专业网络工程班级1305022学号11姓名牟黎明评定成绩指导教师李小平、易兴兵完成时间2015年6月1日2015年6月5日电子工程学院二零一五年五月2一、实习目的1数字电子技术知识的综合应用,包含1门电路的应用2编码器的应用3JK触发器的应用4显示译码器的应用5七段数码显示器的应用2学习电路安装图的绘制方法。3学习电路的调试方法。二、实习设备及实验器件清单实验器件1双下降沿JK型触发器74LS1122个2三3输入与非门74LS102个3四2输入与非门74LS002个44线七段译码器/驱动器74LS481个5LED共阴极显示器AR5471个6触发开关5个710K电阻5个81K电阻3个9铜导线若干10锡焊丝若干3实验工具1电烙铁每组一个2剪刀每组一把3镊子每组一把4学生电源每两组一个5图纸每组一张4三、实习内容1原理方框图2电路原理图SWK12K3抢答信号接收抢答信号识别锁存电路抢答成功提示抢答成功座位显示00SW1门F4553抢答流程图四、阐述电路工作原理。当主持人按动复位开关SW对前一次的记录进行清除,座位显示器显示“0”,进入抢答准备阶段,但此时选手无法抢答(抢答无效,信号被封锁)。当主持人按动开关SW1时,进入抢答时段,锁存电路输出高电平作用于触发器1、2、3的JK端。抢答信号(K1、K2、K3)以负脉冲形式作用于JK触发器时钟端,最早抢入的输入信号使该电路触发器最先翻转,输出的抢答信号一路经门F4、F5以下降沿作用于锁存电路(JK触发器,工作于置“0”状态)时钟端,输出低电平使三路JK触发器的工作状态由“翻转”变为“保持”,后续的抢答信号不能使其他触发器产生翻转。这样就封锁了后到的信号。输出的抢答信号同时以低电平驱动座位提示灯。三路JK触发器输出的组合信号经门电路F1、F2、F3、F6、F7、组成的识别电路,驱动座位显示电路,以数字显示的方式显示抢答成功选手座位号。五、三人抢答器安装图绘图纸的设计。按动SW清除数据进入抢答准备时段按动SW1进入抢答时段同时数显座位号抢答成功选手座位灯点亮K1、2、K3选手抢答重复以上过程抢答结束6六、安装及调试过程在专周期间遇到了什么问题,又是如何解决的。答在周开始安装之前我们都先进行了焊接的练习,一开始手有点抖,但练习了几次之后就比较顺畅了,觉得焊电焊很简单的,所以就没有再加练习就直接等老师发器件后直接开始安装了。暗转步骤从器件(除开导线外)开始,先安装小器件,再暗转大的,在焊接器件的过程中也比较顺利,只是当时板子有点弯,所以中间的器件背面无法顶紧,焊接后发现突出,于是又用电烙铁把角熔了,下面放了一个小的方块,把器件下方顶在方块上从新焊接,再一次焊接后焊接的很紧。器件焊接完后,我们开始布置跳线,把所有跳线布置好后开始布置暗线,由于布置跳线时没注意暗线,所以没有考虑到预留跳线的两端当做暗线用,所以只有少数贴别短的暗线用到了跳线预留的两端外,其余的全是从新剪线,所以我觉得这点我们做得不好,也或许是没有经验的原因吧,以后再遇到时一定会预留出来。暗线特别多,并且有的暗线距离很短很短,所以操作很困难,只有用镊子夹着线。有的距离很小时,我们就直接采用了用锡焊直接连接,这才发现这个操作太困难了,不知道咋的,我们先在一个点上熔较多的锡焊,准备再用烙铁铺开,可就是铺不开,形成一个水球,我们再在另一个点了熔一点,准备让他浸过去,但还是很困难,他们各自形成一个水球,弄了很久,所以有的就把下面的铜圈给弄起来了,铜圈弄起来后锡焊就直接不沾了。线连接完后,开始用万用表测试连通性,发现有路不通,开始对线,发现都是连接好了的,自己怎么都找不到,叫别人帮忙找了下,发现有两处芯片的脚哪儿与背面的的跳线的脚哪儿没有焊接,因为当时我们把线剪断后直接压下去,焊接时感觉哪儿是被焊接过,就没有发现,又用烙铁焊接好后就可以了。7调试时,等待老师检查并发器件,拿到器件后,按照安装步骤一步一步安装,可能运气好,或者我们安装过程中很细心的缘故吧,我们的器件安装上去后就直接可以用,没有任何问题。但我们同桌的那组安装好后出现了问题,就是当按下抢答按钮2号键时,灯正常显示,但数字显示屏没有变化。我就帮着一起给他们找问题,先检查线路,发现都没有问题,最后看是否有虚焊,也没发现,弄了很久,仍找不到原因,最后寻求老师,老师让我检查下74LS10的线路,最后才发现开关2接到74LS10的线路错位了,后把线路改过就好了。8七、专周的心得体会包含题目的难易程度、专周收获,有什么意见及建议等整体描述作为班长,我站在班长的立场上来说句。我觉得这个专周是我们班同学积极性最高的一次专周,为了完成作品,每天中午有的同学不吃饭,叫同学带饭过去,基本上都没有午休,吃完饭后就径直的去实验室了,这是我从没感受过我们班这样好的学习氛围。所以我想,及时理论或技术上我们没有收获的话,至少我们收获了一点,对求知或者说完成工作那一份忘我的积极性。自己的体会吧。首先,毋庸置疑,学会了一项新技能,焊电焊。当开始专周之前,我们老师说到时候自己设计原理图,那时我觉得对于我们计算机专业的学生来说,难度很大,但开始专周之后,原理图老师给我们了,我们的任务就是用原理图设计电路图。开始看着时我对老师说这有什么难,1个小时搞定,但当自己晚上真正画得时候才知道有多难,设计到最后画到图纸上,用了5个多小时,而且还不知道对不对,因为最终安装图为老师给的。我觉得叫我们自己画图,设计图,一方面锻炼了我们的耐心,也锻炼了我们的思维,我觉得这也是一次难得的锻炼自己的机会。当然,在连接电路图当中,考察了我们对图纸和实际的结合,也更考验了我们的耐心,因为我们平时很少有机会动手把那些设计的图纸,经自己的理解,最终把他呈现在现实的实物中,也考验了我们的细心,因为焊接电线中,有的间距很小,如果一不小心,有可能就会和旁边的线连接在一起。而且连线图中,切记不可为了快而走捷径,那样的画最终调式时很痛苦的,因为有很多是虚焊的话,很难找出来的。当然,最后调试时遇到问题时也不要着急,不要因为着急就到处乱碰,此时应该静下心来,先慢慢9分析,次问题出现的原因可能是那块局域的线没连接好,想好后再对局部的线路进行检查并修改。收获整个专周,我从中学到了做事我们应该要有耐心,只有对一件事有了足够的耐心,我们才能静心沉着的去思考,遇到麻烦时心中才不会火急火燎;做事时应该具有细心,当然这个是建立在耐心的基础上,在做事的过程中我们应该万分的细心,只有做事时足够细心,完事后才不会有过多的问题,如本次专周中,有的同学开始时不认真,就耽搁了大量时间,到最后为了完成任务,很粗心,很快的就弄完了,可验收时错误一大堆,最终又花费了等同的时间才去把问题解决了;还学会了理论与实践结合的运用,如最开始自己设计电路图,接着又根据老师给的电路图把它呈现在电路板中,我觉得这是给我们一个很好的锻炼机会,可以说是自己动手完成了一个完整的项目。当通电后,没有问题的那一瞬间,心中好有成就感。意义加强了我们的动手能力,理论与实践相结合的锻炼。整个过程中,自己去设计,操作,发现问题时自己想办法去解决问题,增加了我们对求知的积极性;同时以小组的方式进行,锻炼了我们与他们协同合作的能力。总的说,教会了

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1 数字式抢答器的设计 一、设计任务与要求 1. 设计一个智力竞赛抢答器, 可同时供 8 名选手或 8 个代表队参加比赛, 他们的编号分别是 1、2、3、4、5、6、7、8,各用一个抢答按钮,按钮的编 号与选手的编号相对应,分别是 K1、K2、K3、K4、K5、K6、K7、K8。 2.给节目主持人设置一个控制开关,用来控制系统的清零(编号显示数 码管灭灯)和抢答的开始。 3.抢答器具有数据锁存和显示的功能。抢答开始后,若有选手按动抢答 按钮,编号立即锁存,并在 LED 数码管上显示出选手的编号,同时扬声器给 出音响提示。此外,要封锁输入电路,禁止其它选手抢答。优先抢答选手的 编号一直保持到主持人将系统清零为止。 4. 抢答器具有定时抢答的功能, 且一次抢答的时间可以由主持人设定(30 秒)。当节目主持人启动"开始"键后,要求定时器立即进行倒计时,并用显示 器进行显示,同时扬声器发出短暂的声响,声响持续时间 0.5 秒左右。 5.参赛选手在设定的时间内进行抢答,抢答有效,定时器停止工作,显 示器上显示选手的编号和抢答时刻的时间, 并保持到主持人将系统清零为止。 6.如果定时抢答的时间已到,却没有选手抢答时,本次抢答无效,系统 进行短暂的报警,并封锁输入电路,禁止选手超时后抢答,定时显示器上显 示 00。 二、设计参考 数字抢答器的总体框 8.34.1 所示,它由主体电路和扩展电路两部 分组成。主体电路完成基本的抢答功能,即开始抢答后,当选手按动抢答键 时,能显示选手的编号,同时能封锁输入电路,禁止其它选手抢答。扩展电 路完成定时抢答的功能。 三、设计报告要求 1.画出数字抢答器的总体框及完整的逻辑电路,并说明其设计原理及工 作过程。 2.说明实验中产生的故障现象及解决方法。 3.心得、体会和建议。 2 四、总体框 抢答 按钮 优先 编码 电路 锁 存 电路 译码 电路 主持 人开 关 控制 电路 报警 电路 秒脉 冲电 路 定时 电路 译码 电路 显示 电路 显 示 电路 3 五、实验内容 1、各芯片的工作原理及电路。 (1) 74LS373 锁存器 74LS373 与单刀双掷开关相连作为 8 位选手的抢答锁存开关,它的 4 脚、7 脚、8 脚、13 脚、14 脚、17 脚、18 脚、3 脚分别连接单刀双掷 开关 J1---J8。 单刀双掷开关的双掷的两个端脚分别接 5V 和 0V 高低电平。 1 脚 OE 为 三态允许控制端(低电平有效) 。当三态允许控制端 OE 为低电平时, 1Q~8Q 为正常逻辑状态, 可用来驱动负载或总线。 当 OE 为 高电平时,1Q~8Q 呈高阻态,即不驱动总线,也不为总线的负载,但锁 存器内部的逻辑操作不受影响。本实验中 1 脚接地为低电平。 11 脚作为锁存允许端与 74LS76 的 15 脚相连,74LS76 的 15 脚输出 电平的高低变化控制 74LS373 的导通与锁存。具体控制过程为 11 脚为 高电平时,整个芯片呈"透明"状态,即输出端的电位随输入端的变化 而变化;当 11 脚为低电平时,输出的信号被锁存, 不再受输入端的影 响。 20 脚接高电平 5V,1 脚和 10 脚接地。2 脚、5 脚、6 脚、9 脚、12 脚、15 脚、16 脚、19 脚分别与 74LS148 的 4 脚、3 脚、2 脚、1 脚、13 脚、12 脚、11 脚、10 脚相连。 其芯片的连接如下: 1 74LS373 电路连接 接 7 4 L S 1 4 8 接 74LS76 的 15 脚 抢答开关 4 (2) 74LS148 优先译码器 74LS148 优先编码器,作用是将 74LS373 输出的电信号编码。 其 4 脚、3 脚、2 脚、1 脚、13 脚、12 脚、11 脚、10 脚与 74LS 373 的 输出端 2 脚、5 脚、6 脚、9 脚、12 脚、15 脚、16 脚、19 脚分别相连。 6 脚、7 脚、9 脚分别与 CD4511 的 2 脚、1 脚、7 脚相连。 14 脚连接 74LS76 的 1 脚和 6 脚,15 脚接 CD4511 的 4 脚。作用为 74LS148 不译码时,14 脚为高电平;译码时,14 脚为低电平。通过两 种状态电平变化产生的高低脉冲来控制 74LS76。 当 74LS148 输入端全 为高电平,15 脚为低电平,译码时为高电平,从而控制 CD4511。 5 脚、8 脚接地,16 脚接高电平。 74LS148 的真值表和连接电路如下: 74LS148 真值表 输 入 输 出 Is I0 I1 I2 I3 I4 I5 I6 I7 A2 A1 A0 E S 1 0 0 0 0 0 0 0 0 0 × × × × × × × × 1 1 1 1 1 1

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