本文是关于计算机组成原理实验的总结，重点介绍了一个单总线CPU的设计，涵盖从指令译码器到硬布线控制器的实现。实验包括六关，涉及数电知识和Logisim的使用，强调了逻辑式自动生成和组合逻辑电路分析。在设计过程中，特别是第四关的硬布线控制器组合逻辑单元，需要细心和耐心。最终通过联调和测试程序验证设计正确性。
计算机组成原理实验 单总线CPU设计(定长指令周期3级时序)(HUST)总结
全部任务共六关。主要涉及定长指令周期三级时序系统的设计，设计过程中比较重要的是数电知识、Logisim的组合逻辑电路分析功能和所给Excel表格的逻辑式自动生成。实验总体难度不难，操作有些麻烦，自己动手实现是挺有趣的。希望大家自己保持耐心、多多思考，顺利完成实验。
关于另一种变长指令单总线CPU的设计，可以参考
计算机组成原理实验 单总线CPU设计(变长指令周期3级时序)(HUST)思路总结
第1关 指令译码器设计
思路：利用比较器将指令字转换为译码信号。
注意：
1.指令字OP与不同信号的对应(查阅手册可知)
2.所给常量为16进制，转换时需注意
16进制：23 == 2进制： 00100011
3.SLT除对OP有要求外，对FUNC也有要求，考虑使用与门
其余只对OP有要求
第2、3关
思路：按照题目要求填表，再使用Logisim的组合逻辑电路分析功能即可。也可以直接在Logisim的组合逻辑电路分析功能填写真值表。
第4关 硬布线控制器组合逻辑单元设计
思路：同2、3，不过需要使用表达式进行Logisim的组合逻辑电路分析，表达式可以通过Excel自动生成
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