cmos逻辑门传输延迟时间_组合逻辑电路详解、实现及其应用

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一、什么是组合逻辑电路？

在数字电路中,根据逻辑功能的不同,我们可以将数字电路分成两大类,一类叫做组合逻辑电路、另一类叫做时序逻辑电路。本次主要讲解组合逻辑电路的原理、应用和Verilog实现。

组合逻辑电路在逻辑功能上的特点是任意时刻的输出仅仅取决于该时刻的输入，与电路原来的状态无关。而时序逻辑电路在逻辑功能上的特点是任意时刻的输出不仅取决于当时的输入信号，而且还取决于电路原来的状态，或者说，还与以前的输入有关。

我们从图中可以看出,左侧的X是表示它的输入变量,右侧的Y是表示它的输出变量,对于这种电路,它的输出Y仅仅与当时的相应输入X有关系,而与之前的输入X是没有关系的,像这种电路,我们就称它为组合逻辑电路。

二、如何分析组合逻辑电路？

了解了什么是组合逻辑电路之后， 我们应该如何去分析电路？如果有了电路图，我们用什么方法可以快速准确知道它所实现的逻辑功能？

上图给出了组合逻辑电路的分析方法和流程，具体每一步如何实现，不记得的同学可以复习数电基础，温习一下公式化简、卡诺图化简、真值表等内容。

三、如何设计组合逻辑电路？

由上面我们可以知道，分析组合逻辑电路是根据给定的组合电路逻辑图,分析出其逻辑功能。那么设计组合逻辑电路是分析组合逻辑电路的逆过程,我们要根据给定的逻辑功能要求,设计出一个能实现这种功能的最简逻辑电路。

首先要根据逻辑功能建立真值表，通过真值表写出逻辑函数表达式，再进行表达式化简，再根据化简后的函数表达式画出逻辑电路图。

四、竞争与冒险

1、竞争冒险的产生

当一个逻辑门的两个输入端的信号同时向相反方向变化时，从变化开始到达稳定状态所需的时间不同，称为竞争。

逻辑门因输入端的竞争而导致输出产生不应有的尖峰干扰脉冲（又称过渡干扰脉冲）的现象，称为冒险。

在实际电路中,输入信号通过每一个门电路然后输出,它总是要有传输时间的,那么这个就做门电路的传输时间或是延迟时间。在一个组合电路当中,当某一个变量经过两条以上的路径到达输出端的时候,由于每条路径上的延迟时间的不同到达终点的时间就会有先有后，就会产生竞争。

2、竞争冒险的消除方法

1）加封锁脉冲。在输入信号产生竞争冒险的时间内，引入一个脉冲将可能产生尖峰干扰脉冲的门封锁住。封锁脉冲应在输入信号转换前到来，转换结