c盘windows文件夹过大_C盘满了？试试这几招

最新推荐文章于 2023-03-04 21:24:14 发布
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文章标签： c盘windows文件夹过大

作为一个科技型的博主，经常会被问到一个问题：XXX，我C盘满了，怎么办？

奈何很多人还在用360，腾讯电脑管家清理，然后清理了半天C盘就少了一两个G，下面，就告诉大家几个常用的清理方法。

一.清理Windows.old

顾名思义，Windows.old，老旧的windows，像win7，win8升级来的，win10低版本升级到新版，都会形成这个文件夹，这个文件包含了很多之前版本win的信息，以及一些重要文件，有些用不习惯win10的用户可以通过这个文件夹逆向升级，也就是降级！

但是很多人根本就不知道，然后C盘白白多了十几个G。

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由于笔者的电脑比较干净，Windows.old 文件夹早就没啦，不过，只要有这个文件夹的电脑，位置都在C盘根目录，直接删也没事，要是你是在不放心，也可以这么删。

点开设置，选择系统

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选择存储，点开开存储感知开关

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点击配置存储感知或立即运行

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单击立即清理即可，如有删除以前版本的windows，打钩即可，就是这个文件。


二.更改系统文件夹位置

还是刚刚那个地方，选择更改新内容的保存位置

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下拉菜单选择其他盘，哪个盘空选哪个

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三.关闭win休眠

其实，不太推荐，但是真的有效，休眠文件是在电脑睡眠或者休眠时期保存的系统运行时的文件，小白不太推荐关闭这个功能。

同时按住win键+R，输入cmd

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输入：powercfg -h off ，按下回车，重启，休眠文件就会被清除。

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四.清理微信缓存

由于现在微信电脑版的用户很多，不得不提一下微信的缓存问题，有的一下就是几十个G，极其占用空间。

点开微信设置，选择文件管理，打开文件夹。

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将文件夹里的所有文件复制到其他盘，然后选择更改，位置指向到复制的位置即可。

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五.还是缓存

经常用PS，AI，AE，PR等adobe全家桶的小伙伴可能经常会碰到C盘飚红 的场景，下面以PS为例，教大家释放下C盘空间。

打开PS，选择编辑，点击首选项，然后选择暂存盘

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选择除C盘以外的空闲盘符即可。

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AI，AE，PR同理。

以上就是一些基础的清理教程，当然还有很多深度的，像清理更新缓存啊，nvidia驱动缓存啊，压缩软件缓存，虚拟内存，查找大文件等等，相对比较复杂，以上正常情况下就能给C盘清理出十几个G空间了。

如果本教程对您有帮助，请多多转发并关注 “抹茶科技” ，感谢！

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file，如图11. 图11 个人比较喜欢把设计图，波形图等界面单独显示，利用自己电脑windows7系统的预览 功能，切换起来十分方便，便于观察。点detach window，就可实现，如图12. 图12 然后在edit里面编辑end time和grid size。如图13. 图13 在左边name一栏双击,如下图。 点选node find。 第一次的时候有可能需要设置Filter中为Pin：all。 点选List，列出所有Pin。 选择Nodes Found中到Selected Nodes。（利用两者直接的四个按钮可以方便传送，删除） 完成后，如图14（此图我已经进行过波形仿真，顾不是原始的波形图） 图14 自己开始进行波形仿真。其中会发现总线上的信号D0,D1等信号左边符号显示的是io， （D0,D1本来的属性就是IO）这个问题后面再说。左边工具栏的功能，自己一个个点点试 试就知道什么功能了，很容易上手。第一次做波形仿真的时候有可能会遇到无法点选珊格， 需要自己小心意义，选满珊格，其实是没有勾选snap to grid。在工具栏倒数第二个键就是此 功能键，当然也可以在view里面选择，如图15. 图15 将一些类似的信号进行合并，一起选中后右击，点选group，进行合并或者拆分。在对 一些信号合并的时候，个人使用Quartus有个小瑕疵，不能命名为SW R1 R2 R3 BUS，这样 的信号名，有空格或者“【”等符号都会显示illegal node name。 对于那些名称很类似的信号合并，由于你需要重新排序，可以点工具栏最后那个按钮， 看英文你就知道选按照升序或者降序排列，默认的是升序，由于波形仿真需要一般都选 descenting。 点选波形仿真的快捷键。 波形仿真中有个需要注意的是，波形图的名称一定要与你所在的工程名相同。因为波形 仿真是和编译后的文件关联的。因此如果你在设计16位计数器的时候进行了波形仿真来测 试是否符合要求，如果想保留此波形图，请save as其他名称，因为后面进行memory的波 形仿真图的时候，会把原图覆盖。如果不取和工程名相同名称的波形图名称，将无法进行波 形仿真。 波形仿真完后，出来一个类似波形仿真对话框的界面，他的label 名称为：simulation如 图16. 图16 会发现该波形图比原波形图多出了8个信号，正好与原来波形图中的双向信号对应，只 是多了个后缀result。这正是你要总线输出信号。你可以试着去修改波形图（其实修改不了， 所以我一般随便双击一段波），会弹出对话框如图17. 图17 点选I want那个选项。然后出现一个对话框，点yes，发现自己创建的波形图变了。两 个英文对话框的意思就是我要重修原来的input file，你点了修改了，系统检测到你点波形图 已经改变了，因此询问你是否替换成修改后的波形图，点yes后就发现自己原来的波形图上 也多出了那几个信号。将这些信号排序组合，命名，如图18. 图18 你会发现波形仿真的结果原来的总线信号还是处于高阻态信号，后来出现的信号显示了 你预期的结果。这个时候注意，原来那些高阻态的信号不能删除，如果删除波形仿真会出错。 （不信可以自己试试，到底哪里会错误）为了避免影响自己观察，既然已经将他们打包了， 把他们放在波形仿真末尾，不碍着自己。 在设计的过程中，如果通过波形仿真发现问题错了，得修改电路图。如果没有改变顶层 的输入输出，如只改变了内部连线，则直接点波形仿真好了，不用再次重新建立波形仿真图。 同样，如果打包的芯片内部连线改变了，只用去修改下内部的连线就可以了，重新编译一下。 但是如果某个打包的芯片需要改变输入输出，那么只能将该芯片重新create symbol file for current file了，将原来的bsf文件覆盖了。不然编译的时候会显示被改变的输入或者输出端 与原来的不符合。在顶层芯片图中，也需要右击该芯片，然后选择update symbol or block。 如图19. 图19 三个选项自己英文都能够看懂，更新后引脚的位置有可能改变了，自己需要注意下，然 后重新连接正确。重新编译。 得到正确的波形图后，写实验报告的时候需要对波形图进行说明，此时点选A工具， 进行注释十分方便。 波形仿真正确后，需要进行下载电路的设计（有些图甚至不需要添加外围下载电路）， 然后进行只需进行管脚绑定了。 点选Assignment->Pin Planner 只需在管教的location 选项直接输入管教的数字，就可以很简单的绑定了。 管教绑定后结果如图20. 图20 管脚绑定完再次编译，自己可以看到原来的设计图中的输入输出旁边都会显示已经绑定 好的管教，非常直观，便于自己观察。如图21. 图21 下载： 点选tools->Programmer 第一次有可能使用Hardware Setup。（本人使用的USB下载，写此文时未接上所以显示 No Hardware。实验室的下载线使用的都是并口下载线（有个学长做好了USB下载线，不知 道有没有广泛使用）。Mode选择JTAG，选中sof文件后就可以start了。） 关于下载的一些经验： 每个人都有自己的下载习惯，根据我们实验需要，我们可以养成自己的下载习惯。由于 下载需添加下载电路，万一我们要仿真原来的设计图就显得麻烦了，因此个人建议，在工程 所在的文件夹下再次新建一个工程，然后将原来的设计文件全部add all进去。（在工程建立 的时候那个add file步骤，也可以点选Project->Add/Remove Files in Project进行操作）如图 22 图22 将原来的顶层图打包，作为下载的一个模块，然后添加下载电路。如下图所示： 由于我们下载经常要用到一些下载辅助模块，如扫描电路，消抖电路，7端译码器，可以专 门新建一个文件夹保存这些设计文件，然后在Project中add就可以。然后依次生成对应的 bsf文件（即打包,bsf 文件必须在工程所在的文件下），添加到下载电路中。 管脚绑定也可以利用tcl 命令来完成，我们做实验的时候要反复用到数码管的下载，数 码管的绑定每次都是一样的，而且我们都是用自己设计的扫描电路和7段译码器，因此我们 可以利用tcl命令来简化我们自己的绑定。一种比较省事的办法就是在第一次使用Pin Planner 后，点选file->export,导出文件类型选择tcl。 查看tcl 文件，我们可以看到里面的信息如下： # Copyright (C) 1991-2009 Altera Corporation # Your use of Altera Corporation's design tools, logic functions # and other software and tools, and its AMPP partner logic # functions, and any output files from any of the foregoing # (including device programming or simulation files), and any # associated documentation or information are expressly subject # to the terms and conditions of the Altera Program License # Subscription Agreement, Altera MegaCore Function License # Agreement, or other applicable license agreement, including, # without limitation, that your use is for the sole purpose of # programming logic devices manufactured by Altera and sold by # Altera or its authorized distributors. Please refer to the # applicable agreement for further details. # Quartus II Version 9.0 Build 132 02/25/2009 SJ Full Version # File: E:\code\computer system\cpu design\result\memory\mem_download.tcl # Generated on: Thu Dec 24 19:08:02 2009 package require ::quartus::project set_location_assignment PIN_184 -to q[2] set_location_assignment PIN_183 -to q[1] set_location_assignment PIN_182 -to q[0] set_location_assignment PIN_29 -to scan set_location_assignment PIN_186 -to y[6] set_location_assignment PIN_187 -to y[5] set_location_assignment PIN_188 -to y[4] set_location_assignment PIN_193 -to y[3] set_location_assignment PIN_194 -to y[2] set_location_assignment PIN_195 -to y[1] set_location_assignment PIN_196 -to y[0] set_location_assignment PIN_116 -to CLR_INDATA set_location_assignment PIN_115 -to EN_INDATA set_location_assignment PIN_152 -to CLK_COUNT set_location_assignment PIN_117 -to 161ar set_location_assignment PIN_105 -to 161pc set_location_assignment PIN_118 -to ldar set_location_assignment PIN_28 -to H set_location_assignment PIN_107 -to pcclrn set_location_assignment PIN_108 -to memenab set_location_assignment PIN_113 -to rd set_location_assignment PIN_114 -to we set_location_assignment PIN_106 -to pcload set_location_assignment PIN_123 -to pc_bus set_location_assignment PIN_124 -to sw_bus set_location_assignment PIN_122 -to reset set_location_assignment PIN_64 -to T3 保留我们所要的下载信息： package require ::quartus::project set_location_assignment PIN_184 -to q[2] set_location_assignment PIN_183 -to q[1] set_location_assignment PIN_182 -to q[0] set_location_assignment PIN_29 -to scan set_location_assignment PIN_186 -to y[6] set_location_assignment PIN_187 -to y[5] set_location_assignment PIN_188 -to y[4] set_location_assignment PIN_193 -to y[3] set_location_assignment PIN_194 -to y[2] set_location_assignment PIN_195 -to y[1] set_location_assignment PIN_196 -to y[0] 以后每次进行下载的时候，只需在Project中添加该tcl 文件，然后点选菜单栏tools->Tcl Scripts 然后选择Project中的那个tcl 文件，点选Run，即运行下这个tcl 命令。当我们去查看 原图的时候，会发现那几个数码管的下载管教已经成功绑定了。其余的利用Pin Planner可 以快速绑定。 p.s：一些补充的内容 1.关于Quartus使用 去图书馆借阅一本Quartus的书，很多书籍都有介绍如何入门使用，而且写的很详细。要学 会充分利用图书馆的书籍资源。 Quartus的使用和其他软件一样，完全是孰能生巧。比如放大缩小，自己可以使用鼠标的单 击，右击，其实还可以通过ctrl键和鼠标的滚轮结合使用。如果你不知道某项操作，一种方 法是在他人寻求帮助，找有经验的人，而Google恐怕是每个人最好的老师。还有一种办法 就是自己去尝试。毕竟很多软件做的都是很人性化的，作者设计的软件是很为用户考虑的， 而且通过那些选项的英文提示，我们就很容易完成我们所设想的事情。比如要用到建立mif 文件，你会发现无法填入16进制数，他会提示你请输入十进制的数，这个时候就知道他默 认的是10进制，因此你第一个想到的就是采用16进制，自己右击一下就会发现有地址和内 容的16进制选项了，我们要学会自己去尝试，一个软件很大，不可能全部由别人来告诉自 己怎么使用，自己也会养成自己使用软件的习惯和窍门。 2.HDL语言 实验中的下载模块，我们尝试着使用VHDL或者Verilog来完成设计，你会发现很简单使用。 不管是使用原理图还是HDL语言，我们都可以在顶层框图导航，右击 locate in RTL viewer， 查看编译后的RTL图。为了进一步学习，应当熟练掌握HDL描述语言，在工业界以Verilog 占主导地位。查看RTL如下： 选择完后显示如下： RTL查看的好处有很多，很方便自己排错，如果你是图形输入，可以很轻松的检查线是否 存在连接错误。（光标移动到某根线就知道为什么了） 3.例化原件 本人做的时候也遇到过这种问题，自己在使用VHDL完成课程设计的时候，自己使用语言 写了一个存储器，结果编译的时候过了，但是综合的时候出错，显示逻辑单元不够，在后来 的学习当中，知道了这个是Quartus综合工具的问题，因为他不够智能。在我们每次编译完， 我们可以看到编译信息，使用了多少逻辑单元，使用了多少存储资源。Quartus综合的时候 将我们的语言使用逻辑单元来实现，因此逻辑单元被全部用光。解决的办法有两个：使用第 三方综合工具，例化原器件。 点选菜单栏的tools->MegaWizard Plug-in Manager，如下图： 会显示对话框如下： 点选next 在左边的方框中选择Memory Compiler->RAM:1-PORT，右半部分第一个是Cyclone芯片选 项，自己选不同的Device family可以看到左边有些资源就不可以例化，因为每个芯片的ip core不一样造成的，比如我们的Cyclone芯片就有两个pll让我们调用，第二个选项选择例 化语言：VHDL，AHDL，Verilog HDL，然后选择例化后的文件名极其位置，点选next，进 行存储字的大小，线宽等选项。 可以如果还需要更加详细的参数设置，只需next下去，当然可以直接finish，利用默认的参 数。 我们可以看到可以有很多原件可以让我们调用，就如同图形输入的元器件库。 4.第三方软件 当我们熟练掌握了使用Quartus后，可以试着尝试使用第三方软件来完善我们的工程， 有些第三方软件确实比Quartus自带的工具强大，如用于仿真的Modelsim，用于综合的 Synplify，而且这些软件和Quartus软件都能很方便的配合使用。 新建工程的向导当中就有一步是选择第三方软件，我们起初选择的默认参数，即都没有 使用，当我们熟练使用后就可以试着通过调用第三方软件来实现。 ModelSim可以进行前仿真，也可以进行后仿真。（前仿真即功能仿真，不考虑延时等器 件性能，后仿真即模仿实际情况的仿真，Quartus也可以实现，在仿真的opinion选项里有勾 选是否考虑器件等因素），ModelSim的仿真功能还是很强大的。 Synplify软件是一款很流行的综合软件。就比如前面的存储器，如果自己用语言描述， Synplify的综合就知道调用存储单元来实现该功能，Synplify的好处有很多，对于逻辑资源 的节省是其一大特色。Quartus的编译，综合 完成后会显示消耗的资源，如果通过Synplify 综合，逻辑资源有时候能节省很多。Synplify软件和Quartus软件能够很好的配合使用，可 以通过Synplify软件调用Quartus软件，也可以通过Quartus软件调用Synplify软件。
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基于stm32f103C8T6智能台灯设计与制作
05-03
本次设计是系统介绍了智能台灯的应用背景、设计原理、软硬件电路等。以STM32作为主控，应用定时模块、人体感应模块、光敏模块，使得智能台灯具备调光，监督使用者的坐姿，节能，时间提醒等功能。有五级自动、手动灯光。ds1302实时时钟模块、HCSR04超声波模块、dht11温湿度模块、HCSR501人体感应模块、光敏电阻模块和无源蜂鸣器模块。
c盘user 文件夹过大
07-14
### 回答1： C盘user文件夹过大可能有以下几个原因： 1. 用户文件过多：用户可能在C盘user文件夹中存储了大量的文件，如文档、图片、音乐、视频等。这些文件会占用大量的存储空间，导致文件夹变得过大。 2. 软件安装目录：一些软件默认安装在C盘，而且在用户的个人文件夹中会生成一些配置文件或日志文件。随着软件数量的增加和使用时间的延长，这些文件也会增加，从而导致C盘user文件夹的大小增加。 3. 缓存文件：许多应用程序会在C盘user文件夹中存储临时文件、缓存文件等，以方便下次快速访问。这些文件在长时间的使用过程中会逐渐增加，从而增加了C盘user文件夹的大小。 为了解决C盘user文件夹过大的问题，可以采取以下几种方式： 1. 清理不需要的文件：可以定期删除C盘user文件夹中不再需要的文件，如无用的文档、重复的图片和视频等。可以使用系统自带的磁盘清理工具或第三方工具进行清理。 2. 修改默认安装路径：可以将软件的默认安装路径修改为其他磁盘，避免过多的软件文件存储在C盘user文件夹中。 3. 清理缓存文件：可以定期清理应用程序生成的临时文件、缓存文件等，可以通过应用程序的设置界面或者通过第三方工具进行清理。 4. 增加存储空间：如果C盘user文件夹确实需要大量的存储空间，可以考虑在电脑上增加额外的硬盘或固态硬盘，将一部分文件迁移到其他磁盘上，从而减小C盘user文件夹的大小。 ### 回答2： C盘中的User文件夹过大可能是由于以下几个原因造成的： 首先，User文件夹是系统默认存储用户文件和设置的位置，包括用户文档、下载、图片、音乐等等。如果用户在C盘中保存了大量的个人文件，该文件夹的大小就会逐渐增大。 其次，Windows系统会自动创建用户配置文件，这些文件用于保存用户的个人设置和应用程序配置信息。这些配置文件会占用一定的存储空间，随着时间的流逝，这些文件可能会逐渐增大。 另外，某些应用程序也会将一些缓存文件、日志文件等保存在User文件夹中，这些文件也会占用一定的空间。 要解决C盘User文件夹过大的问题，可以采取以下几种方法： 首先，可以清理User文件夹中的不必要文件。可以检查用户文档、下载、图片等文件夹，删除不再需要的文件。另外，可以清理临时文件夹和回收站中的文件，释放存储空间。 其次，可以调整一些应用程序的设置，将其缓存文件和日志文件保存到其他分区或者外部存储设备中，以减少User文件夹的大小。 此外，还可以将一些大型文件如视频、音乐等移到其他分区或者外部存储设备中，以减轻C盘负担。 最后，定期进行磁盘清理和优化。使用Windows自带的磁盘清理工具，可以删除系统临时文件、下载缓存等。此外，还可以使用优化软件对C盘进行整理和优化，释放更多的存储空间。 总之，通过清理不必要文件、调整应用程序设置和定期进行磁盘清理，可以有效减小C盘User文件夹的大小，提升系统的性能和稳定性。 ### 回答3： C盘User文件夹过大可能是由于以下原因所致： 1. 缓存文件：用户在使用计算机时，许多应用程序会自动创建缓存文件，用于存储临时数据和待处理的文件。这些缓存文件可能会占用大量的存储空间，并且在长时间的使用后可能无法及时清理。 2. 下载文件：用户在下载文件时，这些文件通常会存储在默认下载文件夹中（如User文件夹）。如果用户长时间不清理下载文件夹，其中的文件会不断累积，并且占据大量的存储空间。 3. 用户文件：用户在日常使用计算机时，可能在User文件夹中存储了大量个人文件，如文档、音频、视频等。随着时间的推移，这些文件可能会不断增加，并且占据大量的存储空间。 针对这个问题，我们可以采取以下措施来解决： 1. 清理缓存文件：用户可以定期清理各种应用程序的缓存文件，以释放存储空间。可以在每个应用程序的设置中找到清理缓存的选项，或者使用系统清理工具进行整体清理。 2. 清理下载文件夹：用户可以定期清理下载文件夹中不再需要的文件，特别是那些已经成功下载并使用过的文件。 3. 整理用户文件：用户可以对User文件夹中的个人文件进行整理和分类。删除不再需要的文件，将文件分类储存在不同的文件夹中，以便后续查找和管理。 4. 移动存储位置：对于特别占用存储空间的文件，可以将它们移动到外部硬盘或其他存储介质中，以释放C盘的空间。 总之，通过定期清理缓存文件、下载文件夹和整理用户文件，以及将一些大文件移动到其他存储介质中，可以解决C盘User文件夹过大的问题，释放更多的存储空间用于其他用途。

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