[ARM异常]-ARMV8的异步异常(中断)详细介绍

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分类专栏： ARM 文章标签： arm 嵌入式硬件
于 2020-10-26 14:35:39 首次发布
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1、VBAR寄存器的介绍

VBAR(Vector Base Address Register)的寄存器有：

  • 如果是aarch64：
    VBAR_EL1
    VBAR_EL2
    VBAR_EL3

  • 如果是aarch32
    VBAR
    HVBAR
    MVBAR

在开启MMU的系统，VBAR中写入的是虚拟地址，以VBAR_EL1为例，介绍下field的使用:
在这里插入图片描述

Bits [10:0] reserved

Bits [11:63]：
如果不支持ARMv8.2-LVA(Large VA support:使用64kb页面时，有效虚拟地址达到52bit)
(1)、如果支持tagged addresses， bits [55:48]必需都是一样的
(2)、如果不支持tagged addresses ， bits [63:48] 必需都是一样的
如果支持ARMv8.2-LVA(Large VA support:使用64kb页面时，有效虚拟地址达到52bit)
(1)、如果支持tagged addresses ， bits [55:52] 必需都是一样的
(2)、如果不支持tagged addresses ， bits [63:52] 必需都是一样的

该寄存器的低11bit是reserve的，11～63表示了Vector Base Address，因此这里的异常向量表基地址是2K对齐的

2、ARMV8-aarch64的异常向量表

armv8-aarch64定义的异常向量表如下图所示
在这里插入图片描述在这里插入图片描述

3、ARMV8 中断的routing

在这里插入图片描述

4、ARMV8 中断的Mask

在这里插入图片描述

5、中断的一个routing示例介绍

在这里插入图片描述

TEE OS中断篇（三）：中断的向量表
叫好与叫座虽然不是对立面，但想在同一个作品中达到双重效果很难。
10-04 1155
REE侧、TEE侧以及Monitor模式或EL3都可接收中断信号。在系统中存在两个VBAR寄存器和一个MVBAR寄存器，REE侧的VBAR寄存器中存放的是Linux内核的异常向量表基地址，OP-TEE中的VBAR寄存器存放的是OP-TEE系统的中断向量表基地址，而Monitor或者EL3的MVBAR存放的是Monitor模式或EL3运行时的中断向量表基地址，即在Monitor或者EL3阶段是可以接收外部中断信号的。本节将介绍OP-TEE中断的配置和Monitor或EL3阶段中断的配置。
40-armv8/armv9中断系列详解-中断示例展示(不含虚拟化部分)
baron-周贺贺-代码改变世界ctw
04-21 1224
armv8, armv9, gic,gicv2,gicv3,异常, 中断，irq,fiq,serror,sync，同步异常，异步异常，向量表，向量表基地址，VBAR，vbar_el3，中断嵌套，中断级联，Linux Kernel，optee,ATF,TF-A,optee,hypervisor, SPM
ARMv8 Linux内核异常处理分析
05-30
看了 Linaro 提供的开源 ARMv8 Linux 内核源码，发现 ARMv8 异常处理与 ARMv7 及之前的架构有所不同，详细分析之
ARM V8 GIC中断模块
最新发布
weixin_42438100的博客
12-06 995
ARM V8 GIC模块介绍。
minos 2.1 中断虚拟化——ARMv8 异常处理
weixin_46645613的博客
06-03 1265
Rand_cs该项目来自乐敏大佬：https://github.com/minosproject/minos越往后，交叉的越多，大多都绕不开 ARMv8 的异常处理，所以必须得先了解了解 ARMv8 的异常处理流程先说一下术语，从手册中的用词来看，在 x86 平台，一般将异常和中断统称为中断，在 ARM 平台，一般将中断和异常统称为异常异常的流程，可以分为 3 个阶段，“设备”产生异常信号，中断控制器过滤转发异常，OS 处理异常。
Arm v8 中断处理
firefox_1980的专栏
10-15 5467
ARM v8的工作模式 ARM v8支持的工作状态， EL0（用户态），EL1（内核态），EL2（虚拟机/可选），EL3（监控态 Monitor/可选）。每一个工作状态，有不同的访问权限。CPU运行在ELx，中断类型有同步的和异步的。同步中段有1种，syn；异步中断有3种，irq、fiq、err. 外部中断通过irq告知CPU。 ARM v8的中断处理 基于ARM的SoC大都采用GI
3. ARMv8 中断及异常处理（包括系统调用，系统调用即同步异常）
bantouxiaoxue的博客
08-20 4054
ARMv8 64bits相对于之前的 32bits 有较大变动，所有中断及异常的处理总入口都在entry.S 源文件中。 1.1.       异常介绍（中断即称为 异步异常） 分为同步和异步 两种类型异常，中断划入异步异常类型： Synchronous(同步异常) 异常类型 描述 Undefined Instruction
linux arm 定时器 irq,uboot下开启ARMv8的定时器中断
weixin_26757925的博客
05-13 1954
在工作需求，需要在uboot下实现一个定时器来完成一些业务，使用的是Cortex A53 CPU(基于ARM v8-A架构)，因此对ARMv8-A的定时器以及中断作了一些研究，这篇文章主要描述如在uboot下开启ARM v8的定时器中断。文章内容会涉及到GIC及ARM v8-A(后面简写成ARMv8)架构相关知识，可查看下面2篇文章、ARM v8架构注：本文中所使用和参考的uboot版本：U-Bo...
armv8/armv9中断系列详解-软件篇-Linux kernel中断相关软件导读
baron-周贺贺-代码改变世界ctw
04-21 1576
armv8, armv9, gic,gicv2,gicv3,异常, 中断，irq,fiq,serror,sync，同步异常，异步异常，向量表，向量表基地址，VBAR，vbar_el3，中断嵌套，中断级联，Linux Kernel，optee,ATF,TF-A,optee,hypervisor, SPM
【ARMv7-A】——异常与中断
tyustli
06-29 1746
最常见的异步异常是外部中断，外部中断的发生是由外围设备驱动的，一方面外部中断的发生带有偶然性，另一方面中断请求到达处理器之时，处理器的程序指令流执行到具体的哪一条指令带有偶然性。指响应异常后的处理器状态无法精确反映为某一条指令的边界，即可能是某一条指令执行了一半然后被打断的结果，或者是其他模糊的状态。可能存在多个中断源同时向处理器发起请求的情形，因此需要对这些中断源进行仲裁，从而选择哪个中断源被优先处理，这种情况称为中断仲裁，可以给不同的中断分配优先级以便于仲裁，因此中断存在中断优先级的概念。
50-armv8/armv9中断系列详解-中断示例展示(虚拟化部分)
baron-周贺贺-代码改变世界ctw
04-21 1024
armv8, armv9, gic,gicv2,gicv3,异常, 中断，irq,fiq,serror,sync，同步异常，异步异常，向量表，向量表基地址，VBAR，vbar_el3，中断嵌套，中断级联，Linux Kernel，optee,ATF,TF-A,optee,hypervisor, SPM
Armv8/Armv9异常中断深度学习系列
04-12
本系列文章旨在深入探讨Armv8/Armv9架构下的异常中断机制，涵盖了中断的定义、FIQ和IRQ、GIC中断控制器、核心中的中断控制器接口、同步异常和异步异常、软件对中断的处理流程、中断向量表、Exception Entry和...
ARMv8-AArch64 的异常处理模型详解之异常处理详解（同步异常和异步异常的分析和处理）
DayDayUp
02-26 3981
同步异常发生时，会将产生同步异常的那条指令的地址写入ELR，所以如果想知道是哪条指令导致异常的产生，软件在处理异常时可以读取ELR中的值进行分析。ESR寄存器里保存着一些异常的诊断信息，比如异常产生的原因。在进入异常后，我们可以读取对应异常等级的ESR（ESR_EL1,ESR_EL2或者ESR_EL3），通过解析各个字段的数值所表示的含义，来分析出当前异常产生的原因。FAR寄存器将为一些同步异常保存导致异常发生的地址
ARMv8-AArch64 的异常处理模型详解之异常等级、执行状态以及安全状态
DayDayUp
01-07 6296
AArch64使用 EL 来命名异常等级，EL3权限最高，EL0权限最低。如下图所示，为一种通用的异常等级模型： - 用户应用程序执行在EL0。 - 操作系统，比如Linux执行在EL1. - Hypervisor， 比如虚拟机程序，执行在EL2 - 固件或者安全网关相关代码，执行在EL3. 比如，在EL1的Linux可以使用软件接口标准在EL3上调用固件函数。这个模型意味着大部分的PE处理通常发生在EL0/1处。
[ARM异常]-ARMV8-aarch64异常和中断处理概念详细介绍
baron-周贺贺-代码改变世界ctw
10-12 5217
文章目录1、异常和中断的概念2、异常产生的方法：(1)、Abort ：(2)、Reset(3)、同步异常(4)、异步异常（中断） 1、异常和中断的概念 (AArch64 Exception and Interrupt Handling) 异常是指需要特权软件(an exception handler))采取某些操作,以确保系统的平稳运行 中断有时用作异常的同义词。但是对于ARM的术语来说，中断是异步异常，只是异常的一种; 异常是一个事件(而不是分支或跳转指令)导致指令的正常顺序执行被修改。 一个中断是一个异
[ARM异常]-armv8/armv9异步异常类型、路由、屏蔽
baron-周贺贺-代码改变世界ctw
12-04 1713
IRQ,FIQ,Serror, 中断，同步异常，异步异常，TF-A,TF-M,ATF,TrustedFirmware,trustzone,TEE,optee,trusty,tlk,lk,armv8,armv9,arm,secureboot,BL31,BL32,BL1,BL2,hypervisor,终端安全,secureboot,security,virtulization
ARMv8 AArch64异常处理机制概览
太白断水客
01-28 1949
相对于ARMv7中的异常向量表（Exception Vector Table），ARMv8异常处理机制更为复杂，涉及处理器的异常等级（Exception Levels, ELn）、运行状态（Execution States）和安全模式（Secure Mode）。
ARMv8 异常处理之中断向量表
suyanqiangqq的博客
03-13 1380
ARMv8 异常处理之中断向量表
ARMv8/GICv3中断路由
Hacker
03-23 4950
文章目录ARMv8 IRQ/FIQ/SError路由流程图中断分组中断路由实例GICD_CTLR.DS=1, 假设中断A配置成Group 0，即中断A为FIQGICD_CTLR.DS=1, 假设中断A配置成Group 1，即中断A为IRQGICD_CTRL.DS=0, 假设中断A配置成`Non-secure Group 1`GICD_CTRL.DS=0, 假设中断A配置成`Secure Group 1`GICD_CTRL.DS=0, 假设中断A配置成`Group 0` ARMv8 IRQ/FIQ/SEr.
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