verilog
空
贝贝今天AC了吗
这个作者很懒,什么都没留下…
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Verilog HDL 快速入门4:always进程、条件、判断、循环语句,函数、任务模块
目录一、两种 always 进程二、if-else 语句三、case 语句三、loop 循环语句四、verilog 其他子模块一、两种 always 进程注意:1、敏感列表里的变量变化时才触发 always 块(* 代表全部变量)2、例子中的时序进程中:对上升沿、下降沿敏感二、if-else 语句和 c 语言一模一样哦!三、case 语...原创 2020-04-25 23:16:14 · 2203 阅读 · 0 评论 -
Verilog HDL 快速入门3:块模型与赋值操作
目录一、连续赋值二、过程赋值三、initial 块 & always 块四、阻塞与非阻塞一、连续赋值二、过程赋值三、initial 块 & always 块四、阻塞与非阻塞...原创 2020-04-25 22:59:27 · 276 阅读 · 0 评论 -
Verilog HDL 快速入门2:各类运算符与优先级关系
目录一、算术运算符二、位运算符三、缩减运算符四、关系运算符五、等式运算符六、逻辑运算符七、其他运算符八、运算符优先级一、算术运算符二、位运算符三、缩减运算符四、关系运算符五、等式运算符六、逻辑运算符七、其他运算符八、运算符优先级...原创 2020-04-25 22:47:23 · 568 阅读 · 0 评论 -
Verilog HDL 快速入门1:基本概况、结构和数据类型
目录一、术语和概况简介二、Verilog语法1、程序的基本结构2、模块与端口的声明3、数据类型4、数值表示5、模块例化(调用)一、术语和概况简介RTL的综合与仿真概述:二、Verilog语法1、程序的基本结构module 模块名(端口列表); 端口的声明(包含输入、输出、变量等) 本模块变量、信号的声明 ...原创 2020-04-25 17:21:52 · 971 阅读 · 0 评论