FPGA设计入门-----1位全加器的设计

最新推荐文章于 2023-12-19 19:08:48 发布
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文章目录

一、准备工作

  1. 新建工程
    在这里插入图片描述
    在这里插入图片描述
    选择目标芯片：cycloneIVE系列的EP4CE11529C7
    在这里插入图片描述在这里插入图片描述

  2. 新建原理图文件
    打开QuartusII,选菜单“File”一“New”，在弹出的“New-”对话框中选择“ Design Files” 的原理图文件编辑输入项“Block block diagram/scchematic File"
    在这里插入图片描述
    在这里插入图片描述

  3. 在编辑窗中调入元件，完成半加器的原理图输入
    从“ Symbol”窗中选择需要的

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这里写目录标题一、二、绘制原理图实现1位全加器1. 半加器实现2. 全加器实现三、Verilog实现一位全加器四、硬件测试五、总结参考 一、 二、绘制原理图实现1位全加器 1. 半加器实现 创建工程文件，并勾选所需型号芯片 File->New，进入后选择Block Diagram/Schematic File 选择原件，实现半加器需要 一个and2 一个xor原件，后进行电路连接 保存文件，并通过RTL Viewer查看线路效果图 仿真测试半加器是否正确 新建向量波形文件 添加信号，及所
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