老学弱了
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新星杯·14天创作挑战营·第9期

这是一个以写作博客为目的的创作活动,旨在鼓励大学生博主们挖掘自己的创作潜能,展现自己的写作才华。如果你是一位热爱写作的、想要展现自己创作才华的小伙伴,那么,快来参加吧!我们一起发掘写作的魅力,书写出属于我们的故事。我们诚挚邀请你们参加为期14天的创作挑战赛! 注: 1、参赛者可以进入活动群进行交流、分享创作心得,互相鼓励与支持(开卷),答疑及活动群请见 https://bbs.csdn.net/topics/619626357 2、文章质量分查询:https://www.csdn.net/qc

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ZYNQ----------PS端入门(二)

首先复制上一节的工程,只添加网口(ethernet0或者1)和sd卡0(或者1),编译导出(ExportHardware 包含比特流),选择OK即可。通过tftp传输来自ubuntu的文件,所以要在ubuntu配置相应的环境。
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发布博客 2025.02.28 ·
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ZYNQ----------PS端入门(一)

然后保存,并生成bd,编译并launch到sdk,sdk自动创建一个项目,在此项目新建一个applatcion工程,选helloworld,此helloworld就为串口打印,将PL和PS分别在线烧写到芯片里,打开串口软件就可以看到Hello World的打印了。由此上介绍可知,此例程PL不需要PS的时钟(因为PL有自己的时钟晶振),所以取消掉FCLK_CLKx以及对应的复位信号FCLK_RESETx_N(在PS-PL Configuration选项卡中,并且要选择一路AXI作为传输接口)
原创
发布博客 2025.02.21 ·
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GTX IP核

【代码】GTX IP核。
原创
发布博客 2024.11.27 ·
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FPGA MUTIBOOT(远程固件更新、多重启动)(以K7系列为例)

FPGA多重启动
原创
发布博客 2024.09.18 ·
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搭建Linux服务器(局域网)

在这一步创建共享文件夹(组)(2)创建非root用户。
原创
发布博客 2024.02.01 ·
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ARP协议---笔记

以太网和PHY之间的常用接口。
原创
发布博客 2023.12.06 ·
166 阅读 ·
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ZYNQ7000的GMII_to_RGMII IP核

【代码】ZYNQ7000的GMII_to_RGMII IP核。
原创
发布博客 2023.12.06 ·
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SDI_IP核信号解释(从官方文档理解)

【代码】SDI_IP核信号解释(从官方文档理解)
原创
发布博客 2023.07.25 ·
295 阅读 ·
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vivado compile simulation libraries时 错误[Vivado 12-3754]

情况:之前按照联合仿真教程走过一遍,这次想单独仿真。错误原因:没有删除modesim环境变量。
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发布博客 2023.07.12 ·
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FPGA---Aurora

话不多说,直接放程序(初学者,我就不放过fifo的了,这个不过fifo的程序接收数据的时候跳了一下,别直接用哦,好好研究一下吧。另外界面就不放了,那俩保持默认,或者你想初学时想要时钟少一点就看看第三个界面的设置吧,我懒得搞了。
原创
发布博客 2023.07.11 ·
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zynq-uart

之前在使用stm32的时候串口接收/发送的数据都是一串数据(1D2QABF…),所以zynq为了保持与ram板的这种形式,其接收和发送的数据也是一串的,但由于verilog的特殊性,在程序内最好是二进制按位的,所以接收和发送的数据都要进行特殊的处理。
原创
发布博客 2023.04.02 ·
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zynq-呼吸灯(仿真)

【代码】zynq-呼吸灯(仿真)
原创
发布博客 2023.03.27 ·
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zynq实战篇3-key_beep

按键防抖:检测到按键信号稳定后,再过20ms。
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发布博客 2023.03.26 ·
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zynq实战篇2-led_key

【代码】zynq实战篇2-led_key。
原创
发布博客 2023.03.25 ·
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zynq实战篇1-led_twinkle

【代码】zynq实战篇1-led_twinkle。
原创
发布博客 2023.03.25 ·
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Verilog-语法篇4-状态机(正点原子笔记)

//////////////////////////////////////////////////////////////////////////////////////// 独热码写法(每个状态对应一个寄存器),状态机推荐 //denfine state space parameter SLEEP = 2 'b1000;
原创
发布博客 2023.03.24 ·
711 阅读 ·
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Verilog-语法篇3(正点原子笔记)

【代码】Verilog-语法篇3(正点原子笔记)
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发布博客 2023.03.22 ·
176 阅读 ·
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Verilog语法篇2-程序框架(正点原子笔记)

Verilog的基本设计单元是“模块”(block)模块=描述接口+描述逻辑功能。
原创
发布博客 2023.03.22 ·
229 阅读 ·
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Verilog-语法篇1(正点原子笔记)

【代码】Verilog-语法篇1(正点原子笔记)
原创
发布博客 2023.03.22 ·
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Ubuntu训练tflite模型

1. 安装Anaconada **1.1 查看电脑内核(终端输入)**uname -m#返回x86_64#比如我的电脑是x86_64的,就在清华源镜像网站下载所需要的文件#镜像网址:https://mirrors.tuna.tsinghua.edu.cn/anaconda/archive不建议下载最新版(最新版可能会有bug)。################################################################下载后进入文件夹,解压文件
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发布博客 2022.01.08 ·
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