Xilinx AXI Crossbar相关调试记录

xielk_ustc

于 2020-12-17 21:41:45 发布

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Xilinx AXI Crossbar相关调试记录

本文记录在使用Xilinx AXI Crossbar IPcore现象

** AXI Crossbar IPcore设置如下**

使用AXI Crossbar 作为XDMA的AXILite接口的转接模块，调用了11个Master interfece。
在这里插入图片描述
但是在对相应AXILite地址进行读写寄存器时，发现M10_AXI对应地址无法读写，
读出数据为0xdec0de1c。

特此记录，原因有待后续查明。

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