计算机组成部分摘要

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于 2024-08-22 20:52:27 发布

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分类专栏：软考——软件设计师知识点重点摘要文章标签：其他笔记

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文章目录

前言
一、中央处理器（CPU）
二、存储系统
三、输入输出系统（I/O）
- 3.1数据传输控制方式
- 3.2中断处理过程
四、总线系统
总结

前言

在计算机科学的基础理论中，计算机组成原理占据着举足轻重的地位。它是连接硬件与软件的桥梁，深入探讨了计算机内部各部件的构造、功能以及它们之间的相互作用。一下是部分计算机与体系结构的部分摘要：

一、中央处理器（CPU）

CPU主要是由运算器、控制器、寄存器组、内部总线等部件组成。其中最重要的是运算器和控制器。
运算器：

算数逻辑单元ALU：实现数据的算数运算和逻辑运算。
累加寄存器AC：通用寄存器，为ALU提供一个工作区，用于暂存数据。
数据缓冲寄存器DR：写内存时，暂存指令或数据。
状态条件寄存器PSW：存状态标志与控制标志。

控制器：

程序计数器PC：储存下一条要执行的指令。
指令寄存器IR：存储即将执行的指令。
指令译码器ID：对指令中的操作码字段进行分析解释。
地址寄存器AR保存当前CPU访问内存单元的地址。
时序部件：提供时序控制信号。

二、存储系统

2.1 存储系统的结构层次

存储系统结构类似金字塔，从上到下分别是CPU、Cache、内存、外存。
为何是类似金字塔结构？
是由局部性原理支撑：

空间局部性：如果某个数据项被访问，那么与其相邻的数据项在不久的将来也很可能被访问。
时间局部性：如果某个数据项被访问，那么在不久的将来它很可能再次被访问。

存储器按不同方式有不同分类

按存储器位置：内存/外存
按存取方式：内容存取（相联存储器）/ 地址存取（随机存取存储器、顺序存取存储器、直接存取存储器）
按工作方式：随机存取存储器/只读存储器

2.2 Cache

概念
Cache（缓存）在计算机科学中是一个广泛使用的概念，它指的是一种高速数据存储层，位于处理器（CPU）和较慢的数据存储层（如主存储器RAM或磁盘）之间。在计算机的存储体系中，Cache是访问速度最快的层次。Cache的目的是减少对较慢存储层的访问次数，从而加速数据检索和程序执行的速度。
地址相联映像

全相联映像方式
特点：主存中的任何一个块都可以被映射到Cache中的任何一个块位置上。即主存块可以放在Cache的任意位置。
优点：
主存的块调入Cache中的位置不受限制，冲突率最低。
空间利用率高。
缺点：
无法从主存地址中直接获得Cache的块号，地址变换复杂，速度较慢。
需要较大的相联存储器来存放从主存地址到Cache地址的映射表。
直接映像方式
特点：每个主存块只能映射到Cache中的一个特定位置。通常通过主存块号对Cache总块数取模来确定Cache块号。
优点：
地址变换简单，访问速度快。
硬件实现简单。
缺点：
冲突率高，特别是当Cache块数较少时。
Cache的空间利用率不高，容易出现大量空闲块。
组相联映像方式
特点：是前两种方式的折衷。主存和Cache都被分为若干组，组间采用直接映像方式，组内采用全相联映像方式。
优点：
块的冲突概率比较低。
块的利用率大幅度提高。
块失效率明显降低。
缺点：
实现难度和造价要比直接映像方式高。
需要额外的逻辑来管理组和块之间的映射关系。

2.3 主存编址

主存是由一系列存储单元组成的，每个存储单元都有唯一的地址码，这些地址码用于标识和访问特定的存储单元。主存编址就是对这些存储单元进行编号的过程，通过编址，存储器在逻辑上形成一个线性地址空间，使得CPU可以方便地存取数据。
主存编址的计算：
总容量=存储单元个数*编址内容
总容量=单元芯片容量*总片数
存储单元个数=最大地址-最小地址+1

三、输入输出系统（I/O）

3.1数据传输控制方式

程序I/O方式（程序直接控制方式）
由于CPU的高速性和I/O设备的低速性，CPU的绝大部分时间都处于等待I/O设备完成数据I/O的循环测试中，造成CPU资源的极大浪费。
中断控制方式（中断驱动I/O控制方式）
CPU与I/O设备并行工作，提高了系统资源利用率和吞吐量。但每次传输一个数据即产生中断，对于块设备而言效率较低。
DMA控制方式（直接存储器访问I/O控制方式）
数据传输的基本单位是数据块，数据传输速度快，CPU和I/O设备可以并行工作。但数据传送方向只能是单向的，且每台设备都需要一个DMA控制器，设备增加时成本较高。