cortex学习笔记——寄存器组

最新推荐文章于 2024-09-03 10:45:35 发布
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分类专栏： Cortex-M3权威指南 文章标签： 学习
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cortex-M3处理器拥有R0-R15的寄存器组。其中R13作为堆栈指针SP。SP有两个，但在同一时刻只能有一个可以看到，这也就是所谓的“banked”寄存器。

R0-R12：通用寄存器

 R0-R12都是32位通用寄存器，用于数据操作。但是注意：绝大多数16位Thumb指令只能访问R0-R7，而32位Thumb-2指令可以访问所有寄存器。

Blanked R13：两个堆栈指针

cortex-m3拥有两个堆栈指针，然而它们是banked，因此任一时刻只能使用其中的一个。

（1）主堆栈指针（MSP）：复位后缺省使用的堆栈指针，用于操作系统内核以及异常处理例程（包括中断服务例程）

（2）进程堆栈指针（PSP）：用用户的应用程序代码使用。

堆栈指针的最低两位永远是0，这意味着堆栈总是4字节对齐的。

R14：连接寄存器

当呼叫一个子程序时，由R14存储返回地址

R15：程序计数寄存器

指向当前的程序地址。如果修改它的值，就能改变程序的执行流（很多高级技巧就在这里面）

特殊功能寄存器

cortex-m3还在内核水平上搭载了若干特殊功能寄存器，包括

程序状态字节寄存器组（PSRs）

中断屏蔽寄存器组（PRIMASK,FAUL TMASK,BSAEPRI）

控制寄存器（CONTROL）

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     在8086的EU和BIU两部分中包含有一些工作寄存器，这些寄存器用来存放计算过程中的各种信息，如操作数地址、操作数及运算的中间结果等。微处理器从寄存器中存取数据比从存储器中存取数据要快的多，因此，在计算过程中，合理利用寄存器保存操作数、中间结果或其它信息，能提高程序的运行效率。根据这些寄存器所起的作用，8086寄存器组可以分为通用寄存器、专用寄存器和段寄存器三类，如图2.3所示。下面分别...
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第2章 CPU资源和存储器<br />计算机的硬件资源是用汇编语言编程所必须要了解的重要内容，因为汇编语言允许、也需要程序员直接使用这些硬件资源，只有这样才能编写出高效的目标代码。<br />在汇编语言中，需要访问的硬件资源主要有：CPU内部资源、存储器和I/O端口。本章将着重讲解CPU内部寄存器的命名、功能及其常见的用途，还要介绍存储器的分段管理模式、存储单元地址的表示法以及其物理地址的形成方式。2.1 寄存器组<br />寄存器是CPU内部重要的数据存储资源，是汇编程序员能直接使用的硬件资源之一。由于寄
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程序计数器是存放指令地址的寄存器，其作用是：当程序顺序执行时，每取出一条指令，程序计数器（PC）内容自动增加一个值，指向下一条要取的指令。在CPU中增加寄存器的数量，可以使CPU把执行程序时所需的数据尽可能地放在寄存器中，从而减少访问内存的次数，提高其运行速度。但是，寄存器的数目也不能太多，除了增加成本外，寄存器地址编码增加还会增加指令的长度。CPU中的寄存器通常分为存放数据的寄存器、存放地址的寄存器、存放控制信息的寄存器、存放状态信息的寄存器和其他寄存器等类型。
【ARM学习笔记】cortex-m3与cortex-m4中的寄存器
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学习cortex-m3和m4系列芯片的寄存器，看这篇文章就够了。提示：以下是本篇文章正文内容，下面案例可供参考希望通过这篇文章可以对cortex-m3和m4内部寄存器有深入的理解。参考书籍：《ARM Cortex-M3与Cortex-M4权威指南》
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S5PV210(TQ210)学习笔记——内存配置（DDR2） S5PV210是三星电子生产的一款基于ARM Cortex-A8内核的处理器，主要应用于智能电子设备等领域。TQ210开发板则是搭载S5PV210处理器的一款开发平台。本文重点介绍的是关于...
深入浅出Cortex-M3——LPC178x.177上下册.zip
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《深入浅出Cortex-M3——LPC178x.177上下册》是一部由周工编著的专业书籍，旨在深入解析ARM Cortex-M3处理器及其在LPC178x/177x系列微控制器中的应用。Cortex-M3是ARM公司设计的一种高效能、低功耗的32位微控制器...
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学习笔记——ARM Cortex-M0 异常与中断
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异常类型及编号 异常优先级 向量表 EXC_TURN值 异常流程 3种主要的异常及其机制
设计一个通用寄存器组，16位的寄存器。（含报告）
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设计一个通用寄存器组，满足以下要求： ①通用寄存器组中有4个16位的寄存器。 ②当复位信号reset=0时，将通用寄存器组中的4个寄存器清零。 ③通用寄存器组中有1个写入端口，当DRWr=1时，在时钟clk的上升沿将数据总线上的数据写入DR[1..0]指定的寄存器。 ④通用寄存器组中有两个读出端口，由控制信IDC控制，分别对应算术逻辑单元的A口和B口。IDC=0选择目的操作数；IDC=1选择源操作数。 ⑤设计要求层次设计。底层的设计实体有3个：通用寄存器组数据输入模块包括4个16位寄存器，具有复位功能和允许写功能；一个4选1多路开关，负责选择寄存器的读出。一个2路数据分配器实现数据双端口输出，顶层设计构成一个完整的通用寄存器组。
Cortex-A内核寄存器
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Cortex-A7 有 9 种运行模式，每一种运行模式都有一组与之对应的寄存器组。每一种模式可见的寄存器包括 15 个通用寄存器(R0~R14)、一两个程序状态寄存器和一个程序计数器 PC。在这些寄存器中，有些是所有模式所共用的同一个物理寄存器，有一些是各模式自己所独立拥有的，各个模式所拥有的寄存器如表 6.3.2 所示： ...
第二章 寄存器组
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通用寄存器： AX 累加器，算术运算主要寄存器 BX 基址寄存器 CX 计数器 DX 数据寄存器 SP 堆栈指针寄存器，指示段顶的偏移地址 BP 基址指针寄存器，堆栈区中的一个基地址 SI 源变址寄存器 DI 目的变址寄存器 BP和SS联用来确定堆栈中某一地址，SI,DI和DS联用来确定数据段某一单元的地址 专用寄存器： IP 指令指针寄存器 FLAGS 标志位寄存器（OF，CF，SF，ZF...
寄存器组和寄存器（存储器）阵列
c99LYF的博客
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1.实验目的： 寄存器组和寄存器（存储器）阵列 2.实验内容： 3.实验原理：按照书上的内容，书写和运行代码，完成仿真操作 实验代码： 设计模块 module Register_File#(parameter word_size=32,addr_size=5) (output [word_size-1:0] Data_Out_1,Date_Out_Out_2, input [word_size-1:0] Data_in, input [addr_size-1:0] Read_
二硬件篇-寄存器组
qq_45580176的博客
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CM3 拥有通用寄存器 R0‐R15 以及一些特殊功能寄存器。R0‐R12 是最“通用目的”的，但是绝大多数的 16 位指令只能使用 R0‐R7（低组寄存器），而 32 位的 Thumb‐2指令则可以访问所有通用寄存器。特殊功能寄存器有预定义的功能，而且必须通过专用的指令来访问。
寄存器组基础知识
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    学习汇编的时候，对寄存器组不是很了解，所以上网找了一些资料，转贴一份： 16位寄存器组16位CPU所含有的寄存器有(见图2.1中16位寄存器部分)：4个数据寄存器(AX、BX、CX和DX)2个变址和指针寄存器(SI和DI)2个指针寄存器(SP和BP)4个段寄存器(ES、CS、SS和DS)1个指令指针寄存器(IP)1个标志寄
微机原理学习笔记（2）：8086结构 EU
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功能：负责指令执行 4个通用寄存器：AX、BX、CX、DX 各可以分为上下半个 用来暂存计算过程中所用到的操作数、结果、其他信息 可以用16位的访问，也可以用字节（8位）访问 AX (Accumulater)累加器 所有IO指令都使用AX与外部设备交换数据 BX(Base)基址寄存器 在计算内存储器地址时，经常用来存放基址 CX(Count)计数寄存器 在循环LOOP指令和串处理指令中作隐含计数器 DX(Data)数据寄存器 一般在双字长乘除法运算时，把DX和AX组合在一起存放一个双字长的数(32位)，.
组理学习笔记之寄存器
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组理学习笔记之寄存器 存储器的基本： 基本操作 读写 数据存放 为读出和写入的数据设置"数据缓冲寄存器"MDR 操作控制 读、写 控制线路（R/W控制） 基本结构 存储体（由存储单元构成） 地址寄存器 地址译码器 数据缓冲寄存器 读写控制线路 存储介质分类 存储介质存取方式存储作用半导体存储（ROM，RAM）随机存取主存储器磁性存储器串行存取辅助存储器光存储器 告诉缓冲存储
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