QT ubuntu安装和demo

于 2020-10-31 11:37:00 发布
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分类专栏： linux 文章标签： qt
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在地址：

http://download.qt.io/official_releases/qt/

里面选一个版本就可以，这里选的/5.9/5.9.2/q
下载完村房子啊Download 下
#安装
赋予执行权限

chmod +x qt-opensource-linux-x64-5.9.2.run

执行安装

./qt-opensource-linux-x64-5.9.2.run

弹出的对话框一路next,遇到申请装好就申请账号。
安装完的样子
在这里插入图片描述

demo

New Project-> Application ->Qt wieget Application
在这里插入图片描述
修改程序：
给mainwindow 加一个tital
在这里插入图片描述

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ubuntu升级后无法双屏
04-13 409
ubuntu 升级后无法双屏显示，只有一个屏能够显示，display 也只能看到一个屏。原因是升级后没有安装启动lib。
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解决 svn: Can‘t read stdin:End of file found
01-02 417
jenkins 使用svn 的hook 去触发自动构建的过程中发现报错。报错是通过svn checkout 工程过程中带账号密码的行为出现的。发现是cache 问题，修改命令解决。
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modelsim安装使用
01-01 1008
ModelSim 是三大仿真器公司之一mentor的产品，他可以模拟行为、RTL 和门级代码 - 通过独立于平台的编译提高设计质量和调试效率。单内核模拟器技术可在一种设计中透明地混合 VHDL 和 Verilog，常用在fpga 的仿真中。##下载软件网上找到的资源一般是包含两个文件：一个安装文件，一个注册机点击exe 进行安装，一路都是点击同意，最后有可能重启，是因为没有license。然后进行注册：拷贝四个文件到安装目录中的win64中。
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gitlab 通过svn hook 触发
12-17 591
jenkins 起一个item配置：我选的自由风格的源码管理配置先选subversion 就是svn类型url 设置project 的路径， 注意是工程，不是svn 顶层添加一个账户来进行pull 等操作选择添加的账号构建触发器：，重要的是要自己随便设置一个身份验证的令牌，这个令牌是给svn 触发jenkins 来构建的令牌，svn 发过来请求如果令牌错了也不会有构建操作的svn 的配置：svn 支持的钩子：拷贝生成一个commit 之后触发的钩子：手动执行命令：jenkins 端就
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svn 安装
12-17 402
1、先创建svn根目录文件夹。修改svnd.sh文件的权限。2、创建项目的目录文件夹。通过命令查看是否启动成功。修改passwd 文件。设置开机自启动SVN。
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gitlab 安装
12-17 566
重启gitlab 服务，加入开机启动项。修改成自己的ip 地址和端口号。要选ubuntu focal。默认账号名是root。
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jenkins安装
12-17 132
【代码】jenkins安装。
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rtl仿真器-vcs安装和测试（一）
05-30 292
准备## 下载文件解压sysynopsys installer：synopsys软件安装工具，通过该软件安装VCS和Verdivcs_mx_vO-2018.09-SP2：VCS Verilog+VHDL 混合仿真软件vcs_vO-2018.09-SP2：VCS Verilog仿真软件verdi-2018.9：Verdi软件。
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rtl仿真器-incisive安装和测试
05-21 990
incisive : http://pan.baidu.com/s/1dFC9KZn 提取码 k3cbpath:license:IScape: 安装的图形界面IScape下载链接: https://pan.baidu.com/s/1FvpOto5fAIRjQARcbMbjZQ密码: k1cb。
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epicsim 是芯华章的仿真器，基于iverilog 据说速度快两倍。
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rtl仿真器-ghdl安装和测试
05-15 847
【代码】rtl仿真器-ghdl安装和测试。
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rtl仿真器-iverilog icarus安装和测试
05-15 838
Icarus Verilog是一个轻量、免费、开源的Verilog编译器，基于C++实现，开发者是 Stephen Williams ，遵循 GNU GPL license 许可证，安装文件中已经包含 GTKWave支持Verilog/VHDL文件的编译和仿真，命令行操作方式，类似gcc编译器，通过testbench文件可以生成对应的仿真波形数据文件，通过自带的GTKWave可以查看仿真波形图，支持将Verilog转换为VHDL文件。
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rtl仿真器-verilator安装和测试
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