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原创 时间约束几个名词解释

Clock skew:     假设两个触发器串行连接,vClock skew是时钟信号到达两个触发器的时间差。Clock latency:    时钟信号从源端到端触发器输入端的总时间。Clock uncertainity:    时钟抖动-is the jitter whitch is generated by the oscillator。Setup slack:

2009-12-24 08:45:00 3035 1

《OP放大电路设计》pdf版

模拟电路最经典的运算放大器设计教程之一,冈村迪夫著。

2009-06-30

空空如也

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