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原创 Verilog快速入门
头歌,Verilog快速入门,数字电路,verilog描述电路模块,第2关:Verilog电路模块的端口描述,第3关:电路功能描述—门级原始结构,第4关:电路功能描述—行为定义—连续赋值第5关:电路功能描述—行为定义—过程语句
2024-10-05 10:44:27 133
原创 运算器设计(HUST)
运算器设计,计算机组成原理头歌实训平台,第二关:CLA182四位先行进位电路设计。第七关:6位有符号补码阵列乘法器设计。第六关:5位无符号阵列乘法器设计。第一关:8位可控加减法电路设计。第四关:16位快速加法器设计。第五关:32位快速加法器设计。第十一关:MIPS运算器设计。第三关:4位快速加法器设计。第九关:原码一位乘法器设计。第十关:补码一位乘法器设计。第八关:乘法流水线设计。
2024-09-23 16:55:18 281
原创 计算机数据数据表示实验
文件下载之后用记事本打开直接复制粘贴,九关通用直接点测评,第8关:16位CRC并行编解码电路设计。第1关:汉字国标码转区位码实验。第5关:16位海明编码电路设计。第6关:16位海明解码电路设计。第9关:CRC编码流水传输实验。第7关:海明编码流水传输实验。第2关:汉字机内码获取实验。第4关:偶校验解码电路设计。第3关:偶校验编码设计。计算机组成原理头歌实训
2024-09-23 15:46:29 317
原创 数据库教学案例一:数据库和数据表的建立、修改和删除
第一关:建立数据库第二关:建立学生数据表第三关:建立课程数据表第四关:建立成绩数据表第五关:修改数据表名字第六关:在数据表中添加字段第七关:修改数据表中的字段名称第八关:修改数据表中的字段类型第九关:修改数据表中的字段第十关:删除数据表第十一关:删除数据库
2024-09-23 15:14:19 193
组装一台台式电脑,预算5000左右的实验报告
2024-09-23
空空如也
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