字节面试问到CPU的多级缓存架构，诸佬们怎么回答？_面试 cpu的缓存机制(1)

前言：大家好，我是小威，24届毕业生，上周在面试字节中，问到了一个关于CPU多级缓存架构的问题，当时答得并不是很好，之后查阅了资料，对此进行了复盘总结。
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以下正文开始

计算机由很多部分组成，每个部分的性能和访问数据的速度也是有差别的。比如在计算机中，CPU的执行速度大于内存的执行速度和磁盘等IO设备的执行速度，内存的执行速度快于磁盘等IO设备的执行速度。

为了缩小CPU，内存，磁盘等IO设备访问数据速度的差距，CPU增加了缓存。目前很多CPU内部不仅有寄存器来存储数据，还有L1，L2，L3三级缓存。有了这些缓存的部件，CPU访问数据的效率得到了提升。下面对CPU的三级缓存进行简单介绍：

L1缓存是最接近CPU的，L1缓存每个核上有两个缓存，一个用于存储数据（Data Cache），一个用于存储指令（Instruction Cache）。L1缓存的存储速度最快，但是存储容量最小。

L2缓存的存储容量比L1缓存的存储容量大，存储速度比L1小。L2缓存的容量会影响到CPU的性能，因此一般L2的缓存会比较大，L2缓存是由CPU的物理核心独占的，逻辑核心共享的。

L3缓存的存储速度最小，但存储容量最大，L3缓存是由所有CPU物理核心共享的。

因此，在存储速度上：寄存器>L1缓存>L2缓存>L3缓存
在存储容量上:寄存器<L1缓存<L2缓存<L3缓存
级别越小的缓存，越接近CPU，其存储速度越大，存储容量越小。

所有CPU都能访问计算机中的主内存，当然，主内存的容量比CPU缓存的容量大，CPU与内存之间的数据通信是通过总线（地址总线，数据总线，控制总线）进行的。

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