FPGA波特率与时钟周期对应

最新推荐文章于 2023-05-31 16:18:06 发布
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文章标签： fpga baud

计算出系统时钟计数值与波特率之间的关系

FPGA主板频率是50Mhz,T=20ns

 

 9600波特率指的是9600bps,9600bit/s


然后周期是1/速率 = 1/9600 = 1.0416666667*10^(-4)=104167ns

 

波特率分频计数值：104167/System_clk_period=104167/20=5208

 

计数值与波特率之间的关系如表 1 所示 

baud_set波特率波特率周期（ns）波特率周期分频计数值50MHZ系统时钟计数值
09600104167104167/system_clk_period5208-1
1192005208352083/system_clk_period2604-1
2384002604126041/system_clk_period1302-1
3576001736117361/system_clk_period868-1
411520086808680/system_clk_period434-1

 

设计小工人
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