计算机组成原理学习笔记总结-第一章 计算机系统概论

参考视频:计算机组成原理慕课

参考书本:白中英 戴志涛 等《计算机组成原理》

1.0 导学

基础课:数电与逻辑、汇编、硬件描述语言、高级语言程序设计

核心专业基础课:计算机组成原理、操作系统

专业课:嵌入式系统、存储系统、计算机系统、网络系统、数据库系统

计算机组成原理 主要讲解 运算器、控制器、存储器的结构和原理、设计方法,以及互连构成整机的技术。

1.1 冯·诺依曼结构和层次结构分析

/1 冯·诺依曼计算机核心思想

(1)存储程序:将程序存放在计算机的存储器中

(2)程序控制:按 指令地址 访问存储器并取出指令,经译码依次产生指令执行所需的控制信号,实现对计算的控制,完成指令的功能

/2 冯·诺依曼计算机分为 硬件系统 和 软件系统

硬件系统分为:运算器、控制器、适配器、存储器、输入输出设备

主机:CPU(运算器、控制器)、内存

外设:输入、输出设备,外存储器

总线:控制线、数据线、地址线

存储器中,容量->地址线数量  1K -> 10    1M -> 20    1G -> 30  那么256G = 2^8G -> 30+8 = 38

 软件分为:系统软件、支持软件、应用软件

/3 计算机的层次结构

以指令集架构层为软、硬件分界线

层次越低,执行效率越高,透明度越低

在设计时,需要有系统观,软硬件相互影响

1.2 计算机系统性能评价

/1  非时间指标

(1)机器字长:机器一次能处理的二进制位数

(2)总线宽度:数据总线一次能够并行传输传送的最大信息的位数

(3)主存容量:一一台计算机主存所包含的存储单元总数

        存储带宽:单位时间内存储器与主存交换的二进制信息量,单位B/s(字节/秒),影响因素:数据位宽、数据传输速率

/2 时间指标

(1)主频f:CPU内核工作的时钟频率,即CPU内数字脉冲信号振荡的速率

        时钟周期T:节拍周期,是计算机内最小最基本的单位,一个T内,CPU仅完成一个最基本的工作。f = 1 / T,即f = 100MHz, T= 10ns; f = 1GHz, T = 1ns

        外频:CPU与主板之间同步的时钟频率。即系统总线的工作频率

        倍频: CPU主频与外频的倍数,f = 外频 * 倍频

(2)CPI:每条指令周期数,即执行一条指令所需的平均时钟周期数。CPI = 执行某段程序所需CPU时钟周期数 / 程序包含的指令条数 = sum(程序中各类指令的CPI * 该指令的比例)

(3)MIPS:每秒CPU执行的指令总条数(百万条/秒)。MIPS = 指令条数 / (执行时间*10^6) = 指令条数 / ((所有指令CPU时钟周期数之和/f)* 10^6) = f / (CPI * 10^6)

/3 CPU时间 = 所有指令CPU时钟周期数之和 / f

执行一段程序所需时间 = CPU时间 + I/O时间 + 存储访问时间 + 各类排队时延等

(1)考虑CPI后的CPU时间 t =  = 总指令数 * CPI * T

(2)考虑MIPS后的CPU时间 t = 指令指数 / (MIPS*10^6),因为MIPS = 指令条数 / (执行时间*10^6)

1.3  计算机性能测试

针对CPU、显卡、硬盘、内存等不同测试工具、综合测试

%%%

1.计算机字长一般与通用寄存器的位数相同,一般与运算器的数据位相同

2.若某程序编译后生成的目标代码由A、B、C、D四类指令组成,它们在程序中所占比例分别为40%、20%、15%、25%。已知A、B、C、D四类指令的CPI分别为1、2、2、2。现需要对程序进行编译优化,优化后的程序中A类指令条数减少了一半,而其它指令数量未发生变化。假设运行该程序的计算机CPU主频为500MHZ。优化后程序的MIPS 为(保留到小数点后1位)
20/80 * 1 + 20/80 * 2 + 15/80 * 2 + 25/80 * 2 = 1.75 

3.计算机硬件能直接执行的是  机器语言

本科生期末试卷六 一. 选择题(每小题1分,共10分) 1. 完整的计算机应包括___d___。 A 运算器、存储器、控制器 ; B 外部设备和主机 ; C 主机和实用程序 ; D 配套的硬件设备和软件系统 ; 2. 用64位字长(其中1位符号位)表示定点小数时,所能表示的数值范围是___b___。 A [ 0,264 – 1 ] B [ 0,263 – 1 ] C [ 0,262 – 1 ] D [ 0,263 ] 3. 四片74181ALU和1片74812CLA器件相配合,具有如下进位传递功能___b___。 A 行波进位 ; B 组内先行进位,组间先行进位 ; C 组内先行进位,组间行波进位 ; D 组内行波进位,组间先行进位 ; 4. 某机字长32位,存储容量为 1MB,若按字编址,它的寻址范围是___c___。 A 0—1M B 0—512KB C 0—256K D 0—256KB 5. 某一RAM芯片,其容量为512×8位,除电源和接地端外,该芯片引出线的最小数目应是___d___。 A 23 B 25 C 50 D 19 6.堆栈寻址方式中,设A为通用寄存器,SP为堆栈指示器,MSP为SP指示器的栈顶单元,如果操作的动作是:(A)→MSP ,(SP)- 1 →SP ,那么出栈的动作应是___b___。 A (MSP)→A, (SP) + 1→SP ; B (SP) + 1→SP ,(MSP)→A ; C (SP) - 1→SP ,(MSP)→A ; D (MSP)→A ,(SP) - 1→SP ; 7.指令周期是指___c___。 A CPU从主存取出一条指令的时间 ; B CPU执行一条指令的时间 ; C CPU从主存取出一条指令加上CPU执行这条指令的时间 ; D 时钟周期时间 ; 8.在___a___的微型计算机系统中,外设可和主存贮器单元统一编址 ,因此可以不使用I / O指令。 A 单总线 B 双总线 C 三总线 D 多总线 9.在微型机系统中,外围设备通过___a___与主板的系统总线相连接。 A 适配器 B 设备控制器 C 计数器 D 寄存器 10.CD—ROM光盘的标准播放时间为60分钟。在计算模式1情况下,光盘的存储容量为 ___b___。 A 601MB B 527MB C 630MB D 530MB 二. 填空题(每小题3分,共24分) 1.计算机的硬件包括A.___存储器___,B.___运算器___,C.___控制器___适配器,输入输出部分。 2.按IEEE764标准,一个浮点数由A.___符号位___,阶码E ,尾数m 三部分组成。其中阶码E 的值等于指数的B.___基值___加上一个固定C.___偏移量___。 3.存储器的技术指标有A.___存储容量___,B.___存储时间___,C.__存储周期____,存储器带宽。 4.指令操作码字段表征指令的A.___操作___,而地址码字段指示B.__特征与功能___。微小型机多采用 C.___操作数的地址___混合方式的指令格式。 5. CPU中至少有如下六类寄存器,除了A.___指令___寄存器,B.____程序__计数器,C.___地址___寄存器外,还应有通用寄存器,状态条件寄存器,数据缓冲寄存器。 6.总线有A.___物理___特性,B.___功能___特性,电气特性,C.___机械___特性。 7.不同的CRT显示标准所支持的最大A.__分辨率___和B.___颜色___数目是C.___不同___的。 8.中断处理需要有中断A.___优先级仲裁___,中断B.___向量___产生,中断C.___控制逻辑___等硬件支持。 三.应用题 1. (11分)设有两个浮点数 N1 = 2j1 × S1 , N2 = 2j2 × S2 ,其中阶码2位,阶符1位,尾数四位,数符一位。设 :j1 = (-10 )2 ,S1 = ( +0.1001)2 j2 = (+10 )2 ,S2 = ( +0.1011)2 求:N1 ×N2 ,写出运算步骤及结果,积的尾数占4位,要规格化结果,用原码阵列乘法器求尾数之积。 2. (11分)已知某8位机的主存采用半导体存贮器,地址码为18位,若使用4K×4位RAM芯片组成该机所允许的最大主存空间,并选用模块条的形式,问: (1) 若每个摸条为32K×8位,共需几个模块条? (2) 每个模块内共有多少片RAM芯片? (3) 主存共需多少RAM芯片?CPU如何选择各模块条? 3. (11分)图B6.1是某SRAM的写入时序,其中R / W 是读 、写命令控制线,当R / W 线为低电平时,存贮器按给定地址把数据线上的数据写入存贮器。请指出图中时序的错误,并画出正确的写入时序。 图B6.1 4. (11分)某计算机有如下部件:ALU,移位器,主存M,主存数据寄存器MDR,主存地址寄存器MAR,指令寄存器IR,通用寄存器R0——R3 ,暂存器C和D。 (1) 请将各逻辑部件组成一个数据通路,并标明数据流向。 (2) 画出“ADD R1,(R2)+ ”指令指令周期流程图,指令功能是 (R1)+((R2))→R1。 ALU 图B6.2 5. (11分)集中式仲裁有几种方式?画出计数器定时查询方式的逻辑结构图,说明其工作原理。 6. (11分)刷存的主要性能指标是它的带宽。实际工作时显示适配器的几个功能部分要争用刷存的带宽。假定总带宽的50%用于刷新屏幕,保留50%带宽用于其他非刷新功能。 (1) 若显示工作方式采用分辨率为1024×768,颜色深度为3B,帧频(刷新速率)为72HZ,计算总带宽。 (2) 为达到这样高的刷存带宽,应采取何种技术措施?
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