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RSS订阅原创 滤波器如何用Verilog实现
在此Verilog实现中，input参数包括时钟、复位和输入数据。output参数是滤波器处理后的数据。模块使用参数指定了滤波器的数据位宽度、系数位宽度和电路中使用的移位寄存器数量。移位寄存器和系数存储在reg变量中。在always块中，滤波器执行计算并将结果存储到输出端口中。初始化块用于设置滤波器系数。滤波器的Verilog实现可以使用数字信号处理（DSP）技术。数字信号处理使用离散时间信号的数字表现来处理信号。请注意，这只是一个简单的Verilog实现示例。实际的滤波器可能需要更复杂的结构和算法。
2023-09-08 16:04:07
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原创 Python去水印操作
看到有很多去水印的资源，但是有的方程并不适合新的python，或者转化后的清晰度太低，所以在前人的代码上改了一下，让fitz打开时存储更多信息.至于如何确定水印RGB，推荐微信截图功能，在将pdf转换成图片时可以先查看一下，我转的pdf的水印大部分的RGB加起来是631，但是边缘还是会没被去除干净，所以也可以用>=而不是==。...
2022-06-22 18:23:58
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原创 HDLBits Design a Moore FSM
对于该题，出了S1，S2，S3对应的状态机外不难写外，还有dfr的设置，其变化阶段在每次时钟的上升沿时判断，当S有变化时判断是水位线往下还是往上，往下走则dfr=1，往上则为0，其它情况不变module top_module ( input clk, input reset, input [3:1] s, output fr3, output fr2, output fr1, output dfr); reg [3:0] fr,nex
2022-04-10 22:29:49
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原创 error LNK2022: 无法解析的外部符号 glfwInit，函数 main 中引用了该符号
碰到这个问题后在网上搜了很多类似情况都不能解决，突然注意到在Cmake生产glfw后会产生新的lib，于是在build中生成的诸多文件中又找到了一个glfw3.lib, 将此代替原来lib目录下的同名文件，问题解决...
2022-01-15 06:25:08
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空空如也
空空如也
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