并发与高并发专题--并发编程操作系统基础

本文介绍了CPU多级缓存及其必要性,详细讲解了局部性原理,探讨了存储器的层次结构,包括高速缓存的组织结构,并触及了缓存一致性问题,特别是MESI协议。此外,还提到了乱序执行优化在提升处理器效率中的作用。
摘要由CSDN通过智能技术生成

一、CPU多级缓存


1.1 简单介绍CPU参数

当前笔者所用的笔记本CPU是8代i7-8750H(6核12线程、频率2.2GHz/睿频4.1GHz、三级缓存9MB)。
主频,可以理解为处理速度,相当于手臂肌肉,主频越高,力量越大。睿频是临时的超频。
核心,相当于手臂,6核即六条手臂。
线程,相当于手,6核12线程相当于每个手臂长两只手,提高干活效率,压榨单一CPU核心的处理能力。


1.2 CPU 缓存的必要性

最早的CPU是与主存直接数据交互,CPU将主存的数据取出送到寄存器中,计算完毕后写回主存。但随着CPU的快速发展,内存数据的I/O速度远远不及CPU的处理速度,这就导致CPU等待,浪费资源。

高速缓存的出现是为了缓解CPU与内存之间速度不匹配的问题。此时CPU数据的存取都要经过高速缓存。将运算所需的数据复制到缓存中,让运算快速进行,运算结束后再从缓存同步回内存。


1.3 局部性原理

计算机的存储系统采用分级存储体系的理论依据是程序访问的局部性原理。CPU访问存储器时,无论是存取指令还是存取数据,所访问的存储单元都趋于聚集在一个较小的连续区域中。
(1)时间局部性:如果某个数据被访问,那么在不久的将来它很可能再次被访问,例如循环、堆栈(包括递归)。
(2)空间局部性:如果某个数据被访问,那么与它相邻的数据很快也可能被访问,例如数组。

 int sum = 0;
 
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