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文章平均质量分 70
AXDC_QA_Team
这个作者很懒,什么都没留下…
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MPEG4码流简单分析
测试解码器测试了很久,由于需要将H264和MPEG4的码流进行分析和判断,并逐帧输入解码器进行测试,如何正确的分析码流,并将Video送给我们的解码器做Decode的呢?耐着性子找了很多资料,主要也因为我本身对MPEG4和H264的码流的格式并不懂,自己在视频编码方面的积累也实在是太少了,所以也确实挺头疼的。后来就直接在网上找是否有对码流的各个部分意义的解释,开始搜索码流中的的StartC原创 2009-04-02 10:06:00 · 12948 阅读 · 5 评论 -
FFMPEG使用参数详解
目前又开始测MPEG1和MPEG2的解码,在准备编码好的测试序列过程中,需要通过编码器来进行原始视频序列的编码操作,以生成我们需要的测试数据。由于IPP example提供的Encoder不支持MPEG1,经过查询,决定MPEG1的编码使用FFMPEG。FFMEPG是个啥子东西呢,这里简单说一下:FFmpeg是用于录制、转换和流化音频和视频的完整解决方案,一套领先的音/视频编解码类库。FF原创 2009-05-20 17:10:00 · 48097 阅读 · 1 评论 -
MPEG1和MPEG2码流结构分析
上次测试MPEG4和H264的时候,由于要进行分帧输入解码器测试,因此进行了MPEG4和H264码流的简单分析,MPEG4码流的分析见上次记录的那篇文章。目前又要开始测试MPEG1和MPEG2码流的解码了,同样,对这两种码流也进行一下简单的分析,通过搜集资料和查看两种标准的协议13818-2和11172-2,了解这两种码流格式的一些基本结构,今天把它们也在此做一个简单的整理和记录,也便于以后的原创 2009-05-31 17:51:00 · 10362 阅读 · 4 评论 -
AAC的各种规格
Hi,又来写点儿小记录心得吧,这次是在准备AAC音频解码的规格中发现和总结出的一些问题,大概的情况在这里简要做一小记,为我们最后确立规格提供参考,当然我对AAC规格的了解还很稚嫩,有些表述不太确切的地方,还请大家指正: 一、规格(profile)问题:wiki上说到,AAC共有9种规格,以适应不同的场合的需要:l MPEG-2 AAC LC 低复杂度规格(Low C原创 2009-06-15 17:30:00 · 10984 阅读 · 4 评论 -
虚拟机 VMware Tool 安装说明
1、启动并进入Linux系统。2、然后选择虚拟机菜单中的“虚拟机/安装VMware-Tools”,此时就会有把VMware-tools文件映像到CD-ROM中。3、把“VMwareTools-6.0.2-59824.i386.rpm,VMwareTools-6.0.2-59824.tar.gz”文件复制到自己的需要的位置中,然后选择一种安装方式。在此我选VMwareTools-6.0.2-59824.tar.gz。4、解压# tar -zxvf VmwareTools-6.0.2-5转载 2010-06-01 14:42:00 · 2975 阅读 · 0 评论 -
WANPLL时钟芯片
<br />Ps: 记录WANPLL广域网锁相环 时钟芯片一些知识<br /> <br />WANPLL时钟芯片<br /><br /> 时钟同步和时钟分配的设计在电信产品设计中一向居于核心地位。时钟设计的优劣,往往关系到产品的能否正常开通业务、能否连结极低的误码率等,也关系到产品自己所体现的设计水准和产品的市场竞争力。<br /> 在电信产品中,差别类另外产品所需要的时钟种类很多。下面列举一些典型应用的时钟(表1)。<br /><br /><br /> 设计孕育发生上述时钟源的时钟板卡时,设计工程师转载 2010-12-07 18:23:00 · 2108 阅读 · 0 评论 -
T1/E1/J1单片收发器
<br />Ps: 记载一些简单的知识<br /> <br /> <br />六十年代引入T载波以来,T载波和E载波网络走过了一个漫长的发展道路,今天,设计人员将会看到越来越多的功能被集成到T1/E1/J1单片收发器(SCT)内。大量功能的引入容易使设计人员产生困惑,本文介绍了设计中需要关注的重要性能。1 T、E、J载波网络工作在1.544Mbps的T1是北美公共交换电话网络(PSTN)数字复用传输T载波层的最低速率,它最初是专为传输数字化语音信号而设计的。T1利用脉码调制和时分复用技术传输24路载波级语音原创 2010-12-07 18:34:00 · 1817 阅读 · 0 评论 -
总线相关问题介绍
1、并行总线的主要缺点——传输速度慢。原因:并行总线具有定时要求,由于并行总线有多根数据线,这些数据线传输速率无法做到完全同步。这种情况下,需要给总线设定一个脉冲时钟(clock),确定一次传输的时间,如果脉冲时钟太短,则在一个周期内数据没有传完,上一次未传完的数据又归入了下一周期的数据,这样会造成误码的产生。脉冲时钟决定了并行总线的传输速率,使它的速率不能太高。相比之下串行总线具有自定时的功能,所发送的数据都有特定标记位,告之何时开始和结束,不需要脉冲时钟的存在,可以达到很高的传输速率。2、PCI总线多主原创 2011-01-17 17:30:00 · 2344 阅读 · 0 评论