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RSS订阅原创 硬件设计踩坑：MOS 管电源控制电路的电容匹配陷阱
摘要：本文分享了硬件设计中使用MOS管控制电源通断时遇到的电源跌落问题。作者通过两次项目经历，揭示了因前后级电容容量不匹配导致的前级电压暴跌现象：第一次侥幸通过，第二次则因前级3.3V被拉至1.2V导致CPU卡死。分析指出，问题源于后级大电容在上电瞬间抢夺前级电荷。解决方案强调前级电容容量需≥后级，建议通过精确计算电容值并验证动态响应来规避风险。案例警示硬件设计中需重视电容匹配等细节，避免系统崩溃。
2025-11-06 19:29:48
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原创 PCIE 板卡导致 PC 自动开机？聊聊我踩过的 WAKE 信号设计坑
本文分析了PCIE板卡设计中因WAKE信号连接不当导致PC机"通电自启"的问题。作者误将PCIE接口的WAKE信号直接连至FPGA的GPIO引脚，由于FPGA内部保护电路的存在，3.3V_AUX辅助电源被拉低，使WAKE信号电平不稳定，触发主板误判为唤醒信号。最终解决方案是在信号间增加限流电阻和隔离二极管。通过此案例，作者总结出硬件设计需重视协议细节、深入理解芯片引脚特性、必要时进行电路仿真等经验教训，强调硬件设计中任何细节都可能导致系统性问题的观点。
2025-11-04 16:48:44
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原创 过孔数量对信号质量的影响分析
过孔在高速PCB设计中会显著影响信号质量，主要表现为：阻抗不连续引起的信号反射、寄生电容电感导致的信号畸变、返回路径不完整产生的EMI问题，以及高频下的额外损耗。高速信号（上升时间<1ns）对过孔极其敏感，需严格控制数量并优化结构；而低频信号（kHz/MHz级）由于波长长、容限大，对过孔不敏感，可采用更灵活的布线方式。这种差异体现了PCB分层设计哲学：优先保障高速信号完整性，非关键信号可适当妥协。
2025-10-30 18:32:16
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原创 DCDC电源芯片PFM与PWM模式区别解析
1. 较大的输出纹波和噪声：由于工作在不固定的频率，并且是突发式地输送能量，输出电容上的电压波动会更大，纹波电压的幅值和频率都不固定。2. 可变开关频率：变化的开关频率会产生一个较宽的噪声频谱，这给EMI（电磁干扰）滤波器的设计带来了挑战，因为你需要应对一个频带内的噪声，而不是单一的固定频率。3. 负载响应较慢：当负载突然从轻载跳变到重载时，芯片需要从休眠状态中被“唤醒”，这会有一个短暂的延迟才能提供足够的能量，导致输出电压有一个较大的跌落。负载越轻，发送脉冲的频率就越低，休眠时间越长。
2025-10-30 17:04:03
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硬件工程常见面试问题汇总：单端差分接口、DCDC/LDO电源设计、PCB布局布线及信号完整性分析
2025-10-30
空空如也
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