ARM芯片名字关系

前言

  一款ARM芯片相关的名字太多,经常搞不清楚都分别代表什么,本文就是梳理一下名字的含义层次并着重回顾一下芯片架构。
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  BCM2837是产品的名字,是博通公司的一款SoC(CPU+RAM等外设都封装在一块SoC芯片里),这款SoC包含的CPU架构是ARMv8,这个CPU的名字是ARM Cortex-A53,aarch64和aarch32是ARMv8架构处理器的两种可选的执行状态,aarch64执行状态下支持A64指令集,aarch32和传统的32位指令集被称为A32指令集

名字含义同级其他可能
BCM2837博通的SoC产品名STM32、I.MX6ULL
ARMv8-ACPU芯片的架构ARMv7
Cortex A53CPU芯片的名字,也可以说BCM2837的内核是Cortex A53(有时候就简称A53)ARM9、Cortex M3
aarch64CPU可以运行的64位执行状态aarch32

32位旧有架构

  • ARMv1是1985开发的样本,首颗量产的是1986年的ARMv2架构
  • ARM7是ARMv4架构,ARM9是ARMv5架构,ARM11是ARMv6架构。这些都是2004年以前老架构芯片
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32位Cortex架构

  • 2004年到了ARMv7架构的时候开始以Cortex来命名,并分成Cortex-A、Cortex-R、Cortex-M三个系列。 三大系列分工明确:“A”系列面向尖端的基于虚拟内存的操作系统和用户应用; “R”系列针对实时系统; “M”系列对微控制器[1]
  • NEON技术从ARMv7开始被采用,目前可以在ARM Cortex-A和Cortex-R系列处理器中采用。
    NEON在Cortex-A7、Cortex-A12、Cortex-A15处理器中被设置为默认选项,但是在其余的ARMv7 Cortex-A系列中是可选项。NEON与VFP共享了同样的寄存器,但它具有自己独立的执行流水线[2]。
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64位架构

  • armv8架构的64位芯片既可以选择运行aarch64执行状态也可以选择运行aarch32执行状态,并且ARMv8架构的芯片支持32位的程序在64位的系统里运行

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  • Armv7-A, Armv8-A AArch32 and Armv8-A AArch64 指令集之间的关系
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时间线及几个常见芯片

  • STM32F103芯片是Cortex-M3内核,ARMV7-M指令集架构
  • STM32F407芯片是Cortex-M4内核,ARMv7-ME指令集架构
  • 树莓派RPI A+/B+/Zero的BCM2835带的是ARM11内核
  • 树莓派RPI2 B的BCM2836带的是Cortex A7内核
  • 树莓派RPI3 B/B+的BCM2837带的是Cortex A53内核
  • 树莓派RPI4 B的BCM2711带的是Cortex A72内核
  • I.MX6ULL是Cortex A7内核
  • Tegra X2(Jetson Tx2的SoC )带四核Cortex A57+双核Denver 2(只知道是ARMv8架构不知道具体哪个芯片,具体不太懂没研究过)
  • 海思的麒麟(Kirin)960、970是Cortex A73
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参考资料

[1]https://zhuanlan.zhihu.com/p/92315825
[2]https://zyddora.github.io/2016/02/28/neon_1/
[3]https://zh.wikipedia.org/wiki/ARM%E6%9E%B6%E6%A7%8B

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Table of Contents 1 Introduction 4 1.1 Overview 4 1.2 Address map 4 1.2.1 Diagrammatic overview 4 1.2.2 ARM virtual addresses (standard Linux kernel only) 6 1.2.3 ARM physical addresses 6 1.2.4 Bus addresses 6 1.3 Peripheral access precautions for correct memory ordering 7 2 Auxiliaries: UART1 & SPI1, SPI2 8 2.1 Overview 8 2.1.1 AUX registers 9 2.2 Mini UART 10 2.2.1 Mini UART implementation details. 11 2.2.2 Mini UART register details. 11 2.3 Universal SPI Master (2x) 20 2.3.1 SPI implementation details 20 2.3.2 Interrupts 21 2.3.3 Long bit streams 21 2.3.4 SPI register details. 22 3 BSC 28 3.1 Introduction 28 3.2 Register View 28 3.3 10 Bit Addressing 36 4 DMA Controller 38 4.1 Overview 38 4.2 DMA Controller Registers 39 4.2.1 DMA Channel Register Address Map 40 4.3 AXI Bursts 63 4.4 Error Handling 63 4.5 DMA LITE Engines 63 5 External Mass Media Controller 65 o Introduction 65 o Registers 66 6 General Purpose I/O (GPIO) 89 6.1 Register View 90 6.2 Alternative Function Assignments 102 6.3 General Purpose GPIO Clocks 105 7 Interrupts 109 7.1 Introduction 109 7.2 Interrupt pending. 110 7.3 Fast Interrupt (FIQ). 110 7.4 Interrupt priority. 110 7.5 Registers 112 8 PCM / I2S Audio 119 8.1 Block Diagram 120 8.2 Typical Timing 120 8.3 Operation 121 8.4 Software Operation 122 8.4.1 Operating in Polled mode 122 8.4.2 Operating in Interrupt mode 123 8.4.3 DMA 123 8.5 Error Handling. 123 8.6 PDM Input Mode Operation 124 8.7 GRAY Code Input Mode Operation 124 8.8 PCM Register Map 125 9 Pulse Width Modulator 138 9.1 Overview 138 9.2 Block Diagram 138 9.3 PWM Implementation 139 9.4 Modes of Operation 139 9.5 Quick Reference 140 9.6 Control and Status Registers 141 10 SPI 148 10.1 Introduction 148 10.2 SPI Master Mode 148 10.2.1 Standard mode 148 10.2.2 Bidirectional mode 149 10.3 LoSSI mode 150 10.3.1 Command write 150 10.3.2 Parameter write 150 10.3.3 Byte read commands 151 10.3.4 24bit read command 151 10.3.5 32bit read command 151 10.4 Block Diagram 152 10.5 SPI Register Map 152 10.6 Software Operation 158 10.6.1 Polled 158 10.6.2 Interrupt 158 10.6.3 DMA 158 10.6.4 Notes 159 11 SPI/BSC SLAVE 160 11.1 Introduction 160 11.2 Registers 160 12 System Timer 172 12.1 System Timer Registers 172 13 UART 175 13.1 Variations from the 16C650 UART 175 13.2 Primary UART Inputs and Outputs 176 13.3 UART Interrupts 176 13.4 Register View 177 14 Timer (ARM side) 196 14.1 Introduction 196 14.2 Timer Registers: 196 15 USB 200 15.1 Configuration 200 15.2 Extra / Adapted registers. 202
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