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vivado中DDR的VERILOG程序
软件版本:vivado2019,其他版本需要update一下IP核
编程语言:verilog
功能:实现通过MIG的IP核配置DDR,往DDR中写入累加数,并读出累加数,可修改读写.v来实现自己想要的功能,速率在IP核中可配置。
可通过testbench仿真,该程序已经下板验证过,有问题欢迎评论区交流。
2024-07-22
FMCW三角波雷达测距测速matlab程序
代码注释详细,可实现FFT单目标测距测速,参数可修改。实用价值高,适合初学者学习。可生成接收信号与发射信号时频图、接收信号与发射信号中频时频图、距离维FFT结果图、测距结果与测速结果。
2024-07-19
空空如也
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