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原创 PSpice for TI 设计和仿真工具 获取下载安装

在进行TI电源芯片选型阶段时不时会使用到仿真工具,TI的电源芯片一般都会有PSpice Model、TINA-TI Spice Model,TINA-TI Spice Model可以使用TI的TINA-TI工具直接使用仿真,并且工具获取较容易,无需申请;但很多芯片是不提供TINA-TI Spice Model的,考虑到更加方便的去验证还是需要使用到PSpice for TI 工具。部分介绍:PSpice® for TI 可提供帮助评估模拟电路功能的设计和仿真环境。

2025-08-20 15:08:31 1967

原创 树莓派5/Raspberry Pi 5 降低关机功耗

树莓派5在官方系统下的默认关机功耗约为1-1.4W,如果需要更低的关机功耗,可以通过修改EEPROM 配置文件降低功耗,可以使得关机功耗降低为0.01W左右。硬件版本:Raspberry Pi 5系统版本:Raspberry Pi OS(64-bit)本文章主要为笔记记录,是在指定的系统硬件、软件条件下调试,仅供参考。

2024-09-12 13:40:48 1496

原创 Allegro设置文件自动保存

Allegro绘制PCB时,难免因为某种原因会闪退崩溃等异常导致PCB未及时保存,通过设置可以自动保存PCB,保存时间间隔10-300分钟,避免未完成的设计全部丢失,至少可以挽回绝大部分。软件版本:Allegro16.6以上是Allegro设置自动保存的方法,自动保存建议一般是打开的,同时也要保持及时手动保存的习惯,避免不必要的损失。

2024-07-26 13:37:51 3142

原创 Allegro测量对象时显示两种不同单位数值

Allegro绘制PCB时,通常在进行测量时,可能需要快速的显示另外一种单位值,比如PCB设计单位为mil,如何在测量时直接显示mm,可以通过设置同时显示mil、mm两种单位值。软件版本:Allegro16.6该方法适合进行设计时需要不同单位显示,减少换算步骤,按照个人习惯,通常习惯mil和mm两种单位,亦可更改。

2024-07-25 14:25:49 2161

原创 Allegro覆铜后修改某一单独焊盘(PIN)连接方式

Allegro绘制PCB时,在设置覆铜后,如何让某一焊盘(Pin)更改覆铜形式?比如默认全部十字连接,某一焊盘(Pin)全覆铜连接。软件版本:Allegro16.6该方法一般的适用于动态铜皮,同时可以支持多个Pin同时修改。

2024-01-24 17:37:05 2693

原创 Allegro中查看Pin总数量

Allegro打开的PCB中,如何查看所有Pin的数量?以及元器件的数量。软件版本:Allegro16.6查看方法还可以通过PCB中选中Pin后查看,推荐打开Report查看。

2024-01-22 14:33:49 4645

原创 Allegro恢复被删除的孤铜(Islands)

Allegro绘制PCB中,删除的Islands(孤铜)如何恢复?软件版本:Allegro16.6提示:以下是本篇文章正文内容,下面案例可供参考提示:这里对文章进行总结:例如:以上就是今天要讲的内容,本文仅仅简单介绍了pandas的使用,而pandas提供了大量能使我们快速便捷地处理数据的函数和方法。

2023-11-30 18:01:06 1816

ds180-7Series-Overview.pdf

内容概要:本文介绍了Xilinx公司7系列FPGA产品家族的全面概述,涵盖Artix-7、Kintex-7和Virtex-7三大系列,基于28nm高k金属栅(HKMG)工艺打造,具备高性能、低功耗特性。各系列产品针对不同应用场景优化:Artix-7面向低成本、小尺寸、高量产需求;Kintex-7提供最佳性价比,性能较前代提升两倍;Virtex-7则面向最高系统性能与容量,采用堆叠硅互连(SSI)技术实现超高集成度。文档详细列出了各系列在逻辑单元、DSP切片、块RAM、高速收发器、PCIe接口等方面的技术参数,并提供了具体器件型号的功能汇总与封装选项。此外,还介绍了关键架构特性,如6输入查找表(LUT)、时钟管理模块(CMT)、XADC模拟混合信号功能、部分可重配置、AES加密等,展示了其在通信、工业、医疗、航空航天等领域的广泛应用潜力。; 适合人群:从事FPGA开发的硬件工程师、系统架构师、集成电路设计相关人员以及高校研究人员。; 使用场景及目标:①用于评估和选型适用于特定项目需求的Xilinx 7系列FPGA芯片;②为高性能计算、高速接口设计、信号处理、嵌入式系统等应用提供技术支持参考;③作为学习FPGA架构与先进制造工艺的教学资料。; 阅读建议:此文档为产品规格说明书,建议结合实际设计需求查阅相关章节,重点关注器件资源对比表和技术特性描述,同时可访问Xilinx官网获取配套设计工具、IP核及用户指南以支持完整开发流程。

2026-01-26

ug474-7Series-CLB.pdf

内容概要:本文档为Xilinx 7系列FPGA可配置逻辑块(CLB)的技术参考指南,详细介绍了CLB的架构、功能模块及其应用。主要内容包括CLB的基本组成(如LUT、存储单元、多路复用器、进位链)、SLICEL与SLICEM的区别、分布式RAM和移位寄存器的实现方式、时序模型以及设计实例等。文档还涵盖了高级主题,如锁存器作为逻辑门的使用、全局控制信号GSR/GTS、堆叠硅互连技术(SSI)对布局布线的影响等,旨在帮助设计人员优化资源利用并提升性能。; 适合人群:从事FPGA设计的研发工程师、数字电路设计人员及高年级电子工程专业学生,需具备基本的硬件描述语言(HDL)和数字逻辑设计基础。; 使用场景及目标:①指导开发者在7系列FPGA中高效使用CLB资源进行逻辑、算术和存储功能的设计;②支持复杂功能如加法器、计数器、移位寄存器和小型存储器的底层实现与性能优化;③辅助进行时序分析和资源规划,提升设计密度与运行速度。; 阅读建议:建议结合Xilinx开发工具(如ISE或Vivado)实际操作,参考文档中的原语实例和时序参数进行仿真验证,并关注SLICEM特有功能的应用限制与布局约束。

2026-01-26

ug471-7Series-SelectIO.pdf

内容概要:本文档为赛灵思(Xilinx)7系列FPGA的SelectIO资源用户指南,全面介绍了7系列FPGA(包括Spartan-7、Artix-7、Kintex-7和Virtex-7家族)的输入/输出(I/O)特性与技术。文档详细阐述了SelectIO资源的电气行为、逻辑资源及其高级功能,涵盖I/O标准、电压要求、阻抗控制、延迟机制、数据串并/并串转换以及噪声分析等方面。重点包括HP(高性能)和HR(高范围)I/O银行的区别、数字可控阻抗(DCI)、可编程输入/输出延迟(IDELAY/ODELAY)、串行器/解串器(ISERDESE2/OSERDESE2)以及I/O FIFO等关键技术和配置方法。 适合人群:从事FPGA设计的电子工程师、硬件设计师和系统架构师,特别是需要深入理解并应用7系列FPGA高速I/O接口的设计人员。 使用场景及目标:① 设计符合特定电平标准(如LVDS、HSTL、SSTL等)的高速接口电路;② 优化信号完整性,利用DCI、IDELAY和ODELAY进行精确的时序控制和阻抗匹配;③ 实现高速源同步数据传输,如内存接口(DDR3)或通信协议;④ 进行功耗、性能和信号质量的权衡设计,满足复杂系统的需求。 其他说明:本文档是官方权威的技术参考手册,应与具体器件的数据手册和设计工具(如Vivado)配合使用。所有技术参数和功能均以最新版本为准,实际设计时需严格遵守文档中的规则和约束。

2026-01-26

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