中的PLL、MPLL、UPLL、FCLK、HCLK、PCLK的作用概述

原文:http://blog.sina.com.cn/s/blog_6ba8e4380102w0jl.html
　　S3C2440 CPU主频可达400MHz,开发板上的外接晶振为12M,通过时钟控制逻辑的PLL(Phase Locked Loop,锁相环电路)来倍频这个系统时钟。2440有两个PLL（phase locked loop）一个是MPLL,一个是UPLL。UPLL专用于USB设备,常用频率为48MHz和96MHz。MPLL用于CPU及其他外围器件,用于产生FCLK、HCLK、 PCLK三种频率,上电时,PLL并没有被启动,FCLK=Fin=12MHz,若要提高系统时钟,需要软件来启动PLL。

1，FCLK是向CPU提供的时钟信号。 

2，HCLK是向AHB(Advanced High-performance Bus)总线提供的时钟信号，主要用于高速外设、比如内存控制器、中断控制器、LCD控制器、DMA等。 

3，PCLK是向APB(Advanced Peripherals Bus)总线提供的时钟信号，主要用于低速外设，比如看门狗、UART控制器、IIS、I2C、SDI/MMC、GPIO、RTC和SPI等。